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다층 고전도 인쇄 전자 회로 소재 및 이를 이용한 신축성 임베디드 회로 기판의 제조 방법(METHOD OF MANUFACTURING EMBEDDED PRINTED CIRCUIT BOARD AND EMBEDDED PRINTED CIRCUIT BOARD USING MULTI STRUCTURED CIRCUIT MATERIAL)

  • 기술번호 : KST2017012412
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 다층 고전도 인쇄 전자 회로 소재 및 이를 이용한 신축성 임베디드 회로 기판의 제조 방법에 관한 것이다. 본 발명에 따르면, 기판에 인쇄된 전자 회로를 유연성, 신축성, 투명성을 갖는 유동성 폴리머 내부에 전사시켜 임베딩된 형태로 유연하고 신축성 있는 회로 기판을 제공하게 된다.본 발명에 따르면, 희생 기판을 이용하여 희생 기판 상에 인쇄 회로를 인쇄하고 먼저 소결을 한 이후에 인쇄 회로를 유동성 폴리머에 임베딩 시킴으로써, 인쇄 회로의 박리 발생을 방지하고, 기판의 손상을 발생시키지 않으면서, 신뢰성이 우수한 신축성 임베디드 인쇄 회로 기판을 제공한다.
Int. CL H05K 3/10 (2016.03.04) H05K 1/03 (2016.03.04) H05K 1/09 (2016.03.04) H05K 3/12 (2016.03.04)
CPC H05K 3/103(2013.01) H05K 3/103(2013.01) H05K 3/103(2013.01) H05K 3/103(2013.01) H05K 3/103(2013.01) H05K 3/103(2013.01)
출원번호/일자 1020160006870 (2016.01.20)
출원인 성균관대학교산학협력단
등록번호/일자
공개번호/일자 10-2017-0087183 (2017.07.28) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.01.20)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 정승부 대한민국 서울특별시 동작구
2 정광호 대한민국 경기도 김포시 김포한강*로 *,
3 김대곤 대한민국 경기도 화성시 병점중앙로 ***-**
4 박범근 대한민국 경기도 용인시 기흥구
5 방제오 대한민국 서울특별시 구
6 이충재 대한민국 경기도 수원시 장안구

대리인

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번호 이름 국적 주소
1 남건필 대한민국 서울특별시 영등포구 경인로 ***, *동 ***호(엔씨 국제특허법률사무소)
2 박종수 대한민국 서울특별시 영등포구 경인로 ***, *동 ***호(엔씨 국제특허법률사무소)
3 차상윤 대한민국 서울특별시 영등포구 경인로 ***, *동 ***호(엔씨 국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.01.20 수리 (Accepted) 1-1-2016-0063620-53
2 선행기술조사의뢰서
Request for Prior Art Search
2017.01.10 수리 (Accepted) 9-1-9999-9999999-89
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
4 선행기술조사보고서
Report of Prior Art Search
2017.03.13 발송처리완료 (Completion of Transmission) 9-6-2017-0047268-68
5 의견제출통지서
Notification of reason for refusal
2017.04.03 발송처리완료 (Completion of Transmission) 9-5-2017-0242747-22
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.05.23 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0490059-87
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.05.23 수리 (Accepted) 1-1-2017-0490049-20
8 거절결정서
Decision to Refuse a Patent
2017.10.11 발송처리완료 (Completion of Transmission) 9-5-2017-0701746-76
9 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.10.30 수리 (Accepted) 1-1-2017-1069579-76
10 [명세서등 보정]보정서(재심사)
Amendment to Description, etc(Reexamination)
2017.10.30 보정승인 (Acceptance of amendment) 1-1-2017-1069580-12
11 의견제출통지서
Notification of reason for refusal
2017.11.17 발송처리완료 (Completion of Transmission) 9-5-2017-0802402-77
12 거절결정서
Decision to Refuse a Patent
2018.05.01 발송처리완료 (Completion of Transmission) 9-5-2018-0299318-18
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번호 청구항
1 1
희생 기판을 준비하는 단계;상기 희생 기판 상에 잉크 또는 페이스트를 이용하여 인쇄 회로를 인쇄하는 단계;상기 인쇄 회로를 소결시키는 단계;상기 희생 기판 및 상기 인쇄 회로 상에 유동성 폴리머(liquidity polymer)를 코팅하고 경화시키는 단계; 및상기 희생 기판을 제거하는 단계를 포함하는,임베디드 회로 기판의 제조 방법
2 2
제 1 항에 있어서,상기 희생 기판은 PI, 유리(glass), Si, PET, PEN 중 어느 하나가 이용되는,임베디드 회로 기판의 제조 방법
3 3
제 1 항에 있어서,상기 희생 기판의 표면을 소수성 플라즈마 처리하여 상기 희생 기판과 상기 인쇄 회로 간의 접착성을 떨어뜨려 상기 희생 기판의 제거를 용이하게 하는,임베디드 회로 기판의 제조 방법
4 4
제 1 항에 있어서,상기 잉크 또는 페이스트는, 전도성 입자, 분산제 및 바인더를 포함하는,임베디드 회로 기판의 제조 방법
5 5
제 4 항에 있어서,상기 전도성 입자는,전도성 나노 입자, 전도성 마이크로 입자, 전도성 나노 와이어, 전도성 마이크로 와이어, 전도성 마이크로 플레이크, 전도성 나노 플레이크, 금속 입자, 탄소나노튜브, 그래핀 분말 중 어느 하나 이상을 포함하는,임베디드 회로 기판의 제조 방법
6 6
제 5 항에 있어서,상기 전도성 입자로 금속 입자 및 탄소나노튜브의 복합 입자가 이용되는 경우,금속 입자와 탄소나노튜브 간의 화학적 결합이 이루어지도록 탄소나노튜브를 산처리 하여 분산시킨 후 금속 염과 혼합시켜 탄소나노튜브가 금속 이온과 결합하도록 처리하는,임베디드 회로 기판의 제조 방법
7 7
제 1 항에 있어서,상기 인쇄 회로의 인쇄는 복수회 반복 가능하며, 이에 의해 인쇄 회로가 다층으로 인쇄 가능한,임베디드 회로 기판의 제조 방법
8 8
제 1 항에 있어서,상기 인쇄 회로를 소결시키는 단계 이후 상기 인쇄 회로의 표면 조도(surface roughness)를 거칠게 하는 단계를 추가로 포함하는,임베디드 회로 기판의 제조 방법
9 9
제 8 항에 있어서,상기 인쇄 회로의 표면 조도를 거칠게 하는 단계는, 상기 인쇄 회로의 표면을 노듈(nodule)화 처리 또는 플라즈마 처리에 의해 이루어지는,임베디드 회로 기판의 제조 방법
10 10
제 1 항 내지 제 9 항 중 어느 한 항의 방법에 따라 제조된 임베디드 회로 기판으로서,폴리머층; 및상기 폴리머층에 임베디드된 인쇄 회로를 포함하고,상기 인쇄 회로의 측면 및 하면이 모두 폴리머층에 의해 둘러싸인,임베디드 회로 기판
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.