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게이트 드라이버 회로 및 이를 포함하는 디스플레이 장치

  • 기술번호 : KST2018015176
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 게이트 드라이버 회로 및 이를 포함하는 디스플레이 장치를 개시한다. 본 발명의 실시예에 따른 디스플레이 패널에 게이트 구동 신호를 제공하는 게이트 드라이버 회로는, 스타트 신호를 제공받는 입력 노드, 상기 스타트 신호에 의해 프리차지된 상기 입력 노드의 전압을 제 1 클록 신호에 따라 부트스트랩하여 상기 게이트 구동 신호를 출력 노드로 출력하는 출력부, 상기 스타트 신호에 응답하여 상기 제 1 클록 신호를 레벨 쉬프트하여 제 1 노드로 출력하는 1차 리플 제어부, 및 상기 제 1 노드에 형성된 상기 제 1 클록 신호의 리플을 차단하고, 상기 스타트 신호에 응답하여 상기 제 1 노드의 전압을 상기 출력부의 일단으로 제공하는 2차 리플 제어부를 포함한다.
Int. CL G09G 3/20 (2006.01.01)
CPC G09G 3/20(2013.01) G09G 3/20(2013.01) G09G 3/20(2013.01) G09G 3/20(2013.01) G09G 3/20(2013.01)
출원번호/일자 1020170058335 (2017.05.10)
출원인 성균관대학교산학협력단
등록번호/일자 10-1989609-0000 (2019.06.10)
공개번호/일자 10-2018-0123936 (2018.11.20) 문서열기
공고번호/일자 (20190930) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2017.05.10)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 김용상 대한민국 경기도 용인시 수지구
2 오종수 대한민국 경기도 부천시 경인로 *** 심
3 김진호 대한민국 경기도 파주시 한빛로 ** 야당동

대리인

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번호 이름 국적 주소
1 특허법인로얄 대한민국 서울특별시 서초구 반포대로 ***, *층(서초동,서일빌딩)

최종권리자

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번호 이름 국적 주소
1 성균관대학교산학협력단 경기도 수원시 장안구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2017.05.10 수리 (Accepted) 1-1-2017-0445804-41
2 의견제출통지서
Notification of reason for refusal		 2018.05.20 발송처리완료 (Completion of Transmission) 9-5-2018-0341225-91
3 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2018.07.11 수리 (Accepted) 1-1-2018-0682473-14
4 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2018.07.11 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0682472-68
5 최후의견제출통지서
Notification of reason for final refusal		 2018.11.28 발송처리완료 (Completion of Transmission) 9-5-2018-0812577-61
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2019.01.14 보정승인 (Acceptance of amendment) 1-1-2019-0043300-04
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2019.01.14 수리 (Accepted) 1-1-2019-0043301-49
8 등록결정서
Decision to grant		 2019.05.30 발송처리완료 (Completion of Transmission) 9-5-2019-0388792-25
9 [명세서등 보정]보정서(심사관 직권보정)
 2019.08.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2019-5025696-74
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
디스플레이 패널에 게이트 구동 신호를 제공하는 게이트 드라이버 회로에 있어서,스타트 신호를 제공받는 입력 노드;상기 스타트 신호에 의해 프리차지된 상기 입력 노드의 전압을 제 1 클록 신호에 따라 부트스트랩하여 상기 게이트 구동 신호를 출력 노드로 출력하는 출력부;상기 스타트 신호에 응답하여 상기 제 1 클록 신호를 레벨 쉬프트하여 제 1 노드로 출력하는 1차 리플 제어부; 및상기 제 1 노드에 형성된 상기 제 1 클록 신호의 리플을 차단하고, 상기 스타트 신호에 응답하여 상기 제 1 노드의 전압을 상기 출력부의 일단으로 제공하는 2차 리플 제어부를 포함하는, 게이트 드라이버 회로
2 2
제1항에 있어서, 상기 1차 리플 제어부는,게이트가 상기 스타트 신호에 연결되고 드레인이 제 2 클록 신호에 연결되어 상기 스타트 신호에 응답하여 상기 제 2 클록 신호를 소스로 출력하는 제 1 트랜지스터;게이트가 제 3 클록 신호에 연결되고 드레인이 상기 제 1 트랜지스터의 소스에 연결되고 소스가 기준 전위에 연결되는 제 2 트랜지스터;게이트가 상기 제 1 트랜지스터의 소스 및 상기 제 2 트랜지스터의 드레인에 공통 연결되고 드레인이 상기 제 1 클록 신호에 연결되고 소스가 상기 제 1 노드에 연결되는 제 3 트랜지스터;게이트가 상기 제 2 클록 신호에 연결되고 드레인이 상기 제 1 노드에 연결되고 소스가 상기 기준 전위에 연결되는 제 4 트랜지스터; 및일단이 상기 제 3 트랜지스터의 게이트에 연결되고 타단이 상기 제 1 노드에 연결되는 제 1 커패시터를 포함하는, 게이트 드라이버 회로
3 3
제2항에 있어서, 상기 게이트 드라이버 회로는, 게이트가 상기 제 3 클록 신호에 연결되는 제 5 트랜지스터를 더 포함하고,상기 2차 리플 제어부는, 일단이 상기 제 5 트랜지스터의 드레인에 연결되고 타단이 상기 제 1 노드에 연결되는 제 2 커패시터; 및 게이트가 상기 제 5 트랜지스터의 드레인 및 상기 제 2 커패시터에 공통 연결되고 드레인이 상기 제 1 노드에 연결되고 소스가 상기 출력부의 일단에 연결되는 제 6 트랜지스터를 포함하고,상기 제 5 트랜지스터의 일단은 상기 제 6 트랜지스터의 게이트에 연결되고 타단은 상기 기준 전위에 연결되는, 게이트 드라이버 회로
4 4
제3항에 있어서, 상기 게이트 드라이버 회로는, 게이트가 리셋 신호에 연결되고, 일단이 상기 입력 노드에 연결되고 타단이 상기 기준 전위에 연결되어 상기 입력 노드에 충전된 전하를 상기 기준 전위로 방전하는 리셋 트랜지스터를 더 포함하는, 게이트 드라이버 회로
5 5
제2항에 있어서, 상기 출력부는, 게이트가 상기 입력 노드에 연결되고, 드레인이 상기 2차 리플 제어부의 일단에 연결되고, 소스가 출력 노드에 연결되는 제 1 출력 트랜지스터; 및게이트가 상기 제 3 클록 신호에 연결되고, 드레인이 상기 출력 노드에 연결되고 소스가 상기 기준 전위에 연결되는 제 2 출력 트랜지스터를 포함하는, 게이트 드라이버 회로
6 6
제1항에 있어서, 상기 게이트 드라이버 회로는, 산화물 박막 트랜지스터(Oxide TFT), 유기물 박막 트랜지스터(Organic TFT), 수소화 비정질 실리콘 박막 트랜지스터(a-Si:H TFT) 및 폴리 실리콘 박막 트랜지스터(Poly-Si TFT) 중 어느 하나로 구현된 게이트 드라이버 회로
7 7
컨텐츠를 표시하는 디스플레이 장치로, 상기 디스플레이 장치는, 복수의 픽셀들을 포함하는 디스플레이 패널;상기 픽셀들에 계조 신호를 제공하는 소스 드라이버;상기 픽셀들을 턴 온 하는 게이트 구동 신호를 제공하는 게이트 드라이버를 포함하며, 상기 게이트 드라이버는,스타트 신호를 제공받는 입력 노드;상기 스타트 신호에 의해 프리차지된 상기 입력 노드의 전압을 제 1 클록 신호에 따라 부트스트랩하여 상기 게이트 구동 신호를 출력 노드로 출력하는 출력부; 상기 스타트 신호에 응답하여 상기 제 1 클록 신호의 전압을 레벨 쉬프트하여 제 1 노드로 출력하는 1차 리플 제어부; 및상기 제 1 노드에 형성된 상기 제 1 클록 신호의 리플을 차단하고, 상기 스타트 신호에 응답하여 상기 제 1 노드의 전압을 상기 출력부의 일단으로 제공하는 2차 리플 제어부를 포함하는, 디스플레이 장치
8 8
제7항에 있어서, 상기 1차 리플 제어부는,게이트가 상기 스타트 신호에 연결되고 드레인이 제 2 클록 신호에 연결되어 상기 스타트 신호에 응답하여 상기 제 2 클록 신호를 소스로 출력하는 제 1 트랜지스터;게이트가 제 3 클록 신호에 연결되고 드레인이 상기 제 1 트랜지스터의 소스에 연결되고 소스가 기준 전위에 연결되는 제 2 트랜지스터;게이트가 상기 제 1 트랜지스터의 소스 및 상기 제 2 트랜지스터의 드레인에 공통 연결되고 드레인이 상기 제 1 클록 신호에 연결되고 소스가 상기 제 1 노드에 연결되는 제 3 트랜지스터;게이트가 상기 제 2 클록 신호에 연결되고 드레인이 상기 제 1 노드에 연결되고 소스가 상기 기준 전위에 연결되는 제 4 트랜지스터; 및일단이 상기 제 3 트랜지스터의 게이트에 연결되고 타단이 상기 제 1 노드에 연결되는 제 1 커패시터를 포함하는, 디스플레이 장치
9 9
삭제
10 10
제8항에 있어서, 상기 게이트 드라이버는, 게이트가 리셋 신호에 연결되고, 일단이 상기 입력 노드에 연결되고 타단이 상기 기준 전위에 연결되어 상기 입력 노드에 충전된 전하를 상기 기준 전위로 방전하는 리셋 트랜지스터를 더 포함하는, 디스플레이 장치
11 11
제8항에 있어서, 상기 출력부는, 게이트가 상기 입력 노드에 연결되고, 드레인이 상기 2차 리플 제어부의 일단에 연결되고, 소스가 출력 노드에 연결되는 제 1 출력 트랜지스터; 및게이트가 상기 제 3 클록 신호에 연결되고, 드레인이 상기 출력 노드에 연결되고 소스가 상기 기준 전위에 연결되는 제 2 출력 트랜지스터를 포함하는, 디스플레이 장치
12 12
제7항에 있어서, 상기 게이트 드라이버는, 산화물 박막 트랜지스터(Oxide TFT), 유기물 박막 트랜지스터(Organic TFT), 수소화 비정질 실리콘 박막 트랜지스터(a-Si:H TFT) 및 폴리 실리콘 박막 트랜지스터(Poly-Si TFT) 중 어느 하나로 구현된, 디스플레이 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.