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곱셈기 및 누적기를 이용하여 MAC(multiply-accumulate) 연산을 수행하는 뉴로모픽 연산 장치에 있어서,복수의 횟수들만큼 측정된 복수의 오프셋 데이터를 수신하고 그리고 상기 복수의 오프셋 데이터를 누적하는 오프셋 누적기;상기 누적된 복수의 오프셋 데이터로부터 적어도 하나의 제 1 비트를 추출함으로써 평균 오프셋 데이터를 획득하는 비트 추출기; 및상기 곱셈기에 의해 생성된 복수의 곱셈 값들을 누적하고 그리고 상기 평균 오프셋 데이터에 따라 보정된 상기 복수의 곱셈 값들의 누적 결과를 출력하는 누적 시냅스 어레이를 포함하는 뉴로모픽 연산 장치
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제 1 항에 있어서,상기 누적 시냅스 어레이는 상기 복수의 곱셈 값들 중 제 1 곱셈 값에 대응하는 제 1 전압에 의해 충전되는 제 1 커패시터를 포함하는 뉴로모픽 연산 장치
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제 2 항에 있어서,상기 누적 시냅스 어레이는 상기 복수의 곱셈 값들 중 제 2 곱셈 값에 대응하는 제 2 전압에 의해 충전되는 제 2 커패시터를 더 포함하되,상기 제 1 및 제 2 커패시터들은 동시에 충전되는 뉴로모픽 연산 장치
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제 2 항에 있어서,상기 평균 오프셋 데이터의 제 1 비트에 대응하는 제 3 전압에 의해 충전되는 제 3 커패시터를 더 포함하는 뉴로모픽 연산 장치
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제 4 항에 있어서,상기 제 1 및 3 커패시터들과의 연결에 의해 상기 평균 오프셋 데이터에 따라 보정된 상기 복수의 곱셈 값들의 상기 누적 결과에 대응하는 제 4 전압에 의해 충전되는 제 4 커패시터를 더 포함하는 뉴로모픽 연산 장치
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제 5 항에 있어서,상기 제 1 커패시터 및 상기 제 4 커패시터 사이에 위치하는 제 1 스위치;상기 제 3 커패시터 및 상기 제 4 커패시터 사이에 위치하는 제 2 스위치; 및상기 제 1 및 3 커패시터들이 충전된 후에 상기 제 4 커패시터를 상기 제 1 및 3 커패시터들과 연결하도록 상기 제 1 및 제 2 스위치들을 제어하는 오프셋 제어기를 더 포함하는 뉴로모픽 연산 장치
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제 1 항에 있어서,상기 비트 추출기는 상기 누적된 복수의 오프셋 데이터로부터 적어도 하나의 제 2 비트를 더 추출하고, 그리고상기 뉴로모픽 연산 장치는:상기 적어도 하나의 제 1 비트에 대응하는 제 5 전압에 의해 충전되는 제 5 커패시터; 및상기 적어도 하나의 제 2 비트에 대응하는 제 6 전압에 의해 충전되는 제 6 커패시터를 포함하되,상기 제 5 커패시터의 커패시턴스는 상기 제 6 커패시터의 커패시턴스와 상이한 뉴로모픽 연산 장치
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제 1 항에 있어서,상기 복수의 횟수들은 (k는 1 이상의 정수)인 뉴로모픽 연산 장치
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제 8 항에 있어서,상기 비트 추출기가 상기 누적된 복수의 오프셋 데이터로부터 복수의 비트들을 추출하는 경우, 상기
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뉴로모픽 연산 장치의 동작 방법에 있어서,복수의 횟수들만큼 복수의 오프셋 데이터를 측정하는 단계;상기 복수의 오프셋 데이터를 누적하는 단계;상기 누적된 복수의 오프셋 데이터로부터 적어도 하나의 제 1 비트를 추출함으로써 평균 오프셋 데이터를 획득하는 단계;복수의 특징 데이터 및 복수의 가중 데이터 간의 복수의 곱셈 값들을 계산하는 단계;상기 복수의 곱셈 값들을 누적하는 단계; 및상기 평균 오프셋 데이터에 따라 상기 복수의 곱셈 값들의 누적 결과를 보정하는 단계를 포함하는 동작 방법
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제 10 항에 있어서,상기 뉴로모픽 연산 장치는:상기 복수의 곱셈 값들을 각각 저장하는 복수의 누적 커패시터들; 및상기 누적 결과를 저장하는 보정 커패시터를 포함하되,상기 복수의 곱셈 값들을 누적하는 단계는, 상기 복수의 누적 커패시터들을 상기 보정 커패시터와 동시에 연결하는 단계를 포함하는 동작 방법
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제 11 항에 있어서,상기 뉴로모픽 연산 장치는, 상기 평균 오프셋 데이터의 복수의 비트들을 각각 저장하는 복수의 오프셋 커패시터들을 더 포함하되,상기 평균 오프셋 데이터에 따라 상기 복수의 곱셈 값들의 상기 누적 결과를 보정하는 단계는, 상기 복수의 오프셋 커패시터들을 상기 보정 커패시터와 더 연결하는 단계를 포함하는 동작 방법
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