맞춤기술찾기

이전대상기술

증폭기 회로

  • 기술번호 : KST2021012479
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 증폭기 회로는, 증폭 동작시에 크로스 커플드 형태로 연결되어 제1라인과 제2라인의 전압 차이를 증폭하기 위한 제1인버터 및 제2인버터; 상기 제1라인과 상기 제1인버터의 출력단을 전기적으로 연결하기 위한 제1고립 스위치; 상기 제2라인과 상기 제2인버터의 출력단을 전기적으로 연결하기 위한 제2고립 스위치; 및 상기 제1인버터의 출력단과 상기 제2인버터의 출력단을 전기적으로 연결하기 위한 이퀄라이징 스위치를 포함하고, 상기 증폭 동작 이전에, 상기 제2고립 스위치와 상기 이퀄라이징 스위치를 턴온시키는 제1오프셋 보상 동작과 상기 제1고립 스위치와 상기 이퀄라이징 스위치를 턴온시키는 제2오프셋 보상 동작을 수행할 수 있다.
Int. CL G11C 7/06 (2021.01.01) H03F 3/45 (2006.01.01)
CPC
출원번호/일자 1020210136818 (2021.10.14)
출원인 에스케이하이닉스 주식회사, 서울대학교산학협력단
등록번호/일자
공개번호/일자 10-2021-0127686 (2021.10.22) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/분할
원출원번호/일자 10-2017-0081820 (2017.06.28)
관련 출원번호 1020170081820
심사청구여부/일자 Y (2021.10.14)
심사청구항수 8

출원인

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 출원인 표입니다.
번호 이름 국적 주소
1 에스케이하이닉스 주식회사 대한민국 경기도 이천시
2 서울대학교산학협력단 대한민국 서울특별시 관악구

발명자

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 발명자 표입니다.
번호 이름 국적 주소
1 윤정민 서울특별시 관악구
2 정덕균 서울특별시 서초구

대리인

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 대리인 표입니다.
번호 이름 국적 주소
1 신성특허법인(유한) 대한민국 서울특별시 송파구 중대로 ***, ID타워 ***호 (가락동)

최종권리자

번호, 이름, 국적, 주소의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 인명정보 - 최종권리자 표입니다.
번호 이름 국적 주소
최종권리자 정보가 없습니다
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [분할출원]특허출원서
[Divisional Application] Patent Application
2021.10.14 수리 (Accepted) 1-1-2021-1178754-11
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
증폭 동작시에 크로스 커플드 형태로 연결되어 제1라인과 제2라인의 전압 차이를 증폭하기 위한 제1인버터와 제2인버터를 포함하고,상기 증폭 동작 이전에, 상기 제1인버터의 입력단과 출력단을 상기 제2라인에 전기적으로 연결시키는 제1오프셋 보상 동작과 상기 제2인버터의 입력단과 출력단을 상기 제1라인에 전기적으로 연결시키는 제2오프셋 보상 동작을 수행하는증폭기 회로
2 2
제 1항에 있어서,상기 제1오프셋 보상 동작에서는 상기 제1인버터가 활성화되고 상기 제2오프셋 보상 동작에서는 상기 제2인버터가 활성화되는증폭기 회로
3 3
제 2항에 있어서,상기 제1오프셋 보상 동작과 상기 제2오프셋 보상 동작의 수행 이전에 상기 제1인버터와 상기 제2인버터를 비활성화한 상태에서 상기 제1라인과 상기 제2라인을 전기적으로 연결시키는 프리차지 동작을 수행하는증폭기 회로
4 4
제 2항에 있어서,상기 제1오프셋 보상 동작시에 상기 제1인버터와 상기 제1라인은 전기적으로 분리되고,상기 제2오프셋 보상 동작시에 상기 제2인버터와 상기 제2라인은 전기적으로 분리되는증폭기 회로
5 5
제 2항에 있어서,상기 제1오프셋 보상 동작과 상기 제2오프셋 보상 동작의 수행 이후, 상기 증폭 동작의 수행 이전에,증폭될 신호가 상기 제1라인과 상기 제2라인 중 하나 이상의 라인으로 전달되는증폭기 회로
6 6
증폭 동작시에 크로스 커플드 형태로 연결되어 제1라인과 제2라인의 전압 차이를 증폭하기 위한 제1인버터 및 제2인버터;상기 제1라인과 상기 제1인버터의 출력단을 전기적으로 연결하기 위한 제1고립 스위치;상기 제2라인과 상기 제2인버터의 출력단을 전기적으로 연결하기 위한 제2고립 스위치; 및상기 제1인버터의 출력단과 상기 제2인버터의 출력단에 프리차지 전압을 인가하고, 상기 제1인버터의 출력단과 상기 제2인버터의 출력단을 전기적으로 연결하기 위한 제1프리차지 회로를 포함하고,상기 증폭 동작 이전에, 상기 제2고립 스위치를 턴온시키고 상기 제1프리차지 회로를 활성화시키는 제1오프셋 보상 동작과, 상기 제1고립 스위치를 턴온시키고 상기 제1프리차지 회로를 활성화시키는 제2오프셋 보상 동작을 수행하는증폭기 회로
7 7
제 6항에 있어서,상기 제1인버터와 상기 제2인버터의 공통 풀업단과 상기 제1인버터와 상기 제2인버터의 공통 풀다운단에 상기 프리차지 전압을 인가하고, 상기 공통 풀업단과 공통 풀다운단을 전기적으로 연결하기 위한 제2프리차지 회로를 더 포함하는증폭기 회로
8 8
제 7항에 있어서,상기 제1오프셋 보상 동작과 상기 제2오프셋 보상 동작시에 상기 제1인버터와 상기 제2인버터는 활성화되고, 상기 제2프리차지 회로는 상기 제1인버터와 상기 제2인버터의 비활성화시에 활성화되는증폭기 회로
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.