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ＦＰＧＡ를 사용한 멀티-레벨 인버터 ＰＷＭ 발생장치

  • 기술번호 : KST2015193402
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 멀티-레벨 인버터가 개시된다. 본 멀티-레벨 인버터는, 복수의 스위치 소자를 포함하며, 복수의 스위치 소자의 스위칭 동작에 따라 각각 9개 레벨을 갖는 3상 출력전압을 생성하는 스위치부, 출력전압에 대한 벡터 제어를 수행하여, 3상 기준 전압값을 생성하는 벡터 제어부, 및, FPGA(Field Programmable Gate Array)로 구현되며, 3상 기준 전압값에 따라, 복수의 스위치 소자에 대한 PWM 제어를 수행하는 PWM 제어부를 포함한다. 이에 따라, 9 레벨을 갖는 3상 출력전압을 생성하는 복수의 스위치 소자에 대한 벡터 제어 및 PWM 제어를 용이하게 수행할 수 있다. 멀티-레벨 인버터, FPGA, DSP, 벡터제어, PWM 발생
Int. CL H02M 7/5387 (2007.01) H02M 7/48 (2007.01)
CPC H02P 27/08(2013.01) H02P 27/08(2013.01) H02P 27/08(2013.01) H02P 27/08(2013.01)
출원번호/일자 1020090017335 (2009.02.28)
출원인 울산대학교 산학협력단
등록번호/일자 10-1052275-0000 (2011.07.21)
공개번호/일자 10-2010-0098471 (2010.09.07) 문서열기
공고번호/일자 (20110727) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2009.02.28)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 울산대학교 산학협력단 대한민국 울산광역시 남구

발명자

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번호 이름 국적 주소
1 전태원 대한민국 부산광역시 금정구
2 이홍희 대한민국 울산광역시 울주군
3 김흥근 대한민국 대구광역시 수성구
4 노의철 대한민국 부산광역시 남구

대리인

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번호 이름 국적 주소
1 이현수 대한민국 서울특별시 마포구 백범로 ***(신공덕동) 메트로디오빌빌딩 ****호(이현수상표특허법률사무소)
2 정홍식 대한민국 서울시 서초구 강남대로 *** 신덕빌딩 *층(나우특허법률사무소)
3 김태헌 대한민국 서울시 서초구 강남대로 *** 신덕빌딩 *층(나우특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 울산대학교 산학협력단 대한민국 울산광역시 남구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2009.02.28 수리 (Accepted) 1-1-2009-0125439-96
2 선행기술조사의뢰서
Request for Prior Art Search		 2010.09.13 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2010.10.19 수리 (Accepted) 9-1-2010-0065712-37
4 의견제출통지서
Notification of reason for refusal		 2010.10.20 발송처리완료 (Completion of Transmission) 9-5-2010-0468725-10
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2010.12.20 수리 (Accepted) 1-1-2010-0839388-71
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2010.12.20 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2010-0839385-34
7 [대리인해임]대리인(대표자)에 관한 신고서
[Dismissal of Sub-agent] Report on Agent (Representative)		 2011.03.29 수리 (Accepted) 1-1-2011-0227780-68
8 등록결정서
Decision to grant		 2011.04.22 발송처리완료 (Completion of Transmission) 9-5-2011-0218267-93
9 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.11.29 수리 (Accepted) 4-1-2013-0057072-80
10 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2013.12.30 수리 (Accepted) 4-1-2013-5176374-15
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2016.06.20 수리 (Accepted) 4-1-2016-5080807-13
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.07.10 수리 (Accepted) 4-1-2020-5154267-54
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 스위치 소자를 포함하며, 상기 복수의 스위치 소자의 스위칭 동작에 따라 각각 9개 레벨을 갖는 3상 출력전압을 생성하는 스위치부; 상기 출력전압에 대한 벡터 제어를 수행하여, 3상 기준 전압값을 생성하는 벡터 제어부; 및 FPGA(Field Programmable Gate Array)로 구현되며, 상기 3상 기준 전압값에 따라, 상기 복수의 스위치 소자에 대한 PWM 제어를 수행하는 PWM 제어부;를 포함하며, 상기 스위치부는, 상기 3상 출력 전압을 생성하기 위한 3개의 셀을 포함하며, 상기 3개의 셀 각각은, 직렬 연결된 두 개의 단위 셀을 포함하며, 상기 3개의 셀 각각은, 직렬 연결된 제1 내지 제4 스위치 소자로 이루어진 제1 스위치 그룹; 직렬 연결된 제5 내지 제8 스위치 소자로 이루어지며 상기 제1 스위치 그룹과 나란히 배치되는 제2 스위치 그룹; 직렬 연결된 제9 내지 제12 스위치 소자로 이루어진 제3 스위치 그룹; 및 직렬 연결된 제13 내지 제16 스위치 소자로 이루어지며 상기 제3 스위치 그룹과 나란히 배치되는 제4 스위치 그룹;을 포함하며, 상기 제1 및 제2 스위치 그룹은 제1 단위 셀을 이루고, 상기 제3 및 제4 스위치 그룹은 상기 제1 단위 셀과 직렬 연결되는 제2 단위 셀을 이루는 것을 특징으로 하는 멀티-레벨 인버터
2 2
삭제
3 3
제1항에 있어서, 상기 단위 셀은, 3 레벨을 갖는 출력 전압을 생성하는 다이오드 클램프 인버터이며, 상기 3개의 셀 각각은 상기 두 개의 단위 셀의 출력 전압의 조합에 따라 9 레벨을 갖는 출력 전압을 생성하는 것을 특징으로 하는 멀티-레벨 인버터
4 4
삭제
5 5
제1항에 있어서, 상기 3개의 셀 각각은, 상기 제1, 2, 7, 8, 9, 10, 15, 16 스위치 소자가 온되면 제1 레벨, 상기 제2, 3, 7, 8, 9, 10, 15, 16 스위치 소자가 온되면 제2 레벨, 상기 제2, 3, 7, 6, 9, 10, 15, 16 스위치 소자가 온되면 제3 레벨, 상기 제2, 3, 6, 7, 10, 11, 15, 16 스위치 소자가 온되면 제4 레벨, 상기 제2, 3, 6, 7, 10, 11, 14, 15 스위치 소자가 온되면 제5 레벨, 상기 제2, 3, 6, 7, 10, 11, 13, 14 스위치 소자가 온되면 제6 레벨, 상기 제2, 3, 6, 7, 11, 12, 13, 14 스위치 소자가 온되면 제7 레벨, 상기 제2, 3, 5, 6, 11, 12, 13, 14 스위치 소자가 온되면 제8 레벨, 상기 제3, 4, 5, 6, 11, 12, 13, 14 스위치 소자가 온되면 제9 레벨을 형성하여 총 9개의 출력전압을 생성하는 것을 특징으로 하는 멀티-레벨 인버터
6 6
제1항에 있어서, 상기 제1과 제3 스위치 소자, 상기 제2와 제4 스위치 소자, 상기 제5와 제7 스위치 소자, 상기 제6과 제8스위치 소자, 상기 제9와 제11스위치 소자, 상기 제10과 제12 스위치 소자, 상기 제13과 제15 스위치 소자, 상기 제14와 제16스위치 소자는 하나의 쌍을 이루며, 하나의 스위치 소자의 온 동작시에 다른 하나의 스위치 소자는 오프 동작하는 것을 특징으로 하는 멀티-레벨 인버터
7 7
제1항에 있어서, 상기 벡터 제어부는, 샘플링 시간마다 상기 3상 출력 전압에 대한 벡터 제어를 수행하여, 각 상에 대한 기준 전압값을 생성하고, 생성된 기준 전압값을 순차적으로 상기 PWM 제어부에 전달하는 것을 특징으로 하는 멀티-레벨 인버터
8 8
제1항에 있어서, 상기 벡터 제어부는, 기준 전압값을 나타내는 13비트의 기준 전압값 비트 및 상기 기준 전압값이 적용될 상을 나타내는 3비트의 선택비트를 포함하는 16비트 데이터를 생성하여 상기 PWM 제어부에 전달하는 것을 특징으로 하는 멀티-레벨 인버터
9 9
제8항에 있어서, 상기 벡터 제어부는, 상기 기준 전압값 비트는 상기 선택비트의 동작 시간 및 상기 선택비트의 동작 시간 전후로 기설정된 시간 동안 기준 전압값 데이터를 유지하는 것을 특징으로 하는 멀티-레벨 인버터
10 10
제9항에 있어서, 상기 선택비트의 동작 시간은 1㎲인 것을 특징으로 하는 멀티-레벨 인버터
11 11
제8항에 있어서, 상기 PWM 제어부는, 상기 3비트의 선택 비트 중 어느 하나의 비트가 0 되는 경우, 상기 13비트의 기준 전압값 비트를 상기 0 되는 비트에 대응되는 상에 대한 기준 전압값으로 독취하는 것을 특징으로 하는 멀티-레벨 인버터
12 12
제1항에 있어서, 상기 PWM 제어부는, 외부 클럭 주파수에 대응하는 기본 반송신호를 생성하고, 상기 생성된 기본 반송신호를 기초로, 상기 반송신호와 동상인 M-밴드 반송신호와, 180도 위상차를 갖는 W-밴드 반송신호를 생성하는 반송신호 생성부; 상기 생성된 M-밴드 반송신호, W-밴드 반송신호의 레벨을 조정하여 8개의 반송신호를 생성하는 8 레벨 시프트부; 및 상기 생성된 8개의 반송신호와 상기 벡터 제어부로부터 수신된 3상 기준전압을 비교하여 상기 스위치부의 스위치 소자 각각에 대한 PWM 신호를 생성하는 비교기;를 포함하는 것을 특징으로 하는 멀티-레벨 인버터
13 13
제12항에 있어서, 상기 PWM 제어부는, 상기 스위치부의 과전류를 검출하며, 과전류가 검출되면 상기 비교기의 PWM 신호 생성을 정지하는 보호부;를 더 포함하는 것을 특징으로 하는 멀티-레벨 인버터
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.