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실리콘 기판의 표면 박리 방법

  • 기술번호 : KST2015014267
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 공정비용이 낮으면서도 저온에서 수행되어 실리콘 박막의 품질을 유지할 수 있는 결정질 실리콘 기판의 박리 방법에 관한 것으로서, 결정질 실리콘 기판을 준비하는 단계; 전해 증착(electrodeposition)을 위한 도금욕(bath)을 구성하는 단계; 상기 도금욕을 이용하여 전해 증착공정으로 상기 결정질 실리콘 기판에 스트레스층을 형성하는 단계; 및 상기 스트레스층에 잔류하는 전해 증착 응력에 의하여 상기 결정질 실리콘 기판의 표면을 박리하는 단계를 포함한다.본 발명의 다른 형태에 의한 결정질 실리콘 기판의 표면 박리 방법은, 결정질 실리콘 기판을 준비하는 단계; 상기 결정질 실리콘 기판에 버퍼층을 형성하는 단계; 전해 증착을 위한 도금욕을 구성하는 단계; 상기 도금욕을 이용하여 전해 증착공정으로 상기 버퍼층의 표면에 스트레스층을 형성하는 단계; 및 상기 스트레스층에 잔류하는 전해 증착 응력에 의하여 상기 결정질 실리콘 기판의 표면을 박리하는 단계를 포함하며, 상기 버퍼층에 잔류하는 응력이 상기 스트레스층에 잔류하는 응력보다 작은 것을 특징으로 한다.본 발명은, 전해 증착을 이용하여 결정질 실리콘 기판을 박리함으로써, 저비용으로 결정질 실리콘 박막을 제조할 수 있으며, 고온에서 실리콘 박막의 품질이 저하되는 단점을 방지할 수 있는 효과가 있다.
Int. CL H01L 21/301 (2006.01) H01L 21/265 (2006.01) H01L 21/20 (2006.01)
CPC H01L 21/288(2013.01) H01L 21/288(2013.01) H01L 21/288(2013.01) H01L 21/288(2013.01)
출원번호/일자 1020120073766 (2012.07.06)
출원인 한양대학교 에리카산학협력단
등록번호/일자 10-1377707-0000 (2014.03.17)
공개번호/일자 10-2014-0006545 (2014.01.16) 문서열기
공고번호/일자 (20140321) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2012.07.06)
심사청구항수 16

출원인

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 대한민국 경기도 안산시 상록구

발명자

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번호 이름 국적 주소
1 유봉영 대한민국 경기도 성남시 분당구
2 이정호 대한민국 서울 서초구
3 권영임 대한민국 경기도 안산시 상록구
4 윤상화 대한민국 경기도 안산시 상록구
5 엄한돈 대한민국 경기도 안산시 상록구

대리인

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번호 이름 국적 주소
1 특허법인다울 대한민국 서울 강남구 봉은사로 ***, ***호(역삼동, 혜전빌딩)

최종권리자

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번호 이름 국적 주소
1 한양대학교 에리카산학협력단 경기도 안산시 상록구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.07.06 수리 (Accepted) 1-1-2012-0541475-69
2 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2012.07.25 수리 (Accepted) 1-1-2012-0593346-30
3 선행기술조사의뢰서
Request for Prior Art Search
2013.07.03 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search
2013.08.08 수리 (Accepted) 9-1-2013-0063651-18
5 의견제출통지서
Notification of reason for refusal
2013.08.20 발송처리완료 (Completion of Transmission) 9-5-2013-0570464-17
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2013.10.21 수리 (Accepted) 1-1-2013-0948402-61
7 등록결정서
Decision to grant
2014.01.10 발송처리완료 (Completion of Transmission) 9-5-2014-0023348-89
8 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2019.05.31 수리 (Accepted) 1-1-2019-0559601-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
결정질실리콘 기판을 준비하는 단계;전해 증착(electrodeposition)을 위한 도금욕(bath)을 구성하는 단계;상기 도금욕을 이용하여 전해 증착공정으로 상기 실리콘 기판에 스트레스층을 형성하는 단계; 및상기 스트레스층에 잔류하는 전해 증착 응력에 의하여 상기 결정질 실리콘 기판의 표면을 박리하는 단계를 포함하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
2 2
청구항 1에 있어서,상기 결정질 실리콘 기판에 스트레스층을 형성하기에 앞서, 상기 결정질 실리콘 기판의 표면에 상기 결정질 실리콘 기판과 상기 스트레스층의 접착성을 향상시키기 위한 시드층을 형성하는 단계를 더 포함하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
3 3
청구항 1에 있어서,상기 도금욕을 구성하는 단계에서, 상기 도금욕에 첨가물을 첨가하여 상기 스트레스층에 잔류하는 전해 증착 응력을 조절하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
4 4
청구항 1에 있어서,상기 스트레스층을 형성하는 단계에서, 상기 전해 증착 공정의 전류밀도를 조절하여 상기 스트레스층에 잔류하는 전해 증착 응력을 조절하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
5 5
청구항 1에 있어서,상기 스트레스층이 Ni, Co, Fe 중에 하나의 금속 또는 이들의 합금인 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
6 6
청구항 1에 있어서,상기 스트레스층이 Ni 금속박막이며, 상기 Ni 금속박막에 P가 첨가된 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
7 7
청구항 1에 있어서,상기 도금욕이 NiCl2와 H3BO3 및 H3PO3를 포함하여 구성되는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
8 8
결정질 실리콘 기판을 준비하는 단계;상기 결정질 실리콘 기판에 버퍼층을 형성하는 단계;전해 증착을 위한 도금욕을 구성하는 단계;상기 도금욕을 이용하여 전해 증착공정으로 상기 버퍼층의 표면에 스트레스층을 형성하는 단계; 및상기 스트레스층에 잔류하는 전해 증착 응력에 의하여 상기 결정질 실리콘 기판의 표면을 박리하는 단계를 포함하며,상기 버퍼층에 잔류하는 응력이 상기 스트레스층에 잔류하는 전해 증착 응력보다 작은 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
9 9
청구항 8에 있어서,상기 버퍼층의 두께를 조절하여 상기 스트레스층에 잔류하는 전해 증착 응력이 상기 결정질 실리콘 기판에 미치는 깊이를 조절함으로써 상기 박리된 결정질 실리콘의 두께를 조절하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
10 10
청구항 8에 있어서,상기 도금욕을 구성하는 단계에서, 상기 도금욕에 첨가물을 첨가하여 상기 스트레스층에 잔류하는 전해 증착 응력을 조절하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
11 11
청구항 8에 있어서,상기 스트레스층을 형성하는 단계에서, 상기 전해 증착 공정의 전류밀도를 조절하여 상기 스트레스층에 잔류하는 전해 증착 응력을 조절하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
12 12
청구항 8에 있어서,상기 스트레스층이 Ni, Co, Fe 중에 하나의 금속 또는 이들의 합금인 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
13 13
청구항 8에 있어서,상기 스트레스층이 Ni 금속박막이며, 상기 Ni 금속박막에 P가 첨가된 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
14 14
청구항 8에 있어서,상기 도금욕이 NiCl2와 H3BO3 및 H3PO3를 포함하여 구성되는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
15 15
청구항 8에 있어서,상기 버퍼층을 형성하는 단계가 전해 증착 공정으로 수행되는 특징으로 하는 실리콘 기판의 표면 박리 방법
16 16
청구항 10에 있어서,상기 결정질 실리콘 기판에 상기 버퍼층을 형성하기에 앞서, 상기 결정질 실리콘 기판의 표면에 상기 결정질 실리콘 기판과 상기 버퍼층의 접착성을 향상시키기 위한 시드층을 형성하는 단계를 더 포함하는 것을 특징으로 하는 실리콘 기판의 표면 박리 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 산업통상자원부 한양대학교(ERICA캠퍼스) 신재생에너지 융합원천기술 개발 사업 플라즈모닉기반 초박형 실리콘-금속 이종접합태양전지 개발