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멀티 코어 시스템 반도체 제어 장치 및 방법

  • 기술번호 : KST2015091472
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 멀티 코어 시스템 반도체(SoC;System on Chip) 제어 장치 및 방법이 개시된다. 본 발명에 따른 멀티 코어 시스템 반도체 제어 장치는 하나의 메인 코어와 적어도 하나 이상의 서브 코어로 구성된 멀티 코어 시스템 반도체의 제어 장치에 있어서, 시스템 반도체의 성능 또는 전력을 고려하여 서브 코어의 수행여부를 결정하는 결정부, 결정부의 결정에 대응하여 메인 코어 또는 상기 서브 코어의 레지스터를 포함한 상태 정보를 저장하는 저장부 및 메인 코어와 서브 코어가 상기 상태 정보를 공유함으로써 상호 간에 서브 코어의 태스크인 서브 태스크를 교환하며 수행하도록 제어하는 제어부를 포함한다.
Int. CL G06F 9/38 (2006.01) G06F 9/46 (2006.01)
CPC
출원번호/일자 1020130059950 (2013.05.27)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2014-0139371 (2014.12.05) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 20

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이유경 대한민국 대전 유성구
2 변경진 대한민국 대전 유성구
3 엄낙웅 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 한양특허법인 대한민국 서울특별시 강남구 논현로**길 **, 한양빌딩 (도곡동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.05.27 수리 (Accepted) 1-1-2013-0469063-28
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
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번호 청구항
1 1
하나의 메인 코어와 적어도 하나 이상의 서브 코어로 구성된 멀티 코어 시스템 반도체(SoC;System on Chip)의 제어 장치에 있어서,상기 멀티 코어 시스템 반도체의 성능 또는 전력을 고려하여 상기 서브 코어의 수행여부를 결정하는 결정부; 상기 결정부의 결정에 대응하여 상기 메인 코어 또는 상기 서브 코어의 레지스터를 포함한 상태 정보를 저장하는 저장부; 및상기 메인 코어와 상기 서브 코어가 상기 상태 정보를 공유함으로써 상호 간에 상기 서브 코어의 태스크인 서브 태스크를 교환하며 수행하도록 제어하는 제어부를 포함하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
2 2
청구항 1에 있어서,상기 결정부는,상기 서브 코어의 수행을 중단하는 중단 결정 또는 상기 서브 코어의 수행을 재개하는 재개 결정을 하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
3 3
청구항 2에 있어서,상기 저장부는,상기 결정부가 중단 결정을 하면, 상기 서브 코어의 현재 상태 정보를 저장하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
4 4
청구항 3에 있어서,상기 제어부는,상기 서브 코어에 인터럽트 명령을 전달하여 상기 서브 코어가 상기 서브 태스크의 수행을 중단하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
5 5
청구항 4에 있어서,상기 제어부는, 상기 메인 코어가 상기 저장부에 저장된 상기 서브 코어의 현재 상태 정보를 기반으로 상기 서브 태스크를 이어서 수행하도록 교환 명령을 하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
6 6
청구항 5에 있어서,상기 메인 코어는,본래 자신의 태스크인 메인 태스크와 상기 서브 태스크를 컨텍스트 스위칭(Context switching)하여 수행하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
7 7
청구항 6에 있어서,상기 컨텍스트 스위칭은,사용자 정의에 따라 미리 설정된 주기로 이루어지는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
8 8
청구항 2에 있어서,상기 저장부는,상기 결정부가 재개 결정을 하면, 상기 메인 코어의 현재 상태 정보를 저장하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
9 9
청구항 8에 있어서,상기 제어부는,상기 메인 코어에 교환 중단 명령을 전달하여 상기 메인 코어가 상기 서브 태스크의 수행을 중단하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
10 10
청구항 9에 있어서,상기 제어부는,상기 서브 코어에 웨이크업 명령을 전달하여 상기 서브 코어가 상기 저장부에 저장된 상기 메인 코어의 현재 상태 정보를 기반으로 상기 서브 태스크를 이어서 수행하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 장치
11 11
하나의 메인 코어와 적어도 하나 이상의 서브 코어로 구성된 멀티코어 시스템 반도체(SoC;System on Chip)의 제어 방법에 있어서,상기 멀티코어 시스템 반도체의 성능 또는 전력을 고려하여 상기 서브 코어의 수행여부를 결정하는 단계; 상기 결정하는 단계의 결정에 대응하여 상기 메인 코어 또는 상기 서브 코어의 레지스터를 포함한 상태 정보를 저장하는 단계; 및상기 메인 코어와 상기 서브 코어가 상기 상태 정보를 공유함으로써 상호 간에 상기 서브 코어의 태스크인 서브 태스크를 교환하며 수행하도록 제어하는 단계를 포함하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
12 12
청구항 11에 있어서,상기 결정하는 단계는,상기 서브 코어의 수행을 중단하는 중단 결정 또는 상기 서브 코어의 수행을 재개하는 재개 결정을 하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
13 13
청구항 12에 있어서,상기 저장하는 단계는,상기 결정하는 단계에서 중단 결정을 하면, 상기 서브 코어의 현재 상태 정보를 저장하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
14 14
청구항 13에 있어서,상기 제어하는 단계는,상기 서브 코어에 인터럽트 명령을 전달하여 상기 서브 코어가 상기 서브 태스크의 수행을 중단하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
15 15
청구항 14에 있어서,상기 제어하는 단계는, 상기 메인 코어가 상기 저장하는 단계에서 저장된 상기 서브 코어의 현재 상태 정보를 기반으로 상기 서브 태스크를 이어서 수행하도록 교환 명령을 하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
16 16
청구항 15에 있어서,상기 메인 코어는,본래 자신의 태스크인 메인 태스크와 상기 서브 태스크를 컨텍스트 스위칭(Context switching)하여 수행하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
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청구항 16에 있어서,상기 컨텍스트 스위칭은,사용자 정의에 따라 미리 설정된 주기로 이루어지는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
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청구항 12에 있어서,상기 저장하는 단계는,상기 결정하는 단계에서 재개 결정을 하면, 상기 메인 코어의 현재 상태 정보를 저장하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
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청구항 18에 있어서,상기 제어하는 단계는,상기 메인 코어에 교환 중단 명령을 전달하여 상기 메인 코어가 상기 서브 태스크의 수행을 중단하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
20 20
청구항 19에 있어서,상기 제어하는 단계는,상기 서브 코어에 웨이크업 명령을 전달하여 상기 서브 코어가 상기 저장하는 단계에서 저장된 상기 메인 코어의 현재 상태 정보를 기반으로 상기 서브 태스크를 이어서 수행하도록 제어하는 것을 특징으로 하는 멀티 코어 시스템 반도체 제어 방법
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