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메모리 매핑장치 및 이를 구비한 멀티프로세서 시스템온칩 플랫폼

  • 기술번호 : KST2014045100
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 복수개의 코어들과 복수개의 메모리들 중 코어와 메모리를 선택하는 코어/메모리선택기, 코어/메모리선택기가 선택한 코어와 메모리 사이의 데이터 전송경로를 할당하는 전송경로할당기 및 복수개의 코어들과 복수개의 메모리들 사이의 데이터 전송경로인 복수개의 직접메모리접근을 제어하는 직접메모리접근콘트롤러에 전송할 신호를 설정하는 DMA제어신호설정기를 포함하는 것을 특징으로 한다.
Int. CL G06F 13/16 (2006.01) G06F 9/46 (2006.01) G06F 9/44 (2006.01)
CPC G06F 13/16(2013.01) G06F 13/16(2013.01) G06F 13/16(2013.01) G06F 13/16(2013.01) G06F 13/16(2013.01)
출원번호/일자 1020100134045 (2010.12.23)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2012-0072211 (2012.07.03) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.05.22)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 장준영 대한민국 대전광역시 유성구
2 엄낙웅 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인아주 대한민국 서울특별시 강남구 강남대로 ***, **,**층(역삼동, 동희빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2010.12.23 수리 (Accepted) 1-1-2010-0854186-52
2 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)		 2015.05.22 수리 (Accepted) 1-1-2015-0494063-84
4 의견제출통지서
Notification of reason for refusal		 2016.03.15 발송처리완료 (Completion of Transmission) 9-5-2016-0192763-12
5 거절결정서
Decision to Refuse a Patent		 2016.05.26 발송처리완료 (Completion of Transmission) 9-5-2016-0382729-15
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번호 청구항
1 1
복수개의 코어들과 복수개의 메모리들 중 코어와 메모리를 선택하는 코어/메모리선택기;상기 코어/메모리선택기가 선택한 코어와 메모리 사이의 데이터 전송경로를 할당하는 전송경로할당기; 및상기 복수개의 코어들과 상기 복수개의 메모리들 사이의 데이터 전송경로인 복수개의 직접메모리접근을 제어하는 직접메모리접근콘트롤러(DMAC; direct memory access controller)에 전송할 신호를 설정하는 DMA제어신호설정기를 포함하는 메모리 매핑장치
2 2
제 1 항에 있어서, 상기 전송경로할당기는상기 복수개의 코어들과 상기 복수개의 메모리들 중 상기 코어/메모리선택기가 선택한 제1코어와 제1메모리 사이의 데이터 전송경로를, 데이터 전송이 이루어지고 있는, 상기 복수개의 코어들 중 상기 제1코어가 아닌 코어와 상기 복수개의 메모리들 중 상기 제1메모리가 아닌 메모리 사이의 데이터 전송경로와 교차하지 않도록 설정하는 것을 특징으로 하는 메모리 매핑장치
3 3
제 2 항에 있어서, 상기 DMA제어신호설정기는 상기 전송경로할당기가 설정한 데이터 전송경로에 따라 상기 DMAC에 전송할 신호를 설정하는 것을 특징으로 하는 메모리 매핑장치
4 4
복수개의 코어들과 복수개의 메모리들;상기 복수개의 코어들과 상기 복수개의 메모리들 사이의 데이터 전송경로인 복수개의 직접메모리접근; 및상기 복수개의 코어들과 상기 복수개의 메모리들 중 코어와 이에 대응하는 메모리를 선택하는 코어/메모리선택기, 상기 직접메모리접근을 제어하는 직접메모리접근콘트롤러에 전송할 신호를 설정하는 DMA제어신호설정기, 및 상기 코어/메모리선택기가 선택한 코어와 메모리 사이의 데이터 전송경로를 할당하는 전송경로할당기를 구비하는 메모리 매핑장치를 포함하는 멀티프로세서 시스템온칩 플랫폼
5 5
제 4 항에 있어서, 상기 전송경로할당기는 상기 복수개의 코어들과 상기 복수개의 메모리들 중 상기 코어/메모리선택기가 선택한 제1코어와 제1메모리 사이의 데이터 전송경로를, 데이터 전송이 이루어지고 있는, 상기 복수개의 코어들 중 상기 제1코어가 아닌 코어와 상기 복수개의 메모리들 중 상기 제1메모리가 아닌 메모리 사이의 데이터 전송경로와 교차하지 않도록 설정하는 것을 특징으로 하는 멀티프로세서 시스템온칩 플랫폼
6 6
제 5 항에 있어서, 상기 DMA제어신호설정기는 상기 전송경로할당기가 설정한 데이터 전송경로에 따라 상기 DMAC에 전송할 신호를 설정하는 것을 특징으로 하는 멀티프로세서 시스템온칩 플랫폼
7 7
제 4 항에 있어서, 상기 복수개의 코어들은 동시에 데이터를 디코딩하고, 디코딩된 데이터는 동시에 상기 복수개의 메모리들에 저장되며, 상기 전송경로할당기는, 상기 복수개의 코어들과 상기 복수개의 메모리들 사이의 데이터 전송경로들이 교차하지 않도록, 상기 복수개의 코어들과 상기 복수개의 메모리들 사이의 데이터 전송경로를 설정하는 것을 특징으로 하는 멀티프로세서 시스템온칩 플랫폼
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1 US2012166682 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 정보통신산업원천기술개발사업 MPCore 플랫폼 기반 다중 포맷 멀티미디어 SoC