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디지털 코드인 디지털 신호데이터를 저장하거나 외부로 출력하는 N비트 제어로직부(N은 자연수);상기 디지털 신호데이터의 기 설정된 M(M은 자연수)개의 상위비트 및 (N-M)개의 하위비트를 아날로그로 변환하여 DAC 신호데이터를 출력하는 N비트 DAC(Digital to Analog Converter), 여기서 상기 N비트 DAC는 기 설정된 K(K는 자연수)개의 윈도윙비트를 추가로 포함함; 및상기 DAC 신호데이터와 외부에서 입력된 입력신호데이터의 크기를 비교하고 비교결과를 출력하는 비교부, 여기서 상기 비교부는 (i) 상기 디지털 신호데이터의 기 설정된 M개의 상위비트 중 적어도 하나의 비트와 (ii) 상기 기 설정된 K개의 윈도윙비트 중 적어도 하나의 비트를 비교함, 를 포함하되,상기 N비트 제어로직부는 상기 비교부의 비교결과에 따라 상기 디지털 신호데이터를 변경하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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제 1 항에 있어서,상기 비교부는 (i) 상기 기 설정된 M개의 상위비트 중 적어도 하나의 비트값 및 (ii) 상기 기 설정된 K개의 윈도윙비트 중 적어도 하나의 비트값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위비트를 제외한 (N-M)개의 하위비트를 비교하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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제 1 항에 있어서,상기 비교부는 (i) 상기 기 설정된 M개의 상위 비트 중 적어도 하나의 비트값 및 (ii) 상기 기 설정된 K개의 윈도윙 비트 중 적어도 하나의 비트값이 동일하면, 상기 기 설정된 K개의 윈도윙 비트 중 두 개의 비트를 비교하고,상기 기 설정된 K개의 윈도윙 비트 중 두 개의 비트값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위비트를 제외한 (N-M)개의 하위비트를 비교하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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디지털 코드인 디지털 신호데이터를 저장하거나 외부로 출력하는 N비트 제어로직부(N은 자연수);상기 디지털 신호데이터를 아날로그로 변환하여 DAC 신호데이터를 출력하고 N개의 캐패시터가 구비된 N비트 DAC(Digital to Analog Converter), 여기서 상기 N개의 캐패시터는 기 설정된 M(M은 자연수)개의 상위 캐패시터 및 (N-M)개의 하위 캐패시터를 포함하고, 상기 N비트 DAC는 기 설정된 K(K는 자연수)개의 윈도윙 캐패시터를 추가로 포함함; 및상기 DAC 신호데이터와 외부에서 입력된 입력신호데이터의 크기를 비교하고 비교결과를 출력하는 비교부, 여기서 상기 비교부는 (i) 상기 기 설정된 M개의 상위 캐패시터 중 적어도 하나의 캐패시터와 (ii) 상기 기 설정된 K개의 윈도윙 캐패시터 중 적어도 하나의 캐패시터를 비교함, 를 포함하되,상기 제어로직부는 상기 비교부의 비교결과에 따라 상기 디지털 신호데이터를 변경하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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제 4 항에 있어서,상기 비교부는 (i) 상기 기 설정된 M개의 상위 캐패시터 중 적어도 하나의 캐패시터 값 및 (ii) 상기 기 설정된 K개의 윈도윙 캐패시터 중 적어도 하나의 캐패시터 값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위 캐패시터를 제외한 (N-M)개의 하위 캐패시터를 비교하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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제 4 항에 있어서,상기 비교부는 (i) 상기 기 설정된 M개의 상위 캐패시터 중 적어도 하나의 캐패시터 값 및 (ii) 상기 기 설정된 K개의 윈도윙 캐패시터 중 적어도 하나의 캐패시터 값이 동일하면, 상기 기 설정된 K개의 윈도윙 캐패시터 중 두 개의 캐패시터를 비교하고,상기 기 설정된 K개의 윈도윙 캐패시터 중 두 개의 캐패시터 값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위 캐패시터를 제외한 (N-M)개의 하위 캐패시터를 비교하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터
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외부로부터 입력되는 빛에 따라 아날로그 신호데이터를 출력하는 픽셀을 복수행 및 복수열의 2차원으로 배열한 픽셀부;상기 픽셀부에서 대상픽셀과 기준픽셀을 선택하는 로직부;상기 대상픽셀의 신호데이터를 상관 이중 샘플링하는 CDS(Correlate Double Sampling)부;상기 CDS부로부터 상관 이중 샘플링된 아날로그 신호데이터를 디지털 신호데이터로 변환하는 아날로그 디지털컨버터; 및 상기 디지털 신호데이터 중 기 설정된 상위비트를 저장하는 메모리부를 포함하되,상기 아날로그 디지털컨버터는,디지털 코드인 디지털 신호데이터를 저장하거나 외부로 출력하는 N비트 제어로직부(N은 자연수);상기 디지털 신호데이터의 기 설정된 M(M은 자연수)개의 상위비트 및 (N-M)개의 하위비트를 아날로그로 변환하여 DAC 신호데이터를 출력하는 N비트 DAC(Digital to Analog Converter), 여기서 상기 N비트 DAC는 기 설정된 K(K는 자연수)개의 윈도윙비트를 추가로 포함함; 및상기 DAC 신호데이터와 외부에서 입력된 입력신호데이터의 크기를 비교하고 비교결과를 출력하는 비교부, 여기서 상기 비교부는 (i) 상기 기 설정된 M개의 상위비트 중 적어도 하나의 비트와 (ii) 상기 기 설정된 K개의 윈도윙비트 중 적어도 하나의 비트를 비교함, 를 포함하되,상기 N비트 제어로직부는 상기 비교부의 비교결과에 따라 상기 디지털 신호데이터를 변경하는 것을 특징으로 하는 SAR(Successive Approximation Resister) 아날로그 디지털컨버터를 포함하는 것을 특징으로 하는 CMOS 이미지 센서
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CMOS 이미지 센서가 이미지를 센싱하는 방법에 있어서,적어도 하나 이상의 픽셀을 구비하는 픽셀부에서 외부로부터 입력되는 빛에 따라 아날로그 신호데이터를 출력하는 과정;상기 아날로그 신호데이터를 상관 이중 샘플링(Correlate Double Sampling, CDS)하는 과정;상기 아날로그 신호데이터를 디지털 신호데이터로 변환하는 과정; 및상기 디지털 신호데이터 중 기 설정된 M(M은 자연수)개의 상위비트를 저장하는 과정을 포함하며,상기 아날로그 신호데이터를 디지털 신호데이터로 변환하는 과정은,상기 디지털 신호데이터를 저장하거나 외부로 출력하는 과정;상기 디지털 신호데이터의 기 설정된 M개의 상위비트 및 (N-M)개의 하위비트를 아날로그로 변환하여 DAC 신호데이터를 출력하는 과정, 여기서 상기 디지털 신호데이터는 기 설정된 K(K는 자연수)개의 윈도윙비트를 추가로 포함함;상기 기 설정된 M개의 상위비트 중 적어도 하나의 비트와 상기 기 설정된 K개의 윈도윙비트 중 적어도 하나의 비트를 비교하는 과정;상기 DAC 신호데이터와 외부에서 입력된 입력신호데이터의 크기를 비교하고 비교결과를 출력하는 과정; 및상기 비교결과에 따라 상기 디지털 신호데이터를 변경하는 과정을 포함하는 것을 특징으로 하는 이미지 센싱 방법
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제 16 항에 있어서,(i) 상기 기 설정된 M개의 상위비트 중 적어도 하나의 비트값 및 (ii) 상기 기 설정된 K개의 윈도윙비트 중 적어도 하나의 비트값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위비트를 제외한 (N-M)개의 하위비트를 비교하는 것을 특징으로 하는 이미지 센싱 방법
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제 16 항에 있어서,(i) 상기 기 설정된 M개의 상위 비트 중 적어도 하나의 비트값 및 (ii) 상기 기 설정된 K개의 윈도윙 비트 중 적어도 하나의 비트값이 동일하면, 상기 기 설정된 K개의 윈도윙 비트 중 두 개의 비트를 비교하고,상기 기 설정된 K개의 윈도윙 비트 중 두 개의 비트값이 상이하면, 상기 DAC 신호데이터 및 상기 입력신호데이터의 기 설정된 M개의 상위비트를 제외한 (N-M)개의 하위비트를 비교하는 것을 특징으로 하는 이미지 센싱 방법
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