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반도체 소자 및 그 제조 방법(SEMICONDUCTOR DEVICES AND THE METHOD OF FORMING THE SAME)

  • 기술번호 : KST2017000010
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 반도체 소자의 기판 상의 소스 전극들 및 드레인 전극들은 기판의 상면에 평행한 제1 방향 및 제1 방향과 교차하는 제2 방향을 따라 교대로 배열되고,소스 배선들은 소스 전극들 상에서, 소스 전극들과 전기적으로 연결되고,드레인 패드는 소스 배선들 상에서, 드레인 전극들과 전기적으로 연결되고, 소스 배선들은 소스 전극들 상에서 교차점을 갖는 그리드(grid) 형상을 갖고, 평면적 관점에서, 드레인 패드는 소스 전극들 및 드레인 전극들과 중첩된다.
Int. CL H01L 29/778 (2006.01) H01L 29/66 (2006.01)
CPC H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01)
출원번호/일자 1020150088939 (2015.06.23)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2017-0000421 (2017.01.03) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.12.02)
심사청구항수 17

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박영락 대한민국 대전시 유성구
2 고상춘 대한민국 대전시 유성구
3 나제호 대한민국 서울특별시 용산구
4 문재경 대한민국 대전광역시 유성구
5 배성범 대한민국 대전광역시 유성구
6 장우진 대한민국 대전시 서구
7 전치훈 대한민국 대전 유성구
8 정동윤 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.06.23 수리 (Accepted) 1-1-2015-0606631-57
2 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2016.12.02 수리 (Accepted) 1-1-2016-1185425-18
3 의견제출통지서
Notification of reason for refusal
2017.12.11 발송처리완료 (Completion of Transmission) 9-5-2017-0866059-97
4 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.02.12 수리 (Accepted) 1-1-2018-0153049-05
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.02.12 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0153051-97
6 거절결정서
Decision to Refuse a Patent
2018.04.27 발송처리완료 (Completion of Transmission) 9-5-2018-0289882-57
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번호 청구항
1 1
기판의 상면에 평행한 제1 방향 및 상기 제1 방향과 교차하는 제2 방향을 따라 교대로 배열되는 상기 기판 상의 소스 전극들 및 드레인 전극들;상기 소스 전극들 상에서, 상기 소스 전극들과 전기적으로 연결되는 소스 배선들; 및상기 소스 배선들 상에서, 상기 드레인 전극들과 전기적으로 연결되는 드레인 패드를 포함하며,상기 소스 배선들은 상기 소스 전극들 상에서 교차점을 갖는 그리드(grid) 형상을 갖고,평면적 관점에서, 상기 드레인 패드는 상기 소스 전극들 및 상기 드레인 전극들과 중첩되는 반도체 소자
2 2
제 1 항에 있어서,상기 기판과 상기 소스 전극들 및 상기 드레인 전극들 사이의 제1 질화물 반도체층; 및상기 제1 질화물 반도체층과 상기 소스 전극들 및 상기 드레인 전극들 사이의 제2 질화물 반도체층을 더 포함하는 반도체 소자
3 3
제 2 항에 있어서,상기 소스 전극들을 노출시키는 소스 콘택홀들을 갖는 상기 제2 질화물 반도체층 상의 제1 절연층; 및상기 소스 콘택홀들 내에 제공되는 소스 콘택들을 더 포함하며,상기 소스 배선들은 상기 소스 콘택들을 통하여 상기 소스 전극들과 전기적으로 연결되는 반도체 소자
4 4
제 3 항에 있어서,상기 제1 절연층은 SiN, SiO2, 및 Al2O3 중에서 선택되는 어느 하나를 포함하는 반도체 소자
5 5
제 3 항에 있어서,상기 제1 절연층의 두께는 약 1마이크로미터 이상인 반도체 소자
6 6
제 3 항에 있어서,평면적 관점에서, 상기 소스 콘택들은 상기 그리드 형상의 교차점에 제공되는 반도체 소자
7 7
제 3 항에 있어서,상기 소스 배선들과 상기 드레인 패드 사이에 개재되는 제2 절연층; 및상기 제1 절연층 및 상기 제2 절연층을 관통하여, 상기 드레인 전극들과 연결되는 드레인 콘택들을 더 포함하는 반도체 소자
8 8
제 7 항에 있어서,상기 제2 절연층은 폴리이미드(Polyimide)를 포함하는 반도체 소자
9 9
제 7 항에 있어서,상기 제2 절연층의 두께는 약 1 마이크로미터 이상인 반도체 소자
10 10
제 2 항에 있어서,상기 소스 전극들 및 상기 드레인 전극들 사이로 연장되는 게이트 전극을 더 포함하며,평면적 관점에서, 상기 게이트 전극은 상기 소스 전극들 및 상기 드레인 전극들을 각각 둘러싸는 반도체 소자
11 11
제 10 항에 있어서,상기 제2 질화물 반도체층은 상기 제1 방향 및 상기 제2 방향으로 연장되는 리세스 영역을 포함하며,상기 게이트 전극은 상기 리세스 영역 내에 제공되는 반도체 소자
12 12
제 10 항에 있어서,상기 소스 전극들과 상기 드레인 전극들 사이의 게이트 절연막을 더 포함하며,상기 게이트 절연막은 상기 제2 질화물 반도체층 및 상기 게이트 전극 사이에 제공되는 반도체 소자
13 13
제 2 항에 있어서,상기 제1 질화물 반도체층과 상기 제2 질화물 반도체층은 이종 접합 구조인 반도체 소자
14 14
제 2 항에 있어서,상기 제1 질화물 반도체층은 GaN층이고, 상기 제2 질화물 반도체층은 AlGaN층, InAlN층, 및 InAlGaN층 중에서 선택되는 어느 하나인 반도체 소자
15 15
제 1 항에 있어서,평면적 관점에서, 상기 드레인 전극들 중의 적어도 어느 하나는 라운드된(rounded) 모서리를 갖는 사각형 구조인 반도체 소자
16 16
제 1 항에 있어서, 상기 소스 배선들은 알루미늄(Al), 몰리브덴(Mo), 금(Au), 니켈(Ni), 백금(Pt), 티탄(Ti), 팔라듐(Pd), 이리듐(Ir), 로듐(Rh), 코발트(Co), 텅스텐(W), 탄탈륨(Ta), 구리(Cu), 및 아연(Zn) 중에서 선택되는 적어도 하나를 포함하는 반도체 소자
17 17
제 1 항에 있어서,상기 소스 배선들의 두께는 3 마이크로미터 이상인 반도체 소자
18 18
기판 상에 제1 질화물 반도체층 및 제2 질화물 반도체층을 차례로 형성하는 것;상기 제2 질화물 반도체층 상에 상기 제2 질화물 반도체층의 상면에 평행한 제1 방향 및 상기 제1 방향과 교차하는 제2 방향을 따라 교대로 배열되는 드레인 전극들 및 소스 전극들을 형성하는 것;상기 소스 전극들 상에 상기 소스 전극들과 전기적으로 연결되는 소스 배선들을 형성하는 것; 및상기 소스 배선들 상에 상기 드레인 전극들과 전기적으로 연결되는 드레인 패드를 형성하는 것을 포함하는 반도체 소자의 제조 방법
19 19
제 18 항에 있어서,상기 드레인 전극들 및 상기 소스 전극들 사이로 연장되는 게이트 전극을 제공하는 것을 더 포함하는 반도체 소자의 제조 방법
20 20
제 19 항에 있어서,상기 게이트 전극은 상기 제2 질화물 반도체층 내의 리세스 영역 내에 제공되고, 상기 리세스 영역은 상기 제1 방향 및 상기 제2 방향으로 연장되는 반도체 소자의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 미래창조과학부 한국전자통신연구원 ETRI연구개발지원사업 스마트 데이터센터용 차세대 광-전 모듈 기술