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고온 열처리 장비 개발을 위한 와이드 밴드갭 전력반도체 평가기술

  • 기술번호 : KST2015020849
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 질화물 반도체 소자에 관한 것으로 관통 비아홀들을 갖는 기판, 상기 기판 상에 차례로 적층되는 제 1 및 제 2 질화물 반도체층들, 상기 제 2 질화물 반도체층 상에 제공되는 드레인 전극들 및 소스 전극들 및 상기 제 2 질화물 반도체층 상에 제공되고, 상기 드레인 전극들 상에 제공되는 상부 비아홀들을 갖는 절연 패턴을 포함하고, 상기 관통 비아홀들은 상기 제 1 및 제 2 질화물 반도체층들 내로 연장되어 상기 소스 전극들의 하면을 노출하는 질화물 반도체 소자가 제공된다.
Int. CL H01L 29/778 (2006.01) H01L 21/335 (2006.01)
CPC H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01) H01L 29/778(2013.01)
출원번호/일자 1020130166513 (2013.12.30)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2015-0077735 (2015.07.08) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.09.24)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박영락 대한민국 대전 유성구
2 고상춘 대한민국 대전 유성구
3 장우진 대한민국 대전 서구
4 문재경 대한민국 대전광역시 유성구
5 배성범 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2013.12.30 수리 (Accepted) 1-1-2013-1201509-17
2 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2015.01.16 수리 (Accepted) 1-1-2015-0048858-70
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
4 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2015.09.24 수리 (Accepted) 1-1-2015-0934034-69
5 의견제출통지서
Notification of reason for refusal
2017.02.01 발송처리완료 (Completion of Transmission) 9-5-2017-0079518-04
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.03.31 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-0316894-47
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.03.31 수리 (Accepted) 1-1-2017-0316893-02
8 등록결정서
Decision to grant
2017.04.10 발송처리완료 (Completion of Transmission) 9-5-2017-0253574-88
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
관통 비아홀들을 갖는 기판;상기 기판 상에 차례로 적층되는 제 1 및 제 2 질화물 반도체층들;상기 제 2 질화물 반도체층 상에 제공되는 드레인 전극들 및 소스 전극들; 상기 제 2 질화물 반도체층 상에 제공되고, 상기 드레인 전극들 상에 제공되는 상부 비아홀들을 갖는 절연 패턴; 및상기 제 2 질화물 반도체층 상에 제공되는 게이트 전극들을 포함하고,상기 관통 비아홀들은 상기 제 1 및 제 2 질화물 반도체층들 내로 연장되어 상기 소스 전극들의 하면을 노출하고,상기 게이트 전극들은 제 1 방향으로 연장되는 복수의 열들과 상기 제 1 방향과 교차하는 제 2 방향으로 연장되는 복수의 행들을 포함하는 질화물 반도체 소자
2 2
삭제
3 3
제 1 항에 있어서,상기 제 2 질화물 반도체층은 리세스 영역들을 가지되,평면적 관점에서, 상기 리세스 영역들은 상기 게이트 전극들과 동일한 배열을 이루고, 상기 게이트 전극들은 상기 리세스 영역들 내에 제공되는 질화물 반도체 소자
4 4
제 1 항에 있어서,평면적 관점에서, 상기 드레인 및 소스 전극들은 상기 게이트 전극들 사이의 공간에 교대로 반복 배치되어 복수의 행과 열을 이루는 질화물 반도체 소자
5 5
제 4 항에 있어서,평면적 관점에서, 상기 상부 비아홀들은 상기 드레인 전극들과 정렬되는 질화물 반도체 소자
6 6
제 4 항에 있어서,평면적 관점에서, 상기 관통 비아홀들은 상기 소스 전극들과 정렬되는 질화물 반도체 소자
7 7
관통 비아홀들을 갖는 기판;상기 기판 상에 차례로 적층되는 제 1 및 제 2 질화물 반도체층들;상기 제 2 질화물 반도체층 상에 제공되는 드레인 전극들 및 소스 전극들; 상기 제 2 질화물 반도체층 상에 제공되고, 상기 드레인 전극들 상에 제공되는 상부 비아홀들을 갖는 절연 패턴; 및상기 제 2 질화물 반도체층 상에 제공되는 게이트 전극들을 포함하고,상기 관통 비아홀들은 상기 제 1 및 제 2 질화물 반도체층들 내로 연장되어 상기 소스 전극들의 하면을 노출하고,상기 게이트 전극들은 제 1 방향으로 연장되는 라인 형태를 가지되, 상기 제 1 방향과 교차하는 제 2 방향으로 상호 이격되어 배치되되,상기 게이트 전극들은 서로 전기적으로 연결되는 질화물 반도체 소자
8 8
제 7 항에 있어서,상기 제 2 질화물 반도체층은 리세스 영역들을 가지되,평면적 관점에서, 상기 리세스 영역들은 상기 게이트 전극들과 동일한 배열을 이루고, 상기 게이트 전극들은 상기 리세스 영역들 내에 제공되는 질화물 반도체 소자
9 9
제 7 항에 있어서,상기 드레인 및 소스 전극들은 상기 제 1 방향으로 연장되는 라인 형태를 가지고, 상기 게이트 전극들의 사이에 교대로 반복하여 배치되는 질화물 반도체 소자
10 10
제 9 항에 있어서,평면적 관점에서, 상기 상부 비아홀들은 상기 드레인 전극들을 따라 연장되는 라인 형태를 가지는 질화물 반도체 소자
11 11
제 9 항에 있어서,평면적 관점에서, 상기 관통 비아홀들은 상기 소스 전극들과 정렬되어 상기 제 1 방향으로 상호 이격되어 배치되는 질화물 반도체 소자
12 12
제 1 항에 있어서, 상기 절연 패턴의 상면을 덮으며 상기 상부 비아홀들의 내측벽을 따라 연장되어 상기 드레인 전극들과 접속되는 드레인 전극 패드; 및상기 기판의 하면을 덮으며 상기 관통 비아홀들의 내측벽을 따라 연장되어 상기 소스 전극들과 접속되는 소스 전극 패드를 더 포함하는 질화물 반도체 소자
13 13
제 1 항에 있어서,상기 제 1 질화물 반도체층과 상기 제 2 질화물 반도체층은 이종 접합 구조를 이루는 질화물 반도체 소자
14 14
제 1 항에 있어서,상기 드레인 및 소스 전극들은 상기 제 2 질화물 반도체층과 오믹 접합을 이루는 질화물 반도체 소자
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2 US9136347 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 산업원천기술개발사업(ETRI연구개발지원사업) 차세대 데이터센터용 에너지절감 반도체 기술