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연결부를 포함하는 3차원 플래시 메모리 및 그 제조 방법

  • 기술번호 : KST2022022349
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 연결부를 포함하는 3차원 플래시 메모리 및 그 제조 방법이 개시된다. 일 실시예에 따르면, 3차원 플래시 메모리는 수평 방향으로 연장 형성되며 수직 방향으로 교대로 적층된 층간 절연막들 및 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 관통하며 상기 수직 방향으로 연장 형성되는 수직 채널 구조체들-상기 수직 채널 구조체들 각각은 상기 수직 방향으로 연장 형성되는 데이터 저장 패턴 및 상기 데이터 저장 패턴의 내측벽에 덮으며 상기 수직 방향으로 연장 형성되는 수직 채널 패턴을 포함함-을 각각 포함하는 스택 구조체들-상기 스택 구조체들은 상기 수직 방향으로 적층됨-; 및 상기 스택 구조체들의 사이에 배치된 채, 상기 스택 구조체들 각각의 수직 채널 패턴들을 서로 연결시키는 연결부들을 포함하는 버퍼층을 포함하고. 상기 연결부들 각각은, 상기 수직 채널 패턴들 각각보다 상기 수평 방향으로 돌출된 채 모서리가 굴곡진 형상을 갖는 것을 특징으로 할 수 있다.
Int. CL H01L 25/065 (2006.01.01) H01L 27/11582 (2017.01.01) H01L 27/11565 (2017.01.01) H01L 27/11568 (2017.01.01)
CPC H01L 25/0657(2013.01) H01L 27/11582(2013.01) H01L 27/11565(2013.01) H01L 27/11568(2013.01) H01L 2225/06544(2013.01)
출원번호/일자 1020210062347 (2021.05.14)
출원인 한양대학교 산학협력단
등록번호/일자
공개번호/일자 10-2022-0154868 (2022.11.22) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2021.05.14)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 송윤흡 서울특별시 성동구

대리인

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번호 이름 국적 주소
1 양성보 대한민국 서울특별시 강남구 선릉로***길 ** (논현동) 삼성빌딩 *층(피앤티특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2021.05.14 수리 (Accepted) 1-1-2021-0557588-49
2 의견제출통지서
Notification of reason for refusal
2022.10.17 발송처리완료 (Completion of Transmission) 9-5-2022-0790023-12
3 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2022.11.11 1-1-2022-1200673-18
4 [거절이유 등 통지에 따른 의견]의견서·답변서·소명서
2022.11.11 수리 (Accepted) 1-1-2022-1200670-82
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번호 청구항
1 1
수평 방향으로 연장 형성되며 수직 방향으로 교대로 적층된 층간 절연막들 및 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 관통하며 상기 수직 방향으로 연장 형성되는 수직 채널 구조체들-상기 수직 채널 구조체들 각각은 상기 수직 방향으로 연장 형성되는 데이터 저장 패턴 및 상기 데이터 저장 패턴의 내측벽에 덮으며 상기 수직 방향으로 연장 형성되는 수직 채널 패턴을 포함함-을 각각 포함하는 스택 구조체들-상기 스택 구조체들은 상기 수직 방향으로 적층됨-; 및 상기 스택 구조체들의 사이에 배치된 채, 상기 스택 구조체들 각각의 수직 채널 패턴들을 서로 연결시키는 연결부들을 포함하는 버퍼층을 포함하고
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제1항에 있어서,상기 연결부들 각각은, 상기 버퍼층에서 상기 수평 방향으로의 일부분에 대한 습식 식각(Wet etching)이 수행된 측벽에 형성되어 모서리가 굴곡진 형상을 갖는 것을 특징으로 하는 3차원 플래시 메모리
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제2항에 있어서,상기 버퍼층은, 상기 습식 식각이 수행될 수 있는 물질로 형성되는 것을 특징으로 하는 3차원 플래시 메모리
4 4
제3항에 있어서,상기 버퍼층을 형성하는 물질은, 실리콘 산화물 또는 금속 산화물 중 적어도 하나의 물질을 포함하는 것을 특징으로 하는 3차원 플래시 메모리
5 5
제1항에 있어서,상기 연결부들 각각은, 상기 버퍼층이 서로 다른 식각비를 갖는 복수의 층들이 상기 수직 방향으로 적층되어 구성됨에 따라, 상기 버퍼층에서 상기 수평 방향으로의 일부분에 대한 식각이 수행된 측벽에 형성되어 모서리가 굴곡진 형상을 갖는 것을 특징으로 하는 3차원 플래시 메모리
6 6
제5항에 있어서,상기 복수의 층들 중 상기 수직 방향으로 중앙에 위치하는 층은, 상기 복수의 층들 중 상기 수직 방향으로 가장자리에 위치하는 층들보다 높은 식각비를 갖는 것을 특징으로 하는 3차원 플래시 메모리
7 7
제1항에 있어서,상기 수직 채널 패턴들 각각이 상기 수직 채널 패턴들 각각에 의해 적어도 일부분이 감싸진 채 상기 수직 방향으로 연장 형성되는 백 게이트를 포함하는 경우, 상기 연결부들 각각은, 상기 백 게이트가 상기 수직 방향으로 연장 형성되는 내부 홀(Hole)을 포함하는 것을 특징으로 하는 3차원 플래시 메모리
8 8
제1항에 있어서,상기 연결부들 각각은, 상기 수직 채널 패턴들과 동일한 물질로 형성되는 부분을 포함하는 것을 특징으로 하는 3차원 플래시 메모리
9 9
제1항에 있어서,상기 연결부들 각각은, 평면 상 상기 수직 채널 패턴들 각각을 수용하는 크기 및 위치에 형성되는 것을 특징으로 하는 3차원 플래시 메모리
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수평 방향으로 연장 형성되며 수직 방향으로 교대로 적층된 층간 절연막들 및 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 상기 수직 방향으로 관통하는 채널 홀들을 포함하는 하부 스택 구조체를 준비하는 단계; 상기 하부 스택 구조체의 상부에 버퍼층을 형성하는 단계; 상기 버퍼층이 형성된 상기 하부 스택 구조체의 상부에, 상기 수평 방향으로 연장 형성되며 상기 수직 방향으로 교대로 적층된 상기 층간 절연막들 및 상기 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 상기 수직 방향으로 관통하는 채널 홀들을 포함하는 상부 스택 구조체를 형성하는 단계; 상기 채널 홀들의 위치에 기초하여 상기 버퍼층을 상기 수직 방향으로 관통하는 채널 연결 홀들을 형성하는 단계; 상기 채널 홀들 및 상기 채널 연결 홀들을 통해, 잔여 부분이 언더컷(Undercut) 형상을 갖도록 상기 버퍼층에서 상기 수평 방향으로의 일부분에 대한 습식 식각(Wet etching)을 수행하는 단계; 및 상기 채널 홀들의 내측벽 및 상기 버퍼층에 대한 식각이 수행된 측벽에, 데이터 저장 패턴 및 수직 채널 패턴을 각각 포함하는 수직 채널 구조체들을 상기 수직 방향으로 연장 형성하는 단계를 포함하고, 상기 수직 채널 구조체들을 상기 수직 방향으로 연장 형성하는 단계는, 상기 상부 스택 구조체에 연장 형성된 수직 채널 패턴들과 상기 하부 스택 구조체에 연장 형성된 수직 채널 패턴들을 서로 연결시키며 상기 수직 채널 패턴들 각각보다 상기 수평 방향으로 돌출된 채 모서리가 굴곡진 형상을 갖는 연결부들을 형성하는 단계를 포함하는 것을 특징으로 하는 3차원 플래시 메모리의 제조 방법
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제1항에 있어서,상기 버퍼층을 형성하는 단계는, 상기 습식 식각이 수행될 수 있는 물질로 상기 버퍼층을 형성하는 단계인 것을 특징으로 하는 3차원 플래시 메모리의 제조 방법
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수평 방향으로 연장 형성되며 수직 방향으로 교대로 적층된 층간 절연막들 및 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 상기 수직 방향으로 관통하는 채널 홀들을 포함하는 하부 스택 구조체를 준비하는 단계; 상기 하부 스택 구조체의 상부에 서로 다른 식각비를 갖는 복수의 층들이 상기 수직 방향으로 적층된 버퍼층을 형성하는 단계; 상기 버퍼층이 형성된 상기 하부 스택 구조체의 상부에, 상기 수평 방향으로 연장 형성되며 상기 수직 방향으로 교대로 적층된 상기 층간 절연막들 및 상기 게이트 전극들과, 상기 층간 절연막들 및 상기 게이트 전극들을 상기 수직 방향으로 관통하는 채널 홀들을 포함하는 상부 스택 구조체를 형성하는 단계; 상기 채널 홀들의 위치에 기초하여 상기 버퍼층을 상기 수직 방향으로 관통하는 채널 연결 홀들을 형성하는 단계; 상기 채널 홀들 및 상기 채널 연결 홀들을 통해, 잔여 부분이 언더컷(Undercut) 형상을 갖도록 상기 버퍼층에서 상기 수평 방향으로의 일부분에 대한 식각을 수행하는 단계; 및 상기 채널 홀들의 내측벽 및 상기 버퍼층에 대한 식각이 수행된 측벽에, 데이터 저장 패턴 및 수직 채널 패턴을 각각 포함하는 수직 채널 구조체들을 상기 수직 방향으로 연장 형성하는 단계를 포함하고, 상기 수직 채널 구조체들을 상기 수직 방향으로 연장 형성하는 단계는, 상기 상부 스택 구조체에 연장 형성된 수직 채널 패턴들과 상기 하부 스택 구조체에 연장 형성된 수직 채널 패턴들을 서로 연결시키며 상기 수직 채널 패턴들 각각보다 상기 수평 방향으로 돌출된 채 모서리가 굴곡진 형상을 갖는 연결부들을 형성하는 단계를 포함하는 것을 특징으로 하는 3차원 플래시 메모리의 제조 방법
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제12항에 있어서,상기 버퍼층을 형성하는 단계는, 상기 복수의 층들 중 상기 수직 방향으로 중앙에 위치하는 층을 상기 복수의 층들 중 상기 수직 방향으로 가장자리에 위치하는 층들보다 높은 식각비를 갖는 물질로 형성하는 단계를 포함하는 것을 특징으로 하는 3차원 플래시 메모리의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.