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표시 장치

  • 기술번호 : KST2021004761
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 표시 장치가 제공된다. 표시 장치는 스캔 라인들 각각에 접속되는 복수의 화소, 및 상기 스캔 라인들 각각에 스캔 신호를 공급하는 스테이지들을 구비한 스캔 구동부를 포함하고, 상기 스테이지들 각각은 제1 클럭 단자의 입력 신호 또는 이전 스테이지의 제1 출력 신호를 기초로 이전 스테이지의 제2 출력 신호를 제1 노드에 공급하는 노드 제어부, 상기 제1 노드와 제2 노드 사이에 배치되는 제1 인버터부, 제2 클럭 단자의 입력 신호를 기초로 상기 제2 노드의 전압을 제1 출력 단자에 공급하는 버퍼부, 및 상기 제1 출력 단자와 제2 출력 단자 사이에 배치되는 제2 인버터부를 포함한다.
Int. CL G09G 3/3258 (2016.01.01)
CPC G09G 3/3258(2013.01) G09G 2230/00(2013.01) G09G 2300/0439(2013.01) G09G 2300/0809(2013.01) G09G 2310/0264(2013.01)
출원번호/일자 1020190130952 (2019.10.21)
출원인 삼성디스플레이 주식회사, 건국대학교 산학협력단
등록번호/일자
공개번호/일자 10-2021-0047436 (2021.04.30) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 20

출원인

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번호 이름 국적 주소
1 삼성디스플레이 주식회사 대한민국 경기 용인시 기흥구
2 건국대학교 산학협력단 대한민국 서울특별시 광진구

발명자

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번호 이름 국적 주소
1 양태훈 경기도 용인시 기흥구
2 이준호 경기도 성남시 분당구
3 박기찬 서울특별시 송파구
4 김기범 경기도 화성
5 박향아 서울특별시 강남구
6 이종찬 경기도 수원시 영통구
7 정웅희 서울특별시 동작구

대리인

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번호 이름 국적 주소
1 특허법인가산 대한민국 서울 서초구 남부순환로 ****, *층(서초동, 한원빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.10.21 수리 (Accepted) 1-1-2019-1074890-58
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
스캔 라인들 각각에 접속되는 복수의 화소; 및상기 스캔 라인들 각각에 스캔 신호를 공급하는 스테이지들을 구비한 스캔 구동부를 포함하고,상기 스테이지들 각각은,제1 클럭 단자의 입력 신호 또는 이전 스테이지의 제1 출력 신호를 기초로 이전 스테이지의 제2 출력 신호를 제1 노드에 공급하는 노드 제어부;상기 제1 노드와 제2 노드 사이에 배치되는 제1 인버터부;제2 클럭 단자의 입력 신호를 기초로 상기 제2 노드의 전압을 제1 출력 단자에 공급하는 버퍼부; 및상기 제1 출력 단자와 제2 출력 단자 사이에 배치되는 제2 인버터부를 포함하는 표시 장치
2 2
제1 항에 있어서,상기 노드 제어부는,상기 제1 클럭 단자의 입력 신호가 게이트 로우 전압을 갖는 경우 상기 이전 스테이지의 제2 출력 신호를 상기 제1 노드에 공급하는 제1 트랜지스터; 및상기 이전 스테이지의 제1 출력 신호가 게이트 하이 전압을 갖는 경우 상기 이전 스테이지의 제2 출력 신호를 상기 제1 노드에 공급하는 제2 트랜지스터를 포함하는 표시 장치
3 3
제2 항에 있어서,상기 제1 트랜지스터의 게이트 전극은 상기 스테이지의 제1 클럭 단자에 접속되고, 제1 전극은 상기 스테이지의 제2 스타트 단자에 접속되며, 제2 전극은 상기 제1 노드에 접속되고,상기 제2 트랜지스터의 게이트 전극은 상기 스테이지의 제1 스타트 단자에 접속되고, 제1 전극은 상기 스테이지의 제2 스타트 단자에 접속되며, 제2 전극은 상기 제1 노드에 접속되는 표시 장치
4 4
제1 항에 있어서,상기 제1 인버터부는,상기 제1 노드가 게이트 로우 전압을 갖는 경우 게이트 하이 전압을 상기 제2 노드에 공급하는 제5 트랜지스터; 및상기 제1 노드가 게이트 하이 전압을 갖는 경우 게이트 로우 전압을 상기 제2 노드에 공급하는 제6 트랜지스터를 포함하는 표시 장치
5 5
제4 항에 있어서,상기 제5 트랜지스터의 게이트 전극은 상기 제1 노드에 접속되고, 제1 전극은 상기 게이트 하이 전압을 공급하는 게이트 하이 전압 라인에 접속되며, 제2 전극은 상기 제2 노드에 접속되고,상기 제6 트랜지스터의 게이트 전극은 상기 제1 노드에 접속되고, 제1 전극은 상기 제2 노드에 접속되며, 제2 전극은 상기 게이트 로우 전압을 공급하는 게이트 로우 전압 라인에 접속되는 표시 장치
6 6
제1 항에 있어서,상기 버퍼부는,상기 제2 클럭 단자의 입력 신호가 게이트 로우 전압을 갖는 경우 상기 제2 노드의 전압을 상기 제1 출력 단자에 공급하는 제3 트랜지스터; 및상기 제2 클럭 단자의 입력 신호가 게이트 하이 전압을 갖는 경우 게이트 로우 전압을 상기 제1 출력 단자에 공급하는 제4 트랜지스터를 포함하는 표시 장치
7 7
제6 항에 있어서,상기 제3 트랜지스터의 게이트 전극은 상기 스테이지의 제2 클럭 단자에 접속되고, 제1 전극은 상기 제2 노드에 접속되며, 제2 전극은 상기 제1 출력 단자에 접속되고,상기 제4 트랜지스터의 게이트 전극은 상기 스테이지의 제2 클럭 단자에 접속되고, 제1 전극은 상기 제1 출력 단자에 접속되며, 제2 전극은 상기 게이트 로우 전압을 공급하는 게이트 로우 전압 라인에 접속되는 표시 장치
8 8
제1 항에 있어서,상기 제2 인버터부는,상기 제1 출력 단자가 게이트 로우 전압을 갖는 경우 게이트 하이 전압을 상기 제2 출력 단자에 공급하는 제7 트랜지스터; 및상기 제1 출력 단자가 게이트 하이 전압을 갖는 경우 게이트 로우 전압을 상기 제2 출력 단자에 공급하는 제8 트랜지스터를 포함하는 표시 장치
9 9
제8 항에 있어서,상기 제7 트랜지스터의 게이트 전극은 상기 제1 출력 단자에 접속되고, 제1 전극은 상기 게이트 하이 전압을 공급하는 게이트 하이 전압 라인에 접속되며, 제2 전극은 상기 제2 출력 단자에 접속되고,상기 제8 트랜지스터의 게이트 전극은 상기 제1 출력 단자에 접속되고, 제1 전극은 상기 제2 출력 단자에 접속되며, 제2 전극은 상기 게이트 로우 전압을 공급하는 게이트 로우 전압 라인에 접속되는 표시 장치
10 10
제1 항에 있어서,상기 스테이지들 각각은 상기 제2 출력 단자와 제3 출력 단자 사이에 배치되는 제3 인버터부를 더 포함하는 표시 장치
11 11
제10 항에 있어서,상기 제3 인버터부는,상기 제2 출력 단자가 게이트 로우 전압을 갖는 경우 게이트 하이 전압을 상기 제3 출력 단자에 공급하는 제9 트랜지스터; 및상기 제2 출력 단자가 게이트 하이 전압을 갖는 경우 게이트 로우 전압을 상기 제3 출력 단자에 공급하는 제10 트랜지스터를 포함하는 표시 장치
12 12
제11 항에 있어서,상기 제9 트랜지스터의 게이트 전극은 상기 제2 출력 단자에 접속되고, 제1 전극은 상기 게이트 하이 전압을 공급하는 게이트 하이 전압 라인에 접속되며, 제2 전극은 상기 제3 출력 단자에 접속되고,상기 제10 트랜지스터의 게이트 전극은 상기 제2 출력 단자에 접속되고, 제1 전극은 상기 제3 출력 단자에 접속되며, 제2 전극은 상기 게이트 로우 전압을 공급하는 게이트 로우 전압 라인에 접속되는 표시 장치
13 13
제1 항에 있어서,상기 스테이지들 각각은 상기 제1 노드와 게이트 로우 전압 라인 사이에 배치되는 커패시터를 더 포함하는 표시 장치
14 14
제1 항에 있어서,상기 스테이지들 중 제2n-1(n은 자연수) 스테이지는 상기 제1 클럭 단자에 제1 클럭 신호를 수신하고, 상기 제2 클럭 단자에 제2 클럭 신호를 수신하며,상기 스테이지들 중 제2n 스테이지는 상기 제1 클럭 단자에 제2 클럭 신호를 수신하고, 상기 제2 클럭 단자에 제1 클럭 신호를 수신하는 표시 장치
15 15
제1 항에 있어서,상기 스테이지들 중 제k(k는 2 이상의 자연수) 스테이지의 제1 스타트 단자는 제k-1 스테이지의 제1 출력 단자와 접속되고, 제k 스테이지의 제2 스타트 단자는 제k-1 스테이지의 제2 출력 단자와 접속되는 표시 장치
16 16
제10 항에 있어서,상기 복수의 화소 각각은,발광 소자;상기 발광 소자에 흐르는 구동 전류를 제어하는 구동 트랜지스터;초기화 전압을 상기 구동 트랜지스터의 게이트 전극에 선택적으로 공급하는 제1 스위칭 트랜지스터;데이터 전압을 상기 구동 트랜지스터의 제1 전극에 선택적으로 공급하는 제2 스위칭 트랜지스터;상기 구동 트랜지스터의 제2 전극과 게이트 전극을 선택적으로 접속시키는 제3 스위칭 트랜지스터;초기화 전압을 상기 발광 소자의 제1 전극에 선택적으로 공급하는 제4 스위칭 트랜지스터;구동 전압을 상기 구동 트랜지스터의 제1 전극에 선택적으로 공급하는 제5 스위칭 트랜지스터; 및상기 구동 트랜지스터의 제2 전극과 상기 발광 소자의 제1 전극을 선택적으로 접속시키는 제6 스위칭 트랜지스터를 포함하는 표시 장치
17 17
제16 항에 있어서,상기 복수의 화소 중 제k(k는 2 이상의 자연수) 행에 배치된 화소들의 상기 제2 스위칭 트랜지스터와 상기 제3 스위칭 트랜지스터는 상기 스테이지들 중 제k 스테이지의 상기 제2 출력 단자의 출력 신호를 기초로 턴-온되는 표시 장치
18 18
제16 항에 있어서,상기 복수의 화소 중 제k(k는 2 이상의 자연수) 행에 배치된 화소들의 상기 제1 스위칭 트랜지스터는 상기 스테이지들 중 제k-1 스테이지의 제3 출력 단자의 출력 신호를 기초로 턴-온되는 표시 장치
19 19
제16 항에 있어서,상기 복수의 화소 중 제k(k는 2 이상의 자연수) 행에 배치된 화소들의 상기 제4 스위칭 트랜지스터는 상기 스테이지들 중 제k 스테이지의 제3 출력 단자의 출력 신호를 기초로 턴-온되는 표시 장치
20 20
제16 항에 있어서,상기 제1 스위칭 트랜지스터 및 상기 제4 스위칭 트랜지스터는 상기 제2 스위칭 트랜지스터 및 상기 제3 스위칭 트랜지스터와 서로 다른 타입으로 형성된 표시 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.