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해밍 웨이트 모델을 이용한 전력 분석공격을 방지할 수 있는 논리회로 및 이를 포함하는 스마트 카드

  • 기술번호 : KST2015210964
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 해밍 웨이트 모델을 이용한 전력 분석공격을 방지할 수 있는 논리회로 및 이를 포함한 스마트 카드에 관한 것으로, 논리 게이트를 포함하는 논리 회로와, 상기 논리 게이트의 출력단에 상기 논리 게이트와 동일한 특성의 FET 소자가 설치되어, 상기 논리 회로의 전체 전류를 일정하게 유지시키는 것을 특징으로 한다.이와 같은 본 발명은, 논리회로에 간단한 소자의 설치와 구성으로, 암호화 프로세스를 수행하는 논리회로의 출력단에서 전력신호 또는 전류신호를 측정하더라도 일정한 값을 도출시켜 전력 분석공격을 원천적으로 차단할 수 있는 전력 분석공격 방지 논리회로를 제공할 수 있게 된다.
Int. CL G06F 7/00 (2006.01) H03K 19/20 (2006.01)
CPC H03K 19/00338(2013.01) H03K 19/00338(2013.01)
출원번호/일자 1020110112402 (2011.10.31)
출원인 동서대학교산학협력단
등록번호/일자 10-1332376-0000 (2013.11.18)
공개번호/일자 10-2013-0047401 (2013.05.08) 문서열기
공고번호/일자 (20131126) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2011.10.31)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 동서대학교 산학협력단 대한민국 부산광역시 사상구

발명자

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번호 이름 국적 주소
1 박영구 대한민국 경남 창원시
2 이훈재 대한민국 대구광역시 동구
3 황기현 대한민국 부산광역시 해운대구

대리인

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번호 이름 국적 주소
1 김일환 대한민국 서울특별시 관악구 남부순환로 ****, ***호 제니스국제특허법률사무소 (봉천동, 청동빌딩)

최종권리자

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번호 이름 국적 주소
1 동서대학교산학협력단 부산광역시 사상구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2011.10.31 수리 (Accepted) 1-1-2011-0855776-93
2 [출원인변경]권리관계변경신고서
[Change of Applicant] Report on Change of Proprietary Status		 2012.01.10 수리 (Accepted) 1-1-2012-0024447-53
3 선행기술조사의뢰서
Request for Prior Art Search		 2012.05.14 수리 (Accepted) 9-1-9999-9999999-89
4 선행기술조사보고서
Report of Prior Art Search		 2012.06.21 수리 (Accepted) 9-1-2012-0048841-44
5 의견제출통지서
Notification of reason for refusal		 2012.08.16 발송처리완료 (Completion of Transmission) 9-5-2012-0474789-86
6 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)		 2012.10.16 수리 (Accepted) 1-1-2012-0841587-22
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2012.11.16 수리 (Accepted) 1-1-2012-0946218-85
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2012.11.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-0946216-94
9 최후의견제출통지서
Notification of reason for final refusal		 2013.03.28 발송처리완료 (Completion of Transmission) 9-5-2013-0209602-54
10 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2013.05.28 보정승인 (Acceptance of amendment) 1-1-2013-0472457-85
11 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2013.05.28 수리 (Accepted) 1-1-2013-0472458-20
12 등록결정서
Decision to grant		 2013.09.26 발송처리완료 (Completion of Transmission) 9-5-2013-0665117-95
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2018.08.21 수리 (Accepted) 4-1-2018-5163918-21
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
하나 또는 두개의 FET 소자로 구성된 논리 게이트와,상기 논리 게이트의 출력단에 게이트를 연결하고 공급전원(Vcc)에 소스가 연결되는 상기 논리게이트의 FET 소자와 동일한 특성을 갖는 하나의 FET 소자가 설치되어,상기 논리 게이트의 전체 전류(I)를 일정하게 유지시키는 것을 특징으로 하는 해밍 웨이트 모델을 이용한 전력 분석공격을 방지할 수 있는 논리회로
2 2
하나의 MOS형의 논리 게이트 회로와,상기 논리 게이트 회로의 출력단에 게이트를 연결하고 공급전원(Vcc)에 소스가 연결되는 하나의 FET 소자와,상기 FET 소자의 소스와 공급전원(Vcc) 사이에 연결하는 가변저항을 포함하되,상기 가변저항의 조정을 통해 논리 회로 전체 전류를 일정하게 유지시키는 것을 특징으로 하는 해밍 웨이트 모델을 이용한 전력 분석공격을 방지할 수 있는 논리회로
3 3
제1항 또는 제2항의 전력 분석공격을 방지할 수 있는 논리회로를 포함하는 스마트 카드
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.