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반도체 소자 및 이의 제조 방법(A SEMICONDUCTOR DEVICE AND A METHOD OF FABRICATING THE SAME)

  • 기술번호 : KST2018000633
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 반도체 소자 및 이의 제조 방법에 관한 것이다. 본 발명의 일 실시예에 따르면, 적어도 하나의 그래핀층; 상기 적어도 하나의 그래핀층 상에 상기 적어도 하나의 그래핀층으로부터 에피택셜 재결정화된 강유전성 고분자 결정층; 및 상기 강유전성 고분자 결정층 상의 적어도 하나의 도전성 전극층을 포함하는 반도체 소자가 제공된다.
Int. CL H01L 27/115 (2016.08.03) H01L 29/16 (2016.08.03) H01L 49/02 (2016.08.03) H01L 21/28 (2016.08.03) H01L 21/02 (2016.08.03)
CPC H01L 27/11507(2013.01)H01L 27/11507(2013.01)H01L 27/11507(2013.01)H01L 27/11507(2013.01)H01L 27/11507(2013.01)H01L 27/11507(2013.01)
출원번호/일자 1020160082385 (2016.06.30)
출원인 연세대학교 산학협력단
등록번호/일자
공개번호/일자 10-2018-0003666 (2018.01.10) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2016.06.30)
심사청구항수 14

출원인

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구

발명자

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번호 이름 국적 주소
1 박철민 대한민국 서울특별시 서대문구
2 김강립 대한민국 서울특별시 서대문구
3 이원호 대한민국 서울특별시 서대문구
4 안종현 대한민국 서울특별시 서대문구
5 강석주 대한민국 울산광역시 울주군

대리인

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번호 이름 국적 주소
1 김권석 대한민국 서울특별시 서초구 논현로**, B동 *층(양재동, 삼호물산빌딩)(아이피맥스특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 연세대학교 산학협력단 대한민국 서울특별시 서대문구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2016.06.30 수리 (Accepted) 1-1-2016-0633908-66
2 선행기술조사의뢰서
Request for Prior Art Search
2017.05.12 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2017.07.11 발송처리완료 (Completion of Transmission) 9-6-2017-0105781-18
4 의견제출통지서
Notification of reason for refusal
2017.07.17 발송처리완료 (Completion of Transmission) 9-5-2017-0497578-15
5 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2017.09.18 수리 (Accepted) 1-1-2017-0903806-53
6 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2017.10.17 수리 (Accepted) 1-1-2017-1021673-57
7 [지정기간연장]기간연장(단축, 경과구제)신청서
[Designated Period Extension] Application of Period Extension(Reduction, Progress relief)
2017.10.25 불수리 (Non-acceptance) 1-1-2017-1057152-69
8 서류반려이유통지서
Notice of Reason for Return of Document
2017.11.07 발송처리완료 (Completion of Transmission) 1-5-2017-0159571-15
9 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2017.11.17 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2017-1146932-20
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2017.11.17 수리 (Accepted) 1-1-2017-1146878-52
11 서류반려통지서
Notice for Return of Document
2017.12.13 발송처리완료 (Completion of Transmission) 1-5-2017-0178881-43
12 의견제출통지서
Notification of reason for refusal
2018.04.30 발송처리완료 (Completion of Transmission) 9-5-2018-0291281-20
13 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2018.05.10 수리 (Accepted) 1-1-2018-0459433-12
14 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2018.05.10 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2018-0459486-21
15 등록결정서
Decision to grant
2018.11.26 발송처리완료 (Completion of Transmission) 9-5-2018-0806306-19
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
적어도 하나의 그래핀 층;상기 적어도 하나의 그래핀 층 상에 상기 적어도 하나의 그래핀 층으로부터 에피택셜 재결정화된 강유전성 고분자 결정층; 및상기 강유전성 고분자 결정층 상의 적어도 하나의 도전성 전극층을 포함하며,상기 강유전성 고분자 결정층은 상기 그래핀 층의 상기 그래핀의 격자의 센터-투-센터 방향으로부터 10° 내지 80 ° 씩 회전하여 에피택셜 재결정화되는 반도체 소자
2 2
제 1 항에 있어서,상기 강유전성 고분자 결정층은 폴리비닐리덴 플로라이드(PVDF), 상기 폴리비닐리덴 플로라이드를 포함하는 중합체, PVDF-TrFE, PVDF-HFP, PVDF-CTFE와 같은 공중합체, 또는 PVDF-TrFE-CFE 또는 PVDF-TrFE-CTFE와 같은 삼원공중합체, 나일론, 시아노중합체, 및 이들의 중합체, 공중합체 또는 혼합물을 포함하는 것을 특징으로 하는 반도체 소자
3 3
삭제
4 4
제 1 항에 있어서,상기 강유전성 고분자 결정층은 80 ℃ 내지 300 ℃ 의 온도에서 형성되는 것을 특징으로 하는 반도체 소자
5 5
제 1 항에 있어서,상기 강유전성 고분자 결정층은 1 nm 내지 4000 nm의 두께를 갖는 것을 특징으로 하는 반도체 소자
6 6
제 1 항에 있어서,상기 도전성 전극층은 백금(Pt), 텅스텐(W), 금(Au), 파라듐(Pd), 로듐(Rh) 이리듐(Ir), 루테늄(Ru), 탄탈륨(Ta), 몰리브데늄(Mo), 크롬(Cr), 바나듐(V), 티타늄(Ti), 알루미늄(Al), 구리(Cu), 은(Ag), 니켈(Ni), 망간(Mn), 주석(Sn) 또는 이의 합금, 질화물 또는 산화물, 실리콘(Si), 실리콘 화합물, 활성탄(activated carbon), 그래핀(graphene), 탄소나노튜브(carbon nano tube) 및 풀러린(fullerene) 중 어느 하나 이상을 포함하는 것을 특징으로 하는 반도체 소자
7 7
제 1 항에 있어서,상기 그래핀 층이 형성되는 그래핀 기저층을 더 포함하는 것을 특징으로 하는 반도체 소자
8 8
제 7 항에 있어서,상기 그래핀 기저층은 실리콘계 재료, Ⅲ-Ⅴ족 반도체 재료, Ⅱ-Ⅵ족 반도체 재료, 혼합 반도체 재료, 산화물 반도체 재료, 나노 스케일 재료 또는 이들의 복합 재료, 셀룰로오스계 수지, 폴리에틸렌테레프탈레이트(polyethyleneterephthalate; PET) 및 폴리에틸렌 나프탈레이트(polyethylene naphthalate; PEN)를 포함하는 폴리에스테르 수지, 폴리에틸렌 수지, 염화 폴리비닐 수지, 폴리카보네이트(PC), 폴리에테리 술폰(PES), 폴리에테르 에테르케톤(PEEK), 황화 폴리페닐렌(PPS), 폴리트리페닐아민(PTAA) 중 어느 하나 또는 이들의 혼합물을 포함하는 것을 특징으로 하는 반도체 소자
9 9
적어도 하나의 그래핀층을 제공하는 단계;상기 적어도 하나의 그래핀층 상에 상기 적어도 하나의 그래핀층으로부터 강유전성 고분자 결정층을 에피택셜 재결정화시키는 단계;상기 강유전성 고분자 결정층 상에 적어도 하나의 도전성 전극층을 형성하는 단계를 포함하며,상기 에피택셜 재결정화시키는 단계는, 상기 강유전성 고분자 결정층이 상기 그래핀 층의 상기 그래핀의 격자의 센터-투-센터 방향으로부터 10 ° 내지 80 ° 씩 회전하여 성장되는 반도체 소자의 제조 방법
10 10
제 9 항에 있어서,상기 에피택셜 재결정화시키는 단계는,상기 적어도 하나의 그래핀층 상에 상기 강유전성 고분자를 포함하는 용액을 도포하는 단계; 및 상기 그래핀층과 상기 용액의 혼합 이후에 80 ℃ 내지 300 ℃ 의 온도로 열처리하여 상기 그래핀층 상에 상기 강유전성 고분자를 에피택셜 재결정화시키는 단계를 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법
11 11
제 9 항에 있어서,상기 강유전성 고분자는 폴리비닐리덴 플로라이드(PVDF), 상기 폴리비닐리덴 플로라이드를 포함하는 중합체, PVDF-TrFE, PVDF-HFP, PVDF-CTFE와 같은 공중합체, 또는 PVDF-TrFE-CFE 또는 PVDF-TrFE-CTFE와 같은 삼원공중합체, 나일론, 시아노중합체, 및 이들의 중합체, 공중합체 또는 혼합물을 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법
12 12
삭제
13 13
제 9 항에 있어서,상기 강유전성 고분자 결정층은 1nm 내지 4000nm 의 두께를 갖는 것을 특징으로 하는 반도체 소자의 제조 방법
14 14
제 9 항에 있어서,상기 도전성 전극층은 백금(Pt), 텅스텐(W), 금(Au), 파라듐(Pd), 로듐(Rh) 이리듐(Ir), 루테늄(Ru), 탄탈륨(Ta), 몰리브데늄(Mo), 크롬(Cr), 바나듐(V), 티타늄(Ti), 알루미늄(Al), 구리(Cu), 은(Ag), 니켈(Ni), 망간(Mn), 주석(Sn) 또는 이의 합금, 질화물 또는 산화물, 실리콘(Si), 실리콘 화합물, 활성탄(activated carbon), 그래핀(graphene), 탄소나노튜브(carbon nano tube) 및 풀러린(fullerene) 중 어느 하나 이상을 포함하는 것을 특징으로 하는 반도체 소자의 제조 방법
15 15
제 1 항 또는 제 4 항 기재의 상기 반도체 소자를 포함하는 비휘발성 메모리 장치
16 16
적어도 하나의 그래핀 층;상기 적어도 하나의 그래핀 층 상에 형성되는 바늘 형상의 결정 구조를 갖는 강유전성 고분자 결정층; 및상기 강유전성 고분자 결정층 상의 적어도 하나의 도전성 전극층을 포함하며,상기 강유전성 고분자 결정층은 상기 그래핀 층의 상기 그래핀의 격자의 센터-투-센터 방향으로부터 10° 내지 80 ° 씩 회전하여 에피택셜 재결정화되는 반도체 소자
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.