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프로그래머블 클럭 제너레이터

  • 기술번호 : KST2015087505
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 선택신호들의 조합에 따라 지연시간이 조절되도록 함으로써 출력신호 간의 비중첩 시간을 임의로 조절할 수 있는 프로그래머블 클럭 제너레이터에 관해 개시한다. 클럭 제너레이터를 칩으로 제작한 후에도 사용자가 임의로 선택신호들을 입력하여 비중첩 시간을 조절할 수 있으므로 비중첩 시간이 고정되는 종래의 클럭 제너레이터에 비해 사용 효율이 높고, 또한, 칩의 크기가 증가되어도 데이터 전달시 에러가 발생되지 않는다. 각 구성요소의 성능을 최적화시키면 저전력 및 고효율의 클럭 제너레이터를 구현할 수 있으며, 동기식 순차 시스템으로 작동하는 고성능 마이크로 프로세서 등에 활용될 수 있다. 클럭 제너레이터, 지연시간, 비중첩 시간, 선택신호, 프로그래머블
Int. CL G06F 1/04 (2006.01)
CPC G06F 1/08(2013.01) G06F 1/08(2013.01)
출원번호/일자 1020040103714 (2004.12.09)
출원인 한국전자통신연구원
등록번호/일자 10-0619474-0000 (2006.08.28)
공개번호/일자 10-2006-0065011 (2006.06.14) 문서열기
공고번호/일자 (20060908) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2004.12.09)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이대우 대한민국 대전 유성구
2 노태문 대한민국 대전 유성구
3 양일석 대한민국 대전 유성구
4 김규현 대한민국 대전 유성구
5 조영균 대한민국 전북 완주군
6 이상흥 대한민국 대전 서구
7 김종대 대한민국 대전 서구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2004.12.09 수리 (Accepted) 1-1-2004-0580970-30
2 선행기술조사의뢰서
Request for Prior Art Search
2006.02.08 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.03.18 수리 (Accepted) 9-1-2006-0018061-04
4 의견제출통지서
Notification of reason for refusal
2006.03.31 발송처리완료 (Completion of Transmission) 9-5-2006-0188914-14
5 의견서
Written Opinion
2006.05.30 수리 (Accepted) 1-1-2006-0384432-15
6 등록결정서
Decision to grant
2006.08.25 발송처리완료 (Completion of Transmission) 9-5-2006-0490366-55
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
하나의 입력단자를 통해 클럭을 입력받는 제 1 낸드 게이트, 하나의 입력단자를 통해 반전된 상기 클럭을 입력받는 제 2 낸드 게이트, 상기 제 1 낸드 게이트의 출력을 반전시키는 제 1 인버터, 상기 제 2 낸드 게이트의 출력을 반전시키는 제 2 인버터, 상기 제 1 인버터의 출력을 지연시키는 제 1 지연수단, 상기 제 2 인버터의 출력을 지연시키는 제 2 지연수단, 외부로부터 제공되는 다수의 선택신호를 조합하여 상기 제 1 지연수단의 지연시간을 결정하고, 상기 제 1 지연수단으로부터 출력되는 신호를 제 1 출력단자로 제공하는 제 1 지연시간 조절수단, 상기 다수의 선택신호를 조합하여 상기 제 2 지연수단의 지연시간을 결정하고, 상기 제 2 지연수단으로부터 출력되는 신호를 제 2 출력단자로 제공하는 제 2 지연시간 조절수단, 상기 제 1 출력단자의 신호를 반전시켜 상기 제 2 낸드 게이트의 다른 입력단자로 제공하는 제 3 인버터, 상기 제 2 출력단자의 신호를 반전시켜 상기 제 1 낸드 게이트의 다른 입력단자로 제공하는 제 4 인버터를 포함하는 것을 특징으로 하는 프로그래머블 클럭 제너레이터
2 2
제 1 항에 있어서, 상기 제 1 및 제 2 지연수단은 직렬로 연결된 다수의 인버터들로 구성되며, 상기 인버터들 사이에 출력탭이 각각 형성된 것을 특징으로 하는 프로그래머블 클럭 제너레이터
3 3
제 2 항에 있어서, 상기 다수의 인버터들은 짝수개이며, 상기 출력탭은 짝수개의 인버터 마다 형성된 것을 특징으로 하는 프로그래머블 클럭 제너레이터
4 4
제 1 항에 있어서, 상기 제 1 지연시간 조절수단은 상기 다수의 선택신호, 반전된 상기 다수의 선택신호 및 상기 제 1 지연수단의 출력들을 서로 다르게 조합하는 다수의 제 1 논리 게이트와, 상기 다수의 제 1 논리 게이트들의 출력을 조합하여 상기 제 1 출력단자로 제공하는 제 2 논리 게이트로 구성된 것을 특징으로 하는 프로그래머블 클럭 제너레이터
5 5
제 1 항에 있어서, 상기 제 2 지연시간 조절수단은 상기 다수의 선택신호, 반전된 상기 다수의 선택신호 및 상기 제 2 지연수단의 출력들을 서로 다르게 조합하는 다수의 제 1 논리 게이트와, 상기 다수의 제 1 논리 게이트들의 출력을 조합하여 상기 제 2 출력단자로 제공하는 제 2 논리 게이트로 구성된 것을 특징으로 하는 프로그래머블 클럭 제너레이터
6 6
제 4 항 또는 제 5 항에 있어서, 상기 제 1 논리 게이트는 앤드 게이트이고, 상기 제 2 논리 게이트는 오아 게이트인 것을 특징으로 하는 프로그래머블 클럭 제너레이터
7 6
제 4 항 또는 제 5 항에 있어서, 상기 제 1 논리 게이트는 앤드 게이트이고, 상기 제 2 논리 게이트는 오아 게이트인 것을 특징으로 하는 프로그래머블 클럭 제너레이터
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.