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계층적 캐시 구조를 가지는 멀티코어 프로세서

  • 기술번호 : KST2015090964
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 계층적 캐시 구조를 가지는 멀티코어 프로세서가 개시된다. 멀티코어 프로세서는 복수의 코어와, 복수의 코어 각각과 독립적으로 연결되는 복수의 제1 캐시와, 복수의 제1 캐시 중 적어도 하나의 제1 캐시와 각각 연결되는 적어도 하나의 2 캐시와, 복수의 코어 중 적어도 하나의 코어와 각각 연결되는 복수의 제3 캐시 및 복수의 제3 캐시 중 적어도 하나의 제3 캐시와 각각 연결되는 제4 캐시를 포함한다. 따라서, 각 코어간 통신 오버헤드를 감소시킬 수 있고, 데이터 수준 병렬화 처리를 지원함으로써 애플리케이션의 실행 속도를 향상시킬 수 있다.
Int. CL G06F 12/08 (2006.01) G06F 9/46 (2006.01) G06F 9/44 (2006.01)
CPC G06F 12/08(2013.01) G06F 12/08(2013.01) G06F 12/08(2013.01) G06F 12/08(2013.01) G06F 12/08(2013.01) G06F 12/08(2013.01) G06F 12/08(2013.01)
출원번호/일자 1020120143647 (2012.12.11)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2014-0075370 (2014.06.19) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.09.15)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이재진 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 특허법인이상 대한민국 서울특별시 서초구 바우뫼로 ***(양재동, 우도빌딩 *층)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.12.11 수리 (Accepted) 1-1-2012-1029144-19
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2015.09.15 수리 (Accepted) 1-1-2015-0897504-14
4 선행기술조사의뢰서
Request for Prior Art Search
2016.03.10 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2016.05.04 발송처리완료 (Completion of Transmission) 9-6-2016-0052331-20
6 의견제출통지서
Notification of reason for refusal
2016.05.09 발송처리완료 (Completion of Transmission) 9-5-2016-0332117-88
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.07.05 수리 (Accepted) 1-1-2016-0647907-93
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.07.05 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-0647913-67
9 거절결정서
Decision to Refuse a Patent
2016.11.28 발송처리완료 (Completion of Transmission) 9-5-2016-0854699-26
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.12.29 수리 (Accepted) 1-1-2016-1291299-59
11 [명세서등 보정]보정서(재심사)
Amendment to Description, etc(Reexamination)
2016.12.29 보정승인 (Acceptance of amendment) 1-1-2016-1291882-68
12 거절결정서
Decision to Refuse a Patent
2017.01.31 발송처리완료 (Completion of Transmission) 9-5-2017-0073983-71
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 코어;상기 복수의 코어 각각과 독립적으로 연결되는 복수의 제1 캐시;상기 복수의 제1 캐시 중 적어도 하나의 제1 캐시와 각각 연결되는 적어도 하나의 2 캐시;상기 복수의 코어 중 적어도 하나의 코어와 각각 연결되는 복수의 제3 캐시; 및상기 복수의 제3 캐시 중 적어도 하나의 제3 캐시와 각각 연결되는 제4 캐시를 포함하는 멀티코어 프로세서
2 2
청구항 1에 있어서, 상기 제1 및 제2 캐시는 상기 복수의 코어에 의해 실행되는 애플리케이션의 처리를 위한 명령어 및 데이터가 저장되고, 상기 제3 및 제4 캐시는 상기 복수의 코어가 애플리케이션을 실행할 때 공유하는 데이터가 저장되는 것을 특징으로 하는 멀티코어 프로세서
3 3
청구항 1에 있어서,상기 복수의 제3 캐시 각각은 처리 데이터를 서로 공유하는 적어도 두 개의 코어와 연결되는 것을 특징으로 하는 멀티코어 프로세서
4 4
청구항 1에 있어서,상기 복수의 제3 캐시 각각은 서로 인접한 두 코어간에 연결되는 것을 특징으로 하는 멀티코어 프로세서
5 5
청구항 1에 있어서, 상기 복수의 코어는 상기 제3 캐시 및 상기 제4 캐시 중 상기 제3 캐시를 우선적으로 사용하여 코어간 통신을 수행하는 것을 특징으로 하는 멀티코어 프로세서
6 6
청구항 1에 있어서, 상기 적어도 하나의 제2 캐시 및 상기 적어도 하나의 제4 캐시는 각각 서로 다른 버스를 통해 서로 다른 메모리와 연결되는 것을 특징으로 하는 멀티코어 프로세서
7 7
청구항 1에 있어서,상기 적어도 하나의 제4 캐시는 각각 서로 다른 개수의 제3 캐시와 연결되는 것을 특징으로 하는 멀티코어 프로세서
8 8
청구항 1에 있어서, 상기 적어도 하나의 제2 캐시 각각은 상기 복수의 코어 중 클러스터링된 코어들별로 각각 연결된 적어도 하나의 제1 캐시에 각각 연결되는 것을 특징으로 하는 멀티코어 프로세서
9 9
청구항 1에 있어서,상기 적어도 하나의 제4 캐시 각각은 상기 복수의 코어 중 클러스터링된 코어들별로 연결된 적어도 하나의 제3 캐시에 각각 연결되는 것을 특징으로 하는 멀티코어 프로세서
지정국 정보가 없습니다
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순번 패밀리번호 국가코드 국가명 종류
1 US20140164706 US 미국 FAMILY

DOCDB 패밀리 정보

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순번 패밀리번호 국가코드 국가명 종류
1 US2014164706 US 미국 DOCDBFAMILY
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순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국전자통신연구원 산업원천기술개발사업(ETRI지원사업) 다중코어 기반 고성능 SoC의 SW 에뮬레이션 및 Rapid Prototyping 기술 개발