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ＮＵＭＡ 시스템의 스케줄링 장치 및 그 방법

  • 기술번호 : KST2015114748
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 스케줄링 장치는 각각 프로세스를 실행하는 코어, 공용캐쉬 및 메모리를 포함하는 복수의 노드를 구비하고 코어별 메모리 접근 정보를 획득하는 NUMA 시스템; 상기 NUMA 시스템에서 획득된 상기 코어별 메모리 접근 정보에 따라 상기 NUMA 시스템의 현재 프로세스-코어 매핑 및 미래 프로세스-코어 매핑의 메모리 접근 성능을 평가하는 NUMA 시스템 평가유닛; 및 상기 NUMA 시스템 평가유닛의 평가 결과에 따라 상기 현재 프로세스-코어 매핑 및 상기 미래 프로세스-코어 매핑 중 하나의 프로세스-코어 매핑을 NUMA 시스템의 프로세스-코어 매핑으로 적용하는 프로세스 스케줄러를 포함한다.
Int. CL G06F 13/16 (2006.01) G06F 9/46 (2006.01)
CPC G06F 9/544(2013.01) G06F 9/544(2013.01)
출원번호/일자 1020130009094 (2013.01.28)
출원인 한국과학기술원
등록번호/일자 10-1480954-0000 (2015.01.05)
공개번호/일자 10-2014-0096511 (2014.08.06) 문서열기
공고번호/일자 (20150114) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2013.01.28)
심사청구항수 16

출원인

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 박규호 대한민국 대전 유성구
2 김철민 대한민국 대전 유성구

대리인

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번호 이름 국적 주소
1 김성호 대한민국 서울특별시 강남구 도곡로 *** (역삼동,미진빌딩 *층)(KNP 특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2013.01.28 수리 (Accepted) 1-1-2013-0078120-73
2 선행기술조사의뢰서
Request for Prior Art Search		 2013.10.07 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search		 2013.11.14 수리 (Accepted) 9-1-2013-0096967-92
4 의견제출통지서
Notification of reason for refusal		 2014.01.17 발송처리완료 (Completion of Transmission) 9-5-2014-0039439-54
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2014.03.17 수리 (Accepted) 1-1-2014-0252011-77
6 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment		 2014.03.24 수리 (Accepted) 1-1-2014-0278850-54
7 의견제출통지서
Notification of reason for refusal		 2014.07.08 발송처리완료 (Completion of Transmission) 9-5-2014-0466951-13
8 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment		 2014.09.11 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2014-0857760-13
9 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)		 2014.09.11 수리 (Accepted) 1-1-2014-0857759-77
10 등록결정서
Decision to grant		 2014.11.28 발송처리완료 (Completion of Transmission) 9-5-2014-0819634-35
11 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5157993-01
12 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5157968-69
13 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2014.12.24 수리 (Accepted) 4-1-2014-5158129-58
14 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2019.04.24 수리 (Accepted) 4-1-2019-5081392-49
15 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.05.15 수리 (Accepted) 4-1-2020-5108396-12
16 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2020.06.12 수리 (Accepted) 4-1-2020-5131486-63
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
각각 프로세스를 실행하는 코어, 공용캐쉬 및 메모리를 포함하는 복수의 노드를 구비하고 코어별 메모리 접근 정보를 획득하는 NUMA 시스템;상기 NUMA 시스템에서 획득된 상기 코어별 메모리 접근 정보에 따라 상기 NUMA 시스템의 현재 프로세스-코어 매핑 및 미래 프로세스-코어 매핑의 메모리 접근 성능을 평가하는 NUMA 시스템 평가유닛; 및상기 NUMA 시스템 평가유닛의 평가 결과에 따라 상기 현재 프로세스-코어 매핑 및 상기 미래 프로세스-코어 매핑 중 하나의 프로세스-코어 매핑을 상기 NUMA 시스템의 프로세스-코어 매핑으로 적용하는 프로세스 스케줄러를 포함하는,NUMA 시스템 스케줄링 장치
2 2
제1항에 있어서,상기 코어별 메모리 접근 정보는:상기 현재 프로세스-코어 매핑에 대한 정보, 프로세스별 프로세스 메모리의 위치정보 및 상기 코어별 상기 공용캐쉬로의 접근 횟수와 함께 상기 공용캐쉬에 대한 미스 횟수를 포함하며, 상기 코어별 메모리 접근 정보는 상기 프로세스 스케줄러를 통해 상기 NUMA 시스템 평가 유닛에 전달되는,NUMA 시스템 스케줄링 장치
3 3
제1항에 있어서, 상기 현재 프로세스-코어 매핑에 대한 상기 메모리 접근 성능 평가는:상기 현재 프로세스-코어 매핑에 따른 프로세스별 메모리 접근 레이턴시 계산 결과에 근거한 상기 NUMA 시스템에 대한 전체 메모리 접근 성능 평가와 상기 코어별 메모리 접근 공정성 평가 중 적어도 하나를 포함하는, NUMA 시스템 스케줄링 장치
4 4
제1항에 있어서, 상기 미래 프로세스-코어 매핑에 대한 상기 메모리 접근 성능 평가는:상기 미래 프로세스-코어 매핑에 따른 프로세스별 메모리 접근 레이턴시 계산에 근거한 상기 NUMA 시스템에 대한 전체 메모리 접근 성능 평가와 상기 코어별 메모리 접근 공정성 평가 중 적어도 하나를 포함하는,NUMA 시스템 스케줄링 장치
5 5
제4항에 있어서, 상기 미래 프로세스-코어 매핑에 대한 상기 메모리 접근 성능 평가전에 상기 NUMA 시스템 평가유닛은:상기 프로세스별 1000개의 인스트럭션당 발생하는 메모리 접근 요청의 개수를 획득하는 제1단계;상기 프로세스별 상기 공용캐쉬에 대한 접근 횟수를 계산하는 제2단계;1000개의 인스트럭션당 상기 공용캐쉬에 대한 캐쉬 미스의 횟수를 계산하는 제3단계; 및 상기 프로세스별 초당 상기 공용캐쉬에 대한 캐쉬 미스의 횟수를 계산하는 제4단계를 포함하는 전처리 과정을 수행하는, NUMA 시스템 스케줄링 장치
6 6
제1항 내지 제5항 중 어느 한 항에 있어서, 상기 미래 프로세스-코어 매핑은 복수의 미래 프로세스-코어 매핑을 포함하며, 상기 프로세스 스케줄러는 상기 복수의 미래 프로세스-코어 매핑과 상기 현재 프로세스-코어 매핑 중 가장 높은 성능 평가를 갖는 프로세스-코어 매핑을 상기 NUMA 시스템에 적용하는, NUMA 시스템 스케줄링 장치
7 7
삭제
8 8
제1항 내지 제5항 중 어느 한 항에 있어서,상기 프로세스 스케줄러는:상기 메모리 접근 레이턴시의 증가 요인 중 가장 큰 요인을 제거하는 과부하 제거 과정을 통해 상기 미래 프로세스-코어 매핑을 결정하는, NUMA 시스템 스케줄링 장치
9 9
제8항에 있어서, 상기 과부하 제거 과정은 상기 메모리 접근 레이턴시를 증가시키는 프로세스를 실행하는 코어의 위치 및 상기 메모리 접근 레이턴시를 증가시키는 프로세스의 메모리의 위치 중 적어도 어느 하나를 변경하는, NUMA 시스템 스케줄링 장치
10 10
각각 프로세스를 실행하는 코어, 공용캐쉬 및 메모리를 포함하는 복수의 노드를 구비하는 NUMA 시스템에서 코어별 메모리 접근 정보를 획득 단계;NUMA 시스템 평가유닛에서 상기 NUMA 시스템에서 획득된 상기 코어별 메모리 접근 정보에 따라 상기 NUMA 시스템의 현재 프로세스-코어 매핑 및 미래 프로세스-코어 매핑의 메모리 접근 성능을 평가하는 단계; 및상기 NUMA 시스템 평가유닛의 평가 결과에 따라 프로세스 스케줄러에서 상기 현재 프로세스-코어 매핑 및 상기 미래 프로세스-코어 매핑 중 하나의 프로세스-코어 매핑을 상기 NUMA 시스템의 프로세스-코어 매핑으로 적용하는 단계를 포함하는,NUMA 시스템 스케줄링 방법
11 11
제10항에 있어서,상기 코어별 메모리 접근 정보는:상기 현재 프로세스-코어 매핑에 대한 정보, 프로세스별 프로세스 메모리의 위치정보 및 상기 코어별 상기 공용캐쉬로의 접근 횟수와 함께 공용캐쉬에 대한 미스 횟수를 포함하며, 상기 코어별 메모리 접근 정보는 상기 프로세스 스케줄러를 통해 상기 NUMA 시스템 평가 유닛에 전달되는,NUMA 시스템 스케줄링 방법
12 12
제10항에 있어서, 상기 현재 프로세스-코어 매핑에 대한 상기 메모리 접근 성능을 평가하는 단계는:상기 현재 프로세스-코어 매핑에 따른 프로세스별 메모리 접근 레이턴시를 계산하여 상기 NUMA 시스템에 대한 전체 메모리 접근 성능과 상기 코어별 메모리 접근 공정성 중 적어도 하나를 평가하는 단계를 포함하는, NUMA 시스템 스케줄링 방법
13 13
제10항에 있어서, 상기 미래 프로세스-코어 매핑에 대한 상기 메모리 접근 성능을 평가하는 단계는:상기 미래 프로세스-코어 매핑에 따른 프로세스별 메모리 접근 레이턴시를 계산하여 상기 NUMA 시스템에 대한 전체 메모리 접근 성능과 상기 코어별 메모리 접근 공정성 중 적어도 하나를 평가하는 단계를 포함하는,NUMA 시스템 스케줄링 방법
14 14
제13항에 있어서, 상기 미래 프로세스-코어 매핑에 대한 상기 메모리 접근 성능 평가전에 상기 NUMA 시스템 평가유닛은:상기 프로세스별 1000개의 인스트럭션당 발생하는 메모리 접근 요청의 개수를 획득하는 제1단계;상기 프로세스별 상기 공용캐쉬에 대한 접근횟수를 계산하는 제2단계;1000개의 인스트럭션당 상기 공용캐쉬에 대한 캐쉬 미스의 횟수를 계산하는 제3단계; 및 상기 프로세스별 초당 상기 공용캐쉬에 대한 캐쉬 미스의 횟수를 계산하는 제4단계를 포함하는 전처리 과정을 수행하는, NUMA 시스템 스케줄링 방법
15 15
제10항 내지 제14항 중 어느 한 항에 있어서, 상기 미래 프로세스-코어 매핑은 복수의 미래 프로세스-코어 매핑을 포함하며, 상기 적용하는 단계에서 상기 프로세스 스케줄러는 상기 복수의 미래 프로세스-코어 매핑과 상기 현재 프로세스-코어 매핑 중 가장 높은 성능 평가를 갖는 프로세스-코어 매핑을 상기 NUMA 시스템에 적용하는, NUMA 시스템 스케줄링 방법
16 16
삭제
17 17
제10항 내지 제14항 중 어느 한 항에 있어서,상기 적용단계에서 상기 프로세스 스케줄러는 상기 메모리 접근 레이턴시의 증가 요인 중 가장 큰 요인을 제거하는 과부하 제거 과정을 통해 상기 미래 프로세스-코어 매핑을 결정하는 단계를 더 포함하는,NUMA 시스템 스케줄링 방법
18 18
제17항에 있어서, 상기 과부하 제거 과정은 상기 메모리 접근 레이턴시를 증가시키는 프로세스를 실행하는 코어의 위치 및 상기 메모리 접근 레이턴시를 증가시키는 프로세스의 메모리의 위치 중 적어도 어느 하나를 변경하는, NUMA 시스템 스케줄링 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 KAIST SW컴퓨팅산업원천기술개발사업(차세대컴퓨팅) 매니코어와 차세대 메모리 결합형 아키텍처의 자원관리 기술