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저온 공정을 사용한 실리콘 박막 트랜지스터의 제조방법

  • 기술번호 : KST2014030815
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 저온 화학기상증착 공정을 사용하여 n형 또는 p형 마이크로결정질 실리콘 박막을 기판에 증착한 후 패터닝을 통해 소스 전극 및 드레인 전극으로 형성하는 단계를 포함하는 실리콘 박막 트랜지스터의 제조 방법에 관한 것이다. 본 발명은 실리콘 박막 트랜지스터의 제조과정에서 소스 전극 및 드레인 전극 형성시 종래 기술에서 필수적으로 사용되어 왔던 도핑 공정과 레이저를 사용한 결정화 공정을 단순화하여 고가의 장비를 사용하지 않고 간단한 공정으로 실리콘 박막 트랜지스터를 제조하여 제조비용을 절감할 수 있으며, 저온 공정을 사용함으로써 플라스틱 기판을 사용하여 플렉시블 실리콘 박막 트랜지스터를 제조할 수 있다.
Int. CL H01L 29/786 (2006.01) G02F 1/136 (2006.01)
CPC H01L 29/66757(2013.01) H01L 29/66757(2013.01) H01L 29/66757(2013.01)
출원번호/일자 1020100091776 (2010.09.17)
출원인 성균관대학교산학협력단
등록번호/일자 10-1081479-0000 (2011.11.02)
공개번호/일자
공고번호/일자 (20111108) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.09.17)
심사청구항수 13

출원인

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구

발명자

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번호 이름 국적 주소
1 이준신 대한민국 서울특별시 서초구
2 정호균 대한민국 경기도 용인시 수지구
3 정성욱 대한민국 경기 수원시 권선구
4 장경수 대한민국 서울 서대문구
5 이원백 대한민국 서울특별시 성북구
6 백일호 대한민국 대전광역시 서구

대리인

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번호 이름 국적 주소
1 특허법인다울 대한민국 서울 강남구 봉은사로 ***, ***호(역삼동, 혜전빌딩)

최종권리자

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번호 이름 국적 주소
1 성균관대학교산학협력단 대한민국 경기도 수원시 장안구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.09.17 수리 (Accepted) 1-1-2010-0608456-26
2 선행기술조사의뢰서
Request for Prior Art Search
2011.09.09 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2011.10.18 수리 (Accepted) 9-1-2011-0082235-48
4 등록결정서
Decision to grant
2011.10.27 발송처리완료 (Completion of Transmission) 9-5-2011-0626406-57
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.04.26 수리 (Accepted) 4-1-2012-5090770-53
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.06.20 수리 (Accepted) 4-1-2012-5131828-19
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.06.27 수리 (Accepted) 4-1-2012-5137236-29
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2017.02.23 수리 (Accepted) 4-1-2017-5028829-43
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기판 상에 버퍼층을 형성하는 단계(단계 1);상기 버퍼층 상에 n형 또는 p형 마이크로 크리스탈 실리콘 박막을 증착하는 단계(단계 2);상기 n형 또는 p형 마이크로 크리스탈 실리콘 박막을 패터닝하여 소스 전극 또는 드레인 전극을 형성하는 단계(단계 3);상기 소스 전극 또는 드레인 전극 상에 활성층을 형성하는 단계(단계 4);상기 활성층 상에 절연막과 금속 전극을 형성하는 단계(단계 5); 및상기 단계 4 및 단계 5를 거쳐 기판 상에 형성된 활성층, 절연막 및 금속 전극을 패터닝하여 게이트 전극을 형성하는 단계(단계 6)를 포함하며,상기 단계 2에서 n형 또는 p형 마이크로 크리스탈 실리콘 박막은 저온 화학기상증착 공정을 사용하여 형성되는 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
2 2
청구항 1에 있어서,상기 저온 화학기상증착 공정의 온도는 200℃ 이하인 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
3 3
청구항 2에 있어서,상기 저온 화학기상증착 공정의 온도는 150∼180℃인 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
4 4
청구항 1에 있어서,상기 n형 저온 마이크로 크리스탈 실리콘 박막은 저온 화학기상증착 공정에서 SiH4 : H2 : PH3의 가스비가 1 : 170~200 : 0
5 5
청구항 1에 있어서,상기 p형 저온 마이크로 크리스탈 실리콘 박막은 저온 화학기상증착 공정에서 SiH4 : H2 : B2H6의 가스비가 1 : 170~200 : 0
6 6
청구항 1에 있어서,상기 저온 화학기상증착 공정은 0
7 7
청구항 6에 있어서,상기 저온 화학기상증착 공정은 1∼2 Torr의 압력 하에서 수행되는 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
8 8
청구항 1에 있어서,상기 저온 화학기상증착 공정은 25∼125W의 전력을 인가하여 수행되는 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
9 9
청구항 8에 있어서,상기 저온 화학기상증착 공정은 50∼100W의 전력을 인가하여 수행되는 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
10 10
청구항 1에 있어서,상기 버퍼층은 실리콘 질화막 또는 실리콘 산화막인 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
11 11
청구항 1에 있어서,상기 활성층은 다결정 실리콘 박막, 비정질 실리콘 박막 또는 마이크로결정질 실리콘 박막인 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
12 12
청구항 1에 있어서,상기 기판은 폴리이미드(PI), 폴리에틸렌나프탈레이트(PEN), 폴리에스터(PET), 폴리카보나이트(PC) 및 폴리설폰(PES)으로 이루어진 군으로부터 선택된 재질을 사용하여 제조된 플라스틱 기판인 것을 특징으로 하는 저온 공정을 사용하는 실리콘 박막 트랜지스터의 제조방법
13 13
청구항 1 내지 청구항 12 중 어느 한 항의 제조방법에 따라 제조된 실리콘 박막 트랜지스터
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.