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패스트 락킹 기법을 사용한 위상고정루프 회로 및 그 방법

  • 기술번호 : KST2015172966
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 패스트 락킹 기법을 사용한 위상고정루프 회로 및 그 방법에 대한 것으로서, 보다 상세하게는 미리 메모리의 값을 저장되게 하고, 이를 다시 로딩하여 락타임을 감소시킬 수 있는 패스트 락킹 기법을 사용한 위상고정루프 회로 및 그 방법에 관한 것이다.본 발명은 위상고정루프 회로에 있어서, 콘트롤 전압(Vctrl) 값을 저장하는 제1메모리와, 전압조정발진기의 출력신호(FVCO)를 조절하는 출력 디지털 값을 저장하는 제2메모리와, 초기 위상고정루프 회로의 피드백(Feedback) 동작으로 상기 콘트롤 전압(Vctrl)이 일정 전압 값으로 수렴하면서 락(Lock)이 된 후, 상기 콘트롤 전압(Vctrl) 값을 디지털화하여, 상기 제1메모리에 저장되도록 하는 아날로그-디지털 컨버터(Analog- to-Digital Converter; ADC)와, 상기 디지털화된 상기 콘트롤 전압(Vctrl) 값을 아날로그 값으로 변환시키는 디지털-아날로그 컨버터(Digital- to-Analog Converter; DAC)와, 입력에 인가되는 전압을 통해 발진 주파수가 변화하는 전압조정발진기(VCO)와, 상기 전압조정발진기의 출력신호(FVCO)를 조절하는 출력 디지털 값이 상기 제2메모리에 저장되도록 하는 동조 컨트롤러(Coarse Tuning Controller; CTC)와, 상기 위상고정루프 회로의 락킹(Locking) 조건을 초기에 제공하여 락타임(Lock Time)을 감소시키도록 하는 패스트 락킹 컨트롤러(Fast Locking Controller)로 구성되는 것을 특징으로 한다.
Int. CL H03L 7/093 (2006.01) H03L 7/099 (2006.01)
CPC H03L 7/0805(2013.01) H03L 7/0805(2013.01) H03L 7/0805(2013.01) H03L 7/0805(2013.01)
출원번호/일자 1020100122785 (2010.12.03)
출원인 건국대학교 산학협력단
등록번호/일자 10-1300829-0000 (2013.08.21)
공개번호/일자 10-2012-0061459 (2012.06.13) 문서열기
공고번호/일자 (20130829) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.12.03)
심사청구항수 1

출원인

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번호 이름 국적 주소
1 건국대학교 산학협력단 대한민국 서울특별시 광진구

발명자

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번호 이름 국적 주소
1 이강윤 대한민국 서울특별시 광진구
2 부영건 대한민국 제주특별자치도 제주
3 박안수 대한민국 서울특별시 광진구
4 박준성 대한민국 서울특별시 강동구

대리인

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번호 이름 국적 주소
1 특허법인 수 대한민국 서울특별시 강남구 강남대로**길 **, *층(역삼동, 케이앤와이빌딩)

최종권리자

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번호 이름 국적 주소
1 건국대학교 산학협력단 서울특별시 광진구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.12.03 수리 (Accepted) 1-1-2010-0798848-76
2 선행기술조사의뢰서
Request for Prior Art Search
2012.05.14 수리 (Accepted) 9-1-9999-9999999-89
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2012.06.01 수리 (Accepted) 4-1-2012-5116974-69
4 선행기술조사보고서
Report of Prior Art Search
2012.06.21 수리 (Accepted) 9-1-2012-0048032-24
5 의견제출통지서
Notification of reason for refusal
2012.07.06 발송처리완료 (Completion of Transmission) 9-5-2012-0391925-20
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2012.08.28 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-0693010-28
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2012.08.28 수리 (Accepted) 1-1-2012-0693019-38
8 의견제출통지서
Notification of reason for refusal
2013.01.08 발송처리완료 (Completion of Transmission) 9-5-2013-0015947-40
9 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2013.02.27 불수리 (Non-acceptance) 1-1-2013-0173988-26
10 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2013.03.06 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2013-0197626-76
11 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2013.03.06 수리 (Accepted) 1-1-2013-0197627-11
12 서류반려이유통지서
Notice of Reason for Return of Document
2013.03.11 발송처리완료 (Completion of Transmission) 1-5-2013-0025843-26
13 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2013.03.12 수리 (Accepted) 1-1-2013-0213966-50
14 서류반려통지서
Notice for Return of Document
2013.03.22 발송처리완료 (Completion of Transmission) 1-5-2013-0031121-77
15 등록결정서
Decision to grant
2013.08.19 발송처리완료 (Completion of Transmission) 9-5-2013-0567224-06
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
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위상고정루프 회로에 있어서,콘트롤 전압(Vctrl) 값을 저장하는 제1메모리와;전압조정발진기의 출력신호(FVCO)를 조절하는 출력 디지털 값을 저장하는 제2메모리와;초기 위상고정루프 회로의 피드백(Feedback) 동작으로 상기 콘트롤 전압(Vctrl)이 일정 전압 값으로 수렴하면서 락(Lock)이 된 후, 상기 콘트롤 전압(Vctrl) 값을 디지털화하여, 상기 제1메모리에 저장되도록 하는 아날로그-디지털 컨버터(Analog- to-Digital Converter; ADC)와;상기 디지털화된 상기 콘트롤 전압(Vctrl) 값을 아날로그 값으로 변환시키는 디지털-아날로그 컨버터(Digital- to-Analog Converter; DAC)와;입력에 인가되는 전압을 통해 발진 주파수가 변화하는 전압조정발진기(VCO)와;상기 전압조정발진기의 출력신호(FVCO)를 조절하는 출력 디지털 값이 상기 제2메모리에 저장되도록 하는 동조 컨트롤러(Coarse Tuning Controller; CTC)와;상기 위상고정루프 회로의 락킹(Locking) 조건을 초기에 제공하여 락타임(Lock Time)을 감소시키도록 하는 패스트 락킹 컨트롤러(Fast Locking Controller);로 구성되고,상기 위상고정루프 회로가 파워 오프(Power Off) 후 온(On)이 될 경우, 상기 제1메모리와 제2메모리의 값을 로딩(Loading)하여 상기 위상고정루프 회로의 락킹(Locking) 조건을 초기에 제공하여 락타임(Lock Time)을 감소시키는 것을 특징으로 하는 패스트 락킹 기법을 사용한 위상고정루프 회로
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1 지식경제부 건국대학교 산학협력단 산업원천기술개발사업 대용량 MLC SSD 핵심기술개발