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반도체 제어 정류기를 이용한 정전기 방전 보호 회로

  • 기술번호 : KST2015080646
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 반도체 집적회로(Integrated Circuit)에 적용되는 반도체 제어 정류기(Silicon Controlled Rectifier; SCR)를 이용한 정전기 방전(Electro-static discharge; ESD) 보호 회로에 관한 것으로, 3중 웰 구조의 반도체 기판을 사용하여 ggNMOS 소자의 기판에 해당하는 p웰에 바이어스를 인가할 수 있도록 함으로써 반도체 제어 정류기의 트리거 전압이 종래보다 감소될 수 있으며, PNP 및 NPN 바이폴라 트랜지스터로 구성되는 두 개의 반도체 제어 정류기를 통해 방전 경로가 형성되도록 함으로써 방전 용량이 증대될 수 있다.정전기 방전(ESD), 보호 회로, 반도체 제어 정류기(SCR), 트리거 전압, RC 네트워크
Int. CL H01L 29/00 (2006.01) H01L 29/78 (2006.01)
CPC H01L 27/0259(2013.01) H01L 27/0259(2013.01) H01L 27/0259(2013.01)
출원번호/일자 1020050037956 (2005.05.06)
출원인 한국전자통신연구원
등록번호/일자 10-0627134-0000 (2006.09.15)
공개번호/일자 10-2006-0067100 (2006.06.19) 문서열기
공고번호/일자 (20060925) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020040105736   |   2004.12.14
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.05.06)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김귀동 대한민국 대전 대덕구
2 권종기 대한민국 대전 서구
3 김종대 대한민국 대전 서구

대리인

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번호 이름 국적 주소
1 신영무 대한민국 서울특별시 강남구 영동대로 ***(대치동) KT&G타워 *층(에스앤엘파트너스)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2005.05.06 수리 (Accepted) 1-1-2005-0238801-90
2 선행기술조사의뢰서
Request for Prior Art Search
2006.05.11 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.06.13 수리 (Accepted) 9-1-2006-0037429-92
4 의견제출통지서
Notification of reason for refusal
2006.06.14 발송처리완료 (Completion of Transmission) 9-5-2006-0337884-94
5 명세서등보정서
Amendment to Description, etc.
2006.08.08 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0565722-07
6 의견서
Written Opinion
2006.08.08 수리 (Accepted) 1-1-2006-0565727-24
7 등록결정서
Decision to grant
2006.09.14 발송처리완료 (Completion of Transmission) 9-5-2006-0534660-95
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
반도체 기판 상에 형성된 제1 웰;상기 제1 웰에 형성되는 복수의 제2 웰 -상기 각 제2 웰은 n웰 또는 p웰 중 하나이며, 상기 제2 웰은 상기 n웰과 상기 p웰이 교대로 형성됨-;서로 다른 이온이 주입되며 상기 제2 웰 각각에 교대로 형성된 제1 및 제2 고농도 이온 주입영역 -상기 제1 및 제2 고농도 이온 주입 영역 각각에는 n형 이온 또는 p형 이온 중 하나가 주입됨- ;상기 제2 웰 사이의 각 계면에 형성된 고농도 계면 이온 주입 영역;상기 각 계면에 형성된 상기 고농도 계면 이온 주입 영역과 상기 제1 또는 제2 고농도 이온 주입 영역 사이의 상기 반도체 기판 상에 형성되며, 게이트 절연막에 의해 상기 반도체 기판과 절연되는 제1 및 제2 게이트를 포함하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
2 2
제 1 항에 있어서, 상기 제2 웰 중 상기 p웰에 바이어스 전압을 인가하기 위해, 상기 제 1 및 제 2 게이트와 상기 제2 고농도 이온 주입영역에 접속되는 RC 네트워크를 더 포함하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
3 3
제2 항에 있어서, 상기 제1 웰, 상기 제1 고농도 이온주입영역 및 상기 고농도 계면 이온 주입 영역에는 n형 이온이 주입되며, 상기 제2 고농도 이온 주입 영역에는 p형 이온이 주입되는 것을 특징으로 하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
4 4
삭제
5 5
제 1 항에 있어서, 상기 제2 웰 중 상기 n웰 상에 형성된 상기 제1 및 제2 고농도 이온주입영역과 상기 고농도 계면 이온주입 영역은 입출력 패드에 연결되며, 상기 제2 웰 중 상기 p웰 상에 형성된 상기 제1 및 제2 고농도 이온주입 영역은 접지에 연결되는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
6 6
애노드 및 캐소드 사이에 병렬 접속된 제 1 및 제 2 트랜지스터(N21,N22),상기 제 1 및 제 2 트랜지스터(N21,N22)의 게이트에 접속된 제 1 저항(R24),상기 제1 및 제2 트랜지스터(N21,N22)가 접속된 상기 애노드에 병렬 접속된 제 2 및 제 3 저항(R21,R23),상기 제 1 저항(R24)에 에미터가 접속되고, 상기 제 2 및 제 3 저항(R21,R23)에 베이스가 접속된 제 3 트랜지스터(Q25),상기 제 3 트랜지스터(Q25)의 콜렉터 및 접지 사이에 접속된 제 4 저항(R22),상기 캐소드 및 상기 제 3 트랜지스터(Q25)의 베이스 사이에 병렬 접속되며, 각각의 베이스가 상기 제 3 트랜지스터(Q25)의 에미터에 접속된 제 4 및 제 5 트랜지스터(Q22,Q24),상기 애노드 및 상기 제 3 트랜지스터(Q25)의 에미터 간에 병렬 접속되며, 각각의 게이트가 상기 제 3 트랜지스터(Q25)의 베이스에 접속된 제 6 및 제 7 트랜지스터(Q21,Q23)를 포함하는 것을 특징으로 하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
7 7
제 6 항에 있어서, 상기 애노드는 입출력 패드에 연결되고, 상기 캐소드는 접지에 연결된 것을 특징으로 하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
8 8
제 6 항에 있어서, 상기 제 1 및 제 2 트랜지스터(N21,N22)는 NMOS 트랜지스터이고, 상기 제 3 , 6 및 7 트랜지스터(Q21, Q23, Q25)는 PNP 바이폴라 트랜지스터이며, 상기 제 4 및 제 5 트랜지스터(Q22, Q24)는 NPN 바이폴라 트랜지스터인 것을 특징으로 하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
9 9
제 6 항에 있어서, 상기 제 1 및 제 2 트랜지스터(N21,N22)의 게이트에 RC 네트워크가 접속된 것을 특징으로 하는 반도체 제어 정류기를 이용한 정전기 방전 보호 회로
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