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독립적 및 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계 효과 트랜지스터 및 그 제조 방법

  • 기술번호 : KST2015118056
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 대칭적인 이중 게이트 구조를 가지는 전자-정공 이중층 터널 전계효과 트랜지스터 및 상기 트랜지스터의 제조방법에 관한 것으로,이중 게이트 p-i-n구조 및 밴드간 터널링을 이용한 것으로서 문턱전압 이하에서의 기울기의 개선과 동작 전류의 증가를 가져올 수 있고, 대칭구조의 게이트를 제안함으로써 실제 구현가능한 대칭적인 이중 게이트 구조를 가지는 전자-정공 이중층 터널 전계효과 트랜지스터 및 상기 트랜지스터의 제조방법에 관한 것이다.
Int. CL H01L 29/78 (2006.01) H01L 21/336 (2006.01)
CPC H01L 29/7855(2013.01) H01L 29/7855(2013.01)
출원번호/일자 1020120143844 (2012.12.11)
출원인 한국과학기술원
등록번호/일자 10-1402697-0000 (2014.05.27)
공개번호/일자
공고번호/일자 (20140603) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2012.12.11)
심사청구항수 10

출원인

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이석희 대한민국 대전 서구
2 김태균 대한민국 대전 유성구
3 문정민 대한민국 서울 동대문구
4 정우진 대한민국 서울 서대문구

대리인

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번호 이름 국적 주소
1 한상수 대한민국 서울시 서초구 효령로**길 ** *층 (브릿지웰빌딩)(에이치앤피국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 한국과학기술원 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.12.11 수리 (Accepted) 1-1-2012-1030202-05
2 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2012.12.21 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2012-1063541-29
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.02.01 수리 (Accepted) 4-1-2013-5019983-17
4 선행기술조사의뢰서
Request for Prior Art Search
2013.10.07 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2013.11.14 수리 (Accepted) 9-1-2013-0096569-23
6 의견제출통지서
Notification of reason for refusal
2013.11.26 발송처리완료 (Completion of Transmission) 9-5-2013-0820444-57
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2014.01.02 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2014-0002104-73
8 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2014.01.02 수리 (Accepted) 1-1-2014-0002120-04
9 [지정기간단축]기간연장(단축, 경과구제)신청서
[Reduction of Designated Period] Request for Extension of Period (Reduction, Expiry Reconsideration)
2014.01.02 수리 (Accepted) 1-1-2014-0002204-30
10 최후의견제출통지서
Notification of reason for final refusal
2014.02.18 발송처리완료 (Completion of Transmission) 9-5-2014-0117013-26
11 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2014.04.18 보정승인 (Acceptance of amendment) 1-1-2014-0373714-15
12 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2014.04.18 수리 (Accepted) 1-1-2014-0373709-86
13 등록결정서
Decision to grant
2014.05.27 발송처리완료 (Completion of Transmission) 9-5-2014-0362345-59
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5158129-58
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157993-01
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157968-69
17 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.04.24 수리 (Accepted) 4-1-2019-5081392-49
18 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.15 수리 (Accepted) 4-1-2020-5108396-12
19 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.12 수리 (Accepted) 4-1-2020-5131486-63
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법에 있어서,(i) 기판을 준비하는 단계;(ii) 하부 산화물층을 증착하는 단계;(iii) Si층을 증착하는 단계;(iv) 포토리소그라피(Photolithography) 공정을 이용하여 상방으로 돌출된 실리콘 핀(Si-fin)을 형성하는 단계;(v) 상기 실리콘 핀(Si-fin)의 표면을 산화시켜 게이트 산화물층을 형성하는 단계;(vi) 상기 실리콘 핀(Si-fin)의 게이트 영역에 게이트 전극을 증착하는 단계;(vii) 상기 실리콘 핀(Si-fin)에서 소스 영역과 드레인 영역이 형성되는 부위의 게이트 산화물층을 제거하는 단계;(viii) 소스 마스크를 이용하여 소스 영역에 P형 불순물을 주입하는 단계;(ix) 드레인 마스크를 이용하여 드레인 영역에 N형 불순물을 주입하는 단계;(x) 이중 게이트가 형성되도록, 상기 실리콘 핀(Si-fin) 위에 형성된 게이트 전극 및 게이트 산화물층을 기판에 수평인 절단면에 의해 제거하는 단계;를 포함하여 이루어지는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
2 2
제 1항에 있어서,상기 (i)단계의 기판은 Si 기판, Si-Ge 기판, Ⅲ-Ⅴ족 화합물 반도체 기판 중 어느 하나로 이루어진 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
3 3
제 1항에 있어서,상기 (v) 단계의 게이트 산화물층은,SiO2, Si3N4, Al2O3, HfO2 그리고 ZrO2 중 적어도 어느 하나를 포함하는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
4 4
제 1항에 있어서,상기 (vi) 단계에서 게이트 전극의 재질은 불순물이 주입된 폴리실리콘 또는 금속물질 중 적어도 어느 하나를 포함하는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
5 5
제 4항에 있어서,상기 금속물질은 몰리브덴(Mo), 니켈(Ni), 백금(Pt), 산화 루테늄(RuO2), 티타늄(Ti), 질화티타늄(TiN), 탄탈룸(Ta), 질화탄탈룸(TaN) 중 적어도 어느 하나를 포함하여 이루어지는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
6 6
제 4항에 있어서,상기 불순물은 비소(As), 인(P), 비스무스(Bi), 안티몬(Sb) 중 적어도 어느 하나를 포함하여 구성되는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
7 7
제 1항에 있어서,상기 (vii) 단계의 게이트 산화물층의 제거는 HF를 이용하여 습식식각하는 공정으로 이루어지는 것을 특징으로 하는대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
8 8
제 1항에 있어서,상기 (viii) 단계의 P형 불순물은 알루미늄(Al), 붕소(B), 인듐(In), 갈륨(Ga) 중 적어도 어느 하나를 포함하고,주입량은 1X1018 atom/cm3 ~ 5X1020 atom/cm3인 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
9 9
제 1항에 있어서,상기 (ix) 단계의 N형 불순물은 비소(As), 인(P), 비스무스(Bi), 안티몬(Sb) 중 적어도 어느 하나를 포함하고,주입량은 1X1018 atom/cm3 ~ 5X1020 atom/cm3인 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
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제 1항에 있어서,상기 (x) 단계의 게이트 전극 및 게이트 산화물층의 제거는 CMP(Chemical Mechanical Polishing) 공정을 포함하여 이루어지는 것을 특징으로 하는 대칭적인 이중 게이트 구조를 이용한 전자-정공 이중층 터널 전계효과 트랜지스터의 제조방법
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1 지식경제부 삼성전자 지식경제 기술혁신사업 [산업융합원천기술개발사업] 22nm급 이하 파운드리 소자 및 PDK 기술 개발