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양자 회로 T-깊이 감소 방법 및 장치

  • 기술번호 : KST2023001942
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 양자 회로 T-깊이 감소 방법 및 장치가 개시된다. 본 개시의 일 실시예에 따른 양자 회로 T-깊이 감소 방법은, 두 개의 토폴리 게이트(Toffoli gate)와 상기 두 개의 토폴리 게이트 사이에 제1 양자 회로를 포함하는 양자 회로를 수신하는 단계; 상기 양자 회로에 제1 통제 P 게이트와 제2 통제 P 게이트의 쌍을 추가하는 단계; 및 상기 제1 양자 회로가 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 사이에 배치되도록 상기 제1 양자 회로와 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 중 어느 하나의 통제 P 게이트의 자리를 교환하는 단계를 포함한다.
Int. CL G06N 10/20 (2022.01.01) B82Y 10/00 (2017.01.01)
CPC G06N 10/20(2013.01) B82Y 10/00(2013.01)
출원번호/일자 1020220039170 (2022.03.29)
출원인 한국전자통신연구원
등록번호/일자
공개번호/일자 10-2023-0076072 (2023.05.31) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020210162765   |   2021.11.23
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2022.09.23)
심사청구항수 20

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 이종헌 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 특허법인아주 대한민국 서울특별시 강남구 강남대로 ***, **,**층(역삼동, 동희빌딩)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2022.03.29 수리 (Accepted) 1-1-2022-0339846-12
2 [심사청구]심사청구서·우선심사신청서
2022.09.23 수리 (Accepted) 1-1-2022-1001873-86
3 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2022.10.29 1-1-2022-1147600-18
4 [반환신청]서류 반려요청서·반환신청서
2022.10.29 수리 (Accepted) 1-1-2022-1147633-14
5 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2022.10.29 수리 (Accepted) 1-1-2022-1147635-16
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
두 개의 토폴리 게이트(Toffoli gate)와 상기 두 개의 토폴리 게이트 사이에 제1 양자 회로를 포함하는 양자 회로를 수신하는 단계;상기 양자 회로에 제1 통제 P 게이트와 제2 통제 P 게이트의 쌍을 추가하는 단계; 및상기 제1 양자 회로가 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 사이에 배치되도록 상기 제1 양자 회로와 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 중 어느 하나의 통제 P 게이트의 자리를 교환하는 단계를 포함하는, 양자 회로 T-깊이 감소 방법
2 2
제1항에 있어서,상기 양자 회로 T-깊이 감소 방법은,상기 제1 양자 회로와 통제 P 게이트의 자리 교환 가능 여부를 판별하는 단계를 더 포함하고, 상기 어느 하나의 통제 P 게이트의 자리를 교환하는 단계는,상기 제1 양자 회로와 상기 통제 P 게이트의 자리 교환이 가능한 경우, 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리를 교환하는, 양자 회로 T-깊이 감소 방법
3 3
제2항에 있어서,상기 자리 교환 가능 여부를 판별하는 단계는, 상기 어느 하나의 통제 P 게이트와 상기 제1 양자 회로를 통과할 때의 위상과 상기 어느 하나의 통제 P 게이트와 상기 제1 양자 회로의 자리를 교환한 후 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트를 통과할 때의 위상이 동일한 경우 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리 교환이 가능한 것으로 판별하는, 양자 회로 T-깊이 감소 방법
4 4
제2항에 있어서,상기 자리 교환 가능 여부를 판별하는 단계는, 상기 제1 양자 회로의 X 게이트, H 게이트와 Rz 게이트를 제거하는 단계; 및상기 X 게이트, H 게이트와 Rz 게이트가 제거된 제1 양자 회로의 통제 NOT 게이트의 통제 부분이 상기 어느 하나의 통제 P 게이트의 두 선 중 어느 한 선에 위치하고 타겟 부분이 다른 세번째 선에 위치하는 경우, 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리 교환이 가능한 것으로 판별하는 단계를 포함하는, 양자 회로 T-깊이 감소 방법
5 5
제4항에 있어서,상기 제거하는 단계는,상기 제1 양자 회로에서 X 게이트 전파를 통해 X 게이트를 제거한 후, 상기 어느 하나의 통제 P 게이트의 두 선에 위치한 H 게이트를 모두 제거하고, 상기 제1 양자 회로에 존재하는 모든 Rz 게이트를 제거하는, 양자 회로 T-깊이 감소 방법
6 6
제1항에 있어서,상기 양자 회로 T-깊이 감소 방법은, 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리가 교환되면, 상기 제1 양자 회로를 상기 제1 양자 회로의 기능에 대응하는 제2 양자 회로로 변환하는 단계를 더 포함하는, 양자 회로 T-깊이 감소 방법
7 7
제1항에 있어서,상기 추가하는 단계는,상기 토폴리 게이트의 통제 부분과 타겟 부분을 고려하여 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트의 쌍을 추가하는, 양자 회로 T-깊이 감소 방법
8 8
제1항에 있어서,상기 추가하는 단계는,상기 양자 회로에 통제 P 게이트와 통제 P† 게이트를 추가하는, 양자 회로 T-깊이 감소 방법
9 9
두 개의 토폴리 게이트(Toffoli gate)와 상기 두 개의 토폴리 게이트 사이에 제1 양자 회로를 포함하는 양자 회로에 통제 P 게이트와 통제 P† 게이트의 쌍을 추가하는 단계;상기 제1 양자 회로와 상기 통제 P 게이트와 통제 P† 게이트 중 어느 하나의 게이트의 자리 교환 가능 여부를 판별하는 단계; 및상기 제1 양자 회로와 상기 어느 하나의 게이트의 자리 교환이 가능한 경우, 상기 제1 양자 회로와 상기 어느 하나의 게이트의 자리를 교환하는 단계를 포함하는, 양자 회로 T-깊이 감소 방법
10 10
제9항에 있어서,상기 자리 교환 가능 여부를 판별하는 단계는, 상기 제1 양자 회로의 X 게이트, H 게이트와 Rz 게이트를 제거하는 단계; 및상기 X 게이트, H 게이트와 Rz 게이트가 제거된 제1 양자 회로의 통제 NOT 게이트의 통제 부분이 상기 어느 하나의 게이트의 두 선 중 어느 한 선에 위치하고 타겟 부분이 다른 세번째 선에 위치하는 경우, 상기 제1 양자 회로와 상기 어느 하나의 게이트의 자리 교환이 가능한 것으로 판별하는 단계를 포함하는, 양자 회로 T-깊이 감소 방법
11 11
제10항에 있어서,상기 제거하는 단계는,상기 제1 양자 회로에서 X 게이트 전파를 통해 X 게이트를 제거한 후, 상기 어느 하나의 게이트의 두 선에 위치한 H 게이트를 모두 제거하고, 상기 제1 양자 회로에 존재하는 모든 Rz 게이트를 제거하는, 양자 회로 T-깊이 감소 방법
12 12
제9항에 있어서,상기 양자 회로 T-깊이 감소 방법은, 상기 제1 양자 회로와 상기 어느 하나의 게이트의 자리가 교환되면, 상기 제1 양자 회로를 상기 제1 양자 회로의 기능에 대응하는 제2 양자 회로로 변환하는 단계를 더 포함하는, 양자 회로 T-깊이 감소 방법
13 13
두 개의 토폴리 게이트(Toffoli gate)와 상기 두 개의 토폴리 게이트 사이에 제1 양자 회로를 포함하는 양자 회로를 수신하는 수신부;상기 양자 회로에 제1 통제 P 게이트와 제2 통제 P 게이트의 쌍을 추가하는 추가부; 및상기 제1 양자 회로가 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 사이에 배치되도록 상기 제1 양자 회로와 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트 중 어느 하나의 통제 P 게이트의 자리를 교환하는 교환부를 포함하는, 양자 회로 T-깊이 감소 장치
14 14
제13항에 있어서,상기 양자 회로 T-깊이 감소 장치는,상기 제1 양자 회로와 통제 P 게이트의 자리 교환 가능 여부를 판별하는 판별부를 더 포함하고, 상기 추가부는,상기 제1 양자 회로와 상기 통제 P 게이트의 자리 교환이 가능한 경우, 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트의 쌍을 추가하는, 양자 회로 T-깊이 감소 장치
15 15
제14항에 있어서,상기 판별부는,상기 어느 하나의 통제 P 게이트와 상기 제1 양자 회로를 통과할 때의 위상과 상기 어느 하나의 통제 P 게이트와 상기 제1 양자 회로의 자리를 교환한 후 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트를 통과할 때의 위상이 동일한 경우 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리 교환이 가능한 것으로 판별하는, 양자 회로 T-깊이 감소 장치
16 16
제14항에 있어서,상기 판별부는,상기 제1 양자 회로의 X 게이트, H 게이트와 Rz 게이트를 제거하고, 상기 X 게이트, H 게이트와 Rz 게이트가 제거된 제1 양자 회로의 통제 NOT 게이트의 통제 부분이 상기 어느 하나의 통제 P 게이트의 두 선 중 어느 한 선에 위치하고 타겟 부분이 다른 세번째 선에 위치하는 경우, 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리 교환이 가능한 것으로 판별하는, 양자 회로 T-깊이 감소 장치
17 17
제16항에 있어서,상기 판별부는,상기 제1 양자 회로에서 X 게이트 전파를 통해 X 게이트를 제거한 후, 상기 어느 하나의 통제 P 게이트의 두 선에 위치한 H 게이트를 모두 제거하고, 상기 제1 양자 회로에 존재하는 모든 Rz 게이트를 제거하는, 양자 회로 T-깊이 감소 장치
18 18
제3항에 있어서,상기 양자 회로 T-깊이 감소 장치는, 상기 제1 양자 회로와 상기 어느 하나의 통제 P 게이트의 자리가 교환되면, 상기 제1 양자 회로를 상기 제1 양자 회로의 기능에 대응하는 제2 양자 회로로 변환하는 변환부를 더 포함하는, 양자 회로 T-깊이 감소 장치
19 19
제13항에 있어서,상기 추가부는,상기 토폴리 게이트의 통제 부분과 타겟 부분을 고려하여 상기 제1 통제 P 게이트와 상기 제2 통제 P 게이트의 쌍을 추가하는, 양자 회로 T-깊이 감소 장치
20 20
제13항에 있어서,상기 추가부는,상기 양자 회로에 통제 P 게이트와 통제 P† 게이트를 추가하는, 양자 회로 T-깊이 감소 장치
지정국 정보가 없습니다
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1 과학기술정보통신부 ETRI 정보통신방송연구개발사업(정보보호핵심원천기술개발사업) 미래컴퓨팅 환경에 대비한 계산 복잡도 기반 암호 안전성 검증 기술개발