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소정 영역의 메모리 셀 어레이 내 개별 셀에 라이트할 오버드라이브 전류의 높이 조절용 데이터와 오버드라이브 전류의 폭 조절용 데이터를 이용하여 순간 하강 전압을 발생시키는 순간 하강 전압 생성부;상기 순간 하강 전압을 이용하여 상기 오버드라이브 전류를 포함하는 스파이크 전류를 출력하는 전류 D/A 변환부;테스트 셀 어레이 내 개별 셀에 인가되는 스파이크 전류에 따른 충전 전압을 소정의 기준치와 비교하여 출력하는 셀 전압 검출부;상기 셀 전압 검출부로부터 출력되는 신호를 이용하여 오버드라이브 전류의 높이와 폭을 보정하는 보정 제어부; 및상기 보정 제어부로부터 출력되는 개별 셀에 대한 오버드라이브 전류의 높이 조절용 데이터와 폭 조절용 데이터를 저장하는 보정 테이블 저장부를 포함하고,상기 테스트 셀 어레이는 상기 메모리 셀 어레이에 대응하도록 배치되는 반도체 메모리용 구동 장치
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제1항에 있어서, 상기 순간 하강 전압 생성부는,상기 보정 테이블 저장부로부터 출력되는 상기 높이 조절용 데이터를 아날로그 값의 높이 조절용 신호로 변환하는 D/A 컨버터;상기 보정 테이블 저장부로부터 출력되는 상기 폭 조절용 데이터를 이용하여 숏 펄스 신호를 발생시키는 숏 펄스 제너레이터;상기 높이 조절용 신호를 이용하여 오버드라이브 전류의 높이 조절용 전압으로 충전하는 높이 조절용 캐패시터; 및상기 숏 펄스 신호에 스위칭하여 상기 높이 조절용 전압을 전달하는 하강 전압 전달 스위치를 포함하는 반도체 메모리용 구동 장치
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제1항에 있어서, 상기 메모리 셀 어레이 내 제1 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류의 높이가 상기 메모리 셀 어레이 내 제2 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류의 높이보다 낮고, 상기 메모리 셀 어레이 내 제1 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류의 폭이 상기 메모리 셀 어레이 내 제2 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류의 폭보다 길고, 상기 제1 위치에 배치된 개별 셀과 상기 전류 D/A 변환부의 거리는 상기 제2 위치에 배치된 개별 셀과 상기 전류 D/A 변환부의 거리보다 상대적으로 가까운 것을 특징으로 하는 반도체 메모리용 구동 장치
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제3항에 있어서,상기 제1 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류에 의한 전하량과 상기 제2 위치에 배치된 개별 셀에 흘러드는 오버드라이브 전류에 의한 전하량은 실질적으로 동일한 것을 특징으로 하는 반도체 메모리용 구동 장치
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제2항에 있어서,상기 높이 조절용 캐패시터에 충전되는 높이 조절용 전압을 제어하여 오버드라이브 전류의 높이를 조절하는 반도체 메모리용 구동 장치
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제2항에 있어서,상기 숏 펄스 제너레이터로부터 출력되는 숏 펄스 신호의 턴온 시간을 제어하여 오버드라이브 전류의 폭을 조절하는 반도체 메모리용 구동 장치
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제1항에 있어서,상기 보정 제어부는 오버 드라이브 전류의 폭을 증가시키지 않는 방향으로 천이하고, 천이과정에서 오버드라이브 전류 곡선과 교차하지 않으면, 직전의 천이방향을 유지하도록 제어하는 반도체 메모리용 구동 장치
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제1항에 있어서,상기 보정 제어부는 오버 드라이브 전류의 폭을 증가시키지 않는 방향으로 천이하고, 천이과정에서 오버드라이브 전류 곡선과 교차하지 않으면, 오버드라이브 전류의 폭을 감소시키는 방향으로 천이하도록 제어하는 반도체 메모리용 구동 장치
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제1항에 있어서, 상기 셀 전압 검출부는,상기 테스트 셀 어레이 내 개별 셀에 흐르는 셀 전류를 검출하여 상기 셀 전류에 상응하는 셀 전압을 출력하는 셀 전류 검출부;안정화된 상기 셀 전압을 샘플링하여 각각 제1 및 제2 캐패시터에 저장하는 제1 및 제2 전압 샘플링부;상기 제1 및 제2 전압 샘플링부로부터 출력되는 셀 전압을 각각 제1 및 제2 기준전압으로 증폭하는 제1 및 제2 증폭부; 및안정화되기 전의 초기 셀 전압과 상기 제1 및 제2 기준전압을 각각 비교하여 출력하는 제1 및 제2 비교부를 출력하는 반도체 메모리용 구동 장치
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제1항 내지 제9항 중 어느 한 항에 따른 반도체 메모리용 구동 장치를 포함하는 메모리;사용자에 의해 정보를 생성하도록 사용되는 입출력 인터페이스;무선 통신 네트워크와 정보를 상호 교환하도록 사용되는 무선 인터페이스; 및상기 메모리, 입출력 인터페이스, 및 무선 인터페이스를 제어하는 중앙처리부를 포함하는 시스템
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