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고정길이 및 가변길이 래딕스-4 고속 퓨리에 변환을 위한디지트 반전장치

  • 기술번호 : KST2015083156
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명의 디지트 반전 장치는, 제 1 클럭 신호에 응답해서 상위 2 비트 어드레스를 발생하는 제 1 카운터 모듈, 선택 신호에 응답해서 상기 제 1 클럭 신호를 상기 제 1 카운터 모듈로 선택적으로 출력하는 제 1 클럭 선택기, 상기 상위 2 비트 어드레스를 논리 조합하여 제 2 클럭 신호를 발생하고 상기 선택 신호에 응답해서 상기 제 2 클럭 신호와 상기 제 1 클럭 신호 중 어느 하나를 출력하는 제 2 클럭 선택기, 그리고 상기 제 2 클럭 선택기의 출력에 응답해서 하위 2 비트 어드레스를 발생하는 제 2 카운터 모듈을 포함한다. 디지트 반전장치, 고정 길이 FFT, 가변 길이 FFT, 래딕스-4
Int. CL H03K 23/00 (2006.01)
CPC G06F 7/768(2013.01) G06F 7/768(2013.01) G06F 7/768(2013.01)
출원번호/일자 1020070098828 (2007.10.01)
출원인 한국전자통신연구원, 경북대학교 산학협력단
등록번호/일자 10-0918378-0000 (2009.09.15)
공개번호/일자 10-2009-0033674 (2009.04.06) 문서열기
공고번호/일자 (20090922) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.10.01)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 경북대학교 산학협력단 대한민국 대구광역시 북구

발명자

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번호 이름 국적 주소
1 옥승호 대한민국 부산 서구
2 문병인 대한민국 서울 은평구
3 김창선 대한민국 서울 강동구
4 차진종 대한민국 경기 성남시 분당구
5 윤병진 대한민국 경기 부천시 원미구

대리인

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번호 이름 국적 주소
1 오세준 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)(특허법인 고려)
2 권혁수 대한민국 서울특별시 강남구 언주로 ***, *층(삼일빌딩, 역삼동)(KS고려국제특허법률사무소)
3 송윤호 대한민국 서울특별시 강남구 언주로 *** (역삼동) *층(삼일빌딩)(케이에스고려국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 경북대학교 산학협력단 대한민국 대구광역시 북구
2 한국전자통신연구원 대한민국 대전광역시 유성구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2007.10.01 수리 (Accepted) 1-1-2007-0707023-22
2 선행기술조사의뢰서
Request for Prior Art Search
2008.08.18 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2008.09.11 수리 (Accepted) 9-1-2008-0054992-98
4 의견제출통지서
Notification of reason for refusal
2009.02.27 발송처리완료 (Completion of Transmission) 9-5-2009-0091902-39
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2009.04.10 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2009-0217377-33
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2009.04.10 수리 (Accepted) 1-1-2009-0217379-24
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
8 등록결정서
Decision to grant
2009.08.31 발송처리완료 (Completion of Transmission) 9-5-2009-0363200-54
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.03.26 수리 (Accepted) 4-1-2018-5051994-32
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.23 수리 (Accepted) 4-1-2020-5136893-04
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
제 1 클럭 신호에 응답해서 상위 2 비트 어드레스를 발생하는 제 1 카운터 모듈; 선택 신호에 응답해서 상기 제 1 클럭 신호를 상기 제 1 카운터 모듈로 선택적으로 출력하는 제 1 클럭 선택기; 상기 상위 2 비트 어드레스를 논리 조합하여 제 2 클럭 신호를 발생하고, 상기 선택 신호에 응답해서 상기 제 2 클럭 신호와 상기 제 1 클럭 신호 중 어느 하나를 출력하는 제 2 클럭 선택기; 그리고 상기 제 2 클럭 선택기의 출력에 응답해서 하위 2 비트 어드레스를 발생하는 제 2 카운터 모듈을 포함하고, 상기 제 1 및 제 2 카운터 모듈은, 2 비트 카운터 모듈인 것을 특징으로 하는 디지트 반전 장치
2 2
제 1 항에 있어서, 상기 어드레스들은 가변길이 래딕스-4 고속 퓨리에 변환을 위한 디지트 반전 결과인 것을 특징으로 하는 디지트 반전 장치
3 3
제 1 항에 있어서, 상기 제 1 및 제 2 카운터 모듈 각각은, 각각이 1 비트의 어드레스를 발생하는 2 개의 J-K 플립플롭들을 포함하는 것을 특징으로 하는 디지트 반전 장치
4 4
삭제
5 5
제 1 항에 있어서, 상기 제 1 클럭 선택기는 상기 선택 신호와 상기 제 1 클럭 신호의 논리 곱 결과를 출력하는 것을 특징으로 하는 디지트 반전 장치
6 6
제 1 항에 있어서, 상기 제 2 클럭 선택기는 상기 상위 2 디지트의 출력 어드레스를 논리 곱하여 상기 제 2 클럭 신호를 발생하는 제 1 논리 게이트; 상기 제 2 클럭 신호와 상기 선택신호를 논리 곱하는 제 2 논리 게이트; 상기 제 1 클럭 신호와 반전된 상기 선택신호를 논리 곱하는 제 3 논리 게이트; 그리고 상기 제 2 논리 게이트와 상기 제 3 논리 게이트의 출력을 논리 합하는 제 4 논리 게이트를 포함하는 것을 특징으로 하는 디지트 반전 장치
7 7
제 1 항에 있어서, 상기 제 2 클럭 선택기는 상기 선택 신호에 응답해서 상기 제 1 클럭 신호와 상기 제 2 클럭 신호 중 어느 하나를 선택하는 2-입력 선택기인 것을 특징으로 하는 디지트 반전 장치
8 8
제 1 항에 있어서, 고속 퓨리에 변환의 가변길이가 N일 때(N은 양의 정수) 상기 제 1 클럭 선택기와 상기 제 2 클럭 선택기의 개수의 합은 log4N개인 것을 특징으로 하는 디지트 반전 장치
9 9
제 1 클럭 신호에 응답해서 상위 2 비트 어드레스를 발생하는 제 1 카운터 모듈; 상기 상위 2 비트 어드레스에 응답해서 제 2 클럭 신호를 발생하는 클럭 발생기; 그리고 상기 제 2 클럭 신호의 출력에 응답해서 하위 2 비트 어드레스를 발생하는 제 2 카운터 모듈을 포함하는 것을 특징으로 하는 디지트 반전 장치
10 10
제 9 항에 있어서, 상기 어드레스들은 고정길이 래딕스-4 고속 퓨리에 변환을 위한 디지트 반전 결과인 것을 특징으로 하는 디지트 반전 장치
11 11
제 9 항에 있어서, 상기 제 1 및 제 2 카운터 모듈 각각은, 각각이 1 비트의 어드레스를 발생하는 2 개의 J-K 플립플롭들을 포함하는 것을 특징으로 하는 디지트 반전 장치
12 12
제 9 항에 있어서, 상기 제 1 및 제 2 카운터 모듈은, 2 비트 카운터 모듈인 것을 특징으로 하는 디지트 반전 장치
13 13
제 9 항에 있어서, 상기 클럭 발생기는 상기 상위 2 디지트의 출력 어드레스의 논리 곱 결과를 상기 제 2 클럭 신호로서 발생하는 것을 특징으로 하는 디지트 반전 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
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