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초기 동작 완료 신호에 응답하여 발진 동작을 수행하여 시스템 클럭을 생성하는 발진부, 및 상기 시스템 클럭의 라이징 에지마다 쉬프팅 동작을 수행하여 페치 클럭, 디코딩 클럭, 실행 클럭 및 라이트-백 클럭을 순차적으로 인에이블 시키는 쉬프팅부를 포함하는 클럭 생성 장치;
상기 페치 클럭에 응답하여 기 저장된 프로그램 데이터를 출력하는 휘발성 메모리 장치;
상기 디코딩 클럭에 응답하여 상기 프로그램 데이터를 디코딩하여 디코딩 커맨드를 생성하는 명령 디코더;
상기 실행 클럭에 응답하여 상기 디코딩 커맨드의 지시에 따라 연산 동작을 수행하는 연산 장치; 및
상기 라이트-백 클럭에 응답하여 상기 디코딩 커맨드의 지시에 따라 동작하는 주변회로 장치;
를 포함하는 마이크로 프로세서
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삭제
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3
제 1 항에 있어서,
상기 클럭 생성 장치는 상기 시스템 클럭의 한 주기에 해당하는 인에이블 구간을 갖는 상기 페치 클럭, 상기 디코딩 클럭, 상기 실행 클럭 및 상기 라이트-백 클럭을 생성하도록 구성됨을 특징으로 하는 마이크로 프로세서
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4
제 1 항에 있어서,
상기 라이트-백 클럭을 반전 지연시켜 칩 인에이블 신호를 생성하는 인에이블 제어 장치를 추가로 포함하는 마이크로 프로세서
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5
제 4 항에 있어서,
상기 휘발성 메모리 장치는 상기 칩 인에이블 신호가 인에이블 되면 활성화되고, 상기 칩 인에이블 신호가 디스에이블 되면 아이들 모드에 진입하도록 구성됨을 특징으로 하는 마이크로 프로세서
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6
제 1 항에 있어서,
사용자로부터 입력 받은 프로그램 데이터를 저장하고 있다가 파워 온 리셋 신호가 인에이블 되면 상기 프로그램 데이터를 출력하는 프로그램 입력 장치;
상기 프로그램 데이터를 순차적으로 각 어드레스에 저장한 후, 이를 순차적으로 출력하는 비휘발성 메모리 장치; 및
상기 비휘발성 메모리 장치로부터 출력되는 프로그램 데이터를 순차적으로 상기 휘발성 메모리 장치에 전송하는 데이터 덤핑 장치;
를 추가로 포함하는 마이크로 프로세서
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7
초기 동작 완료 신호에 응답하여 발진 동작을 수행하여 시스템 클럭을 생성하는 발진부, 및 상기 시스템 클럭의 라이징 에지마다 쉬프팅 동작을 수행하여 페치 클럭, 디코딩 클럭, 실행 클럭 및 라이트-백 클럭을 순차적으로 인에이블 시키는 쉬프팅부를 포함하는 클럭 생성 장치;
상기 라이트-백 클럭을 이용하여 칩 인에이블 신호를 생성하는 인에이블 제어 장치;
상기 칩 인에이블 신호에 응답하여 활성화되며, 상기 페치 클럭이 인에이블 되면 기 저장되어 있는 프로그램 데이터를 출력하는 휘발성 메모리 장치; 및
상기 디코딩 클럭에 응답하여 상기 프로그램 데이터를 디코딩하는 명령 디코더;
를 포함하는 마이크로 프로세서
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8
삭제
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9
제 7 항에 있어서,
상기 휘발성 메모리 장치는 상기 칩 인에이블 신호가 인에이블 되면 활성화되고, 상기 칩 인에이블 신호가 디스에이블 되면 아이들 모드에 진입하도록 구성됨을 특징으로 하는 마이크로 프로세서
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10
제 7 항에 있어서,
상기 실행 클럭에 응답하여 상기 명령 디코더로부터 출력되는 신호의 지시에 따라 연산 동작을 수행하는 연산 장치; 및
상기 라이트-백 클럭에 응답하여 상기 명령 디코더로부터 출력되는 신호의 지시에 따라 저장, 카운팅 및 통신 동작을 수행하는 주변회로 장치;
를 추가로 포함하는 마이크로 프로세서
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11
제 10 항에 있어서,
사용자로부터 입력 받은 프로그램 데이터를 저장하고 있다가 파워 온 리셋 신호가 인에이블 되면 상기 프로그램 데이터를 출력하는 프로그램 입력 장치;
상기 프로그램 데이터를 순차적으로 각 어드레스에 저장한 후, 이를 다시 상기 데이터 덤핑 장치에 순차적으로 출력하는 비휘발성 메모리 장치; 및
상기 비휘발성 메모리 장치로부터 출력되는 프로그램 데이터를 순차적으로 상기 휘발성 메모리 장치에 전송하는 데이터 덤핑 장치;
를 추가로 포함하는 마이크로 프로세서
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12
파워 온 리셋 신호에 응답하여 비휘발성 메모리 장치에 기 저장되어 있는 프로그램 데이터를 휘발성 메모리 장치에 전송하고, 전송 동작이 완료되면 초기 동작 완료 신호를 인에이블 시키는 데이터 덤핑 장치;
상기 초기 동작 완료 신호가 인에이블 되면 상기 휘발성 메모리 장치로부터 전송되는 상기 프로그램 데이터를 디코딩하여 디코딩 커맨드를 생성하는 명령 디코더;
상기 초기 동작 완료 신호가 인에이블 되면 상기 디코딩 커맨드의 지시에 따라 연산 동작을 수행하는 연산 장치;
상기 초기 동작 완료 신호가 인에이블 되면 상기 디코딩 커맨드의 지시에 따라 동작하는 주변회로 장치; 및
순차적으로 인에이블 되는 페치 클럭, 디코딩 클럭, 실행 클럭 및 라이트-백 클럭을 생성하여 각각 상기 휘발성 메모리 장치, 상기 명령 디코더, 상기 연산 장치 및 상기 주변회로 장치에 전송하는 클럭 생성 장치;
를 포함하는 마이크로 프로세서
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13
삭제
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14
제 12 항에 있어서,
상기 클럭 생성 장치는,
상기 초기 동작 완료 신호에 응답하여 발진 동작을 수행하여 시스템 클럭을 생성하는 발진부; 및
상기 시스템 클럭의 라이징 에지마다 쉬프팅 동작을 수행하여 상기 페치 클럭, 상기 디코딩 클럭, 상기 실행 클럭 및 상기 라이트-백 클럭을 순차적으로 인에이블 시키는 쉬프팅부;
를 포함하는 것을 특징으로 하는 마이크로 프로세서
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15
제 12 항에 있어서,
상기 라이트-백 클럭을 지연시켜 칩 인에이블 신호를 생성하는 인에이블 제어 장치를 추가로 포함하는 마이크로 프로세서
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16
제 15 항에 있어서,
상기 휘발성 메모리 장치는 상기 칩 인에이블 신호가 인에이블 되면 활성화되고, 상기 칩 인에이블 신호가 디스에이블 되면 아이들 모드에 진입하도록 구성됨을 특징으로 하는 마이크로 프로세서
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