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기판;상기 기판 상에 형성된 제1 전극;상기 제1 전극의 한쪽에 주어진 길이로 형성된 제1 나노 와이어;상기 제1 전극 위에 상기 제1 전극과 겹치게 형성된 제2 전극; 및상기 제1 전극의 한쪽에 대응하는 상기 제2 전극의 한쪽에 형성된 제2 나노 와이어를 포함하고,상기 제1 및 제2 전극사이에 절연층이 존재하는 것을 특징으로 메모리 소자
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제 1 항에 있어서, 상기 기판은 베이스 기판과 절연기판이 순차적으로 적층된 것을 특징으로 하는 메모리 소자
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제 1 항에 있어서, 상기 제1 및 제2 전극은 일부가 겹친 것을 특징으로 하는 메모리 소자
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제 1 항에 있어서, 상기 나노 와이어는 탄소나노튜브인 것을 특징으로 하는 메모리 소자
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제 1 항에 있어서, 상기 기판 상에 상기 제1 및 제2 전극과 상기 제1 및 제2 나노 와이어가 적어도 한 개 더 구비된 것을 특징으로 하는 메모리 소자
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6
기판;상기 기판 상에 주어진 간격으로 이격된 제1 및 제2 하부전극;상기 제1 및 제2 하부전극을 연결하는 제1 나노 와이어;상기 제1 하부전극 위에 상기 제1 하부전극과 겹치게 형성된 제1 상부전극;상기 제2 하부전극 위에 상기 제2 하부전극과 겹치게 형성된 제2 상부전극; 및상기 제1 및 제2 상부전극을 연결하는 제2 나노 와이어를 포함하고,상기 제1 및 제2 상부전극은 상기 제1 및 제2 하부전극과 동일한 간격으로 이격되어 있고,상기 제1 하부전극과 상기 제1 상부전극사이와 상기 제2 하부전극과 상기 제2 상부전극사이에 절연층이 존재하는 것을 특징으로 하는 메모리 소자
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7
제 6 항에 있어서, 상기 기판은 베이스 기판과 절연기판이 순차적으로 적층된 것을 특징으로 하는 메모리 소자
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8
제 7 항에 있어서, 상기 제1 및 제2 하부전극사이의 상기 절연기판에 그루브가 형성된 것을 특징으로 하는 메모리 소자
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9
제 6 항에 있어서, 상기 제1 및 제2 상부전극은 각각 상기 제1 및 제2 하부전극과 일부 겹친 것을 특징으로 하는 메모리 소자
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10
제 6 항에 있어서, 상기 절연층은 포토레지스트막인 것을 특징으로 하는 메모리 소자
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제 6 항에 있어서, 상기 제1 및 제2 나노 와이어는 탄소나노튜브인 것을 특징으로 하는 메모리 소자
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기판 상에 제1 및 제2 전극을 겹치고 서로 절연되게 형성하는 제1 단계;상기 기판 상에 상기 제1 및 제2 전극과 각각 마주하는 제1 및 제2 더미 전극을 겹치고 서로 절연되게 형성하는 제2 단계;상기 제1 전극과 상기 제1 더미 전극을 연결하는 제1 나노 와이어를 형성하는 제3 단계;상기 제2 전극과 상기 제2 더미 전극을 연결하는 제2 나노 와이어를 형성하는 제4 단계;상기 제1 및 제2 전극을 덮고 동일한 길이의 상기 제1 및 제2 나노 와이어를 덮는 마스크를 형성하는 제5 단계; 및상기 제1 및 제2 더미 전극과 상기 마스크로 덮이지 않은 상기 제1 및 제 나노 와이를 제거하고, 상기 마스크를 제거하는 제6 단계를 포함하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 12 항에 있어서, 상기 제1 단계는,상기 기판 상에 제1 전극을 형성하는 단계;상기 기판 상에 상기 제1 전극을 덮는 층간 절연층을 형성하는 단계;상기 층간 절연층 상에 상기 제2 전극을 형성하는 단계; 및상기 제1 및 제2 전극 둘레의 상기 층간 절연층을 제거하는 단계를 더 포함하는 것을 특징으로 하는 메모리 소자의 제조방법
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제 13 항에 있어서, 상기 층간 절연층을 제거한 후, 상기 제1 및 제2 전극과 마주하는 영역의 상기 기판을 과도식각하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 12 항 또는 제 13 항에 있어서, 상기 제2 단계는,상기 기판 상에 상기 제1 및 제2 전극을 덮는 제1 포토레지스트막을 형성하는 단계;상기 제1 포토레지스트막 상에 상기 제1 더미 전극을 형성하는 단계;상기 제1 포토레지스트막 상에 상기 제1 더미 전극을 덮는 제2 포토레지스트막을 형성하는 단계;상기 제2 포토레지스트막 상에 상기 제2 더미 전극을 형성하는 단계; 및상기 제1 및 제2 더미 전극 둘레의 상기 제1 및 제2 포토레지스트막을 제거하는 단계를 더 포함하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 12 항에 있어서, 상기 기판 상에 상기 제1 및 제2 전극과 상기 제1 및 제2 나노 와이어를 적어도 한 개 더 형성하는 것을 특징으로 하는 메모리 소자의 제조방법
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제 12 항에 있어서, 상기 기판은 베이스 기판과 절연기판을 순차적으로 적층하여 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 12 항에 있어서, 상기 제1 및 제2 나노 와이어는 복합 전기장을 이용하여 형성하는 것을 특징으로 하는 메모리 소자의 제조방법
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제 12 항에 있어서, 상기 제2 전극은 상기 제1 전극의 일부와 겹치게 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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기판 상에 주어진 간격으로 제1 및 제2 하부전극을 형성하는 제1 단계;상기 제1 및 제2 하부전극을 연결하는 제1 나노 와이어를 형성하는 제2 단계;상기 기판 상에 상기 제1 및 제2 하부전극과 상기 제1 나노 와이어를 덮는 마스크를 형성하는 제3 단계;상기 마스크 상에 상기 제1 하부전극과 겹치는 제1 상부전극 및 상기 제2 하부전극과 겹치는 제2 상부전극을 상기 제1 및 제2 하부전극과 동일한 간격으로 형성하는 제4 단계;상기 제1 및 제2 상부전극을 연결하는 제2 나노 와이어를 형성하는 제5 단계; 및상기 제1 및 제2 상부전극 둘레의 상기 마스크를 제거하는 제6 단계를 포함하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 기판은 베이스 기판과 절연기판을 순차적으로 적층하여 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 제1 나노 와이어를 형성하기 전에 상기 제1 및 제2 하부전극 사이의 상기 절연기판에 그루브를 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 제1 및 제2 상부전극은 각각 상기 제1 및 제2 하부전극과 일부만 겹치게 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 마스크는 포토레지스트막으로 형성하는 것을 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 제1 및 제2 나노 와이어는 복합 전기장을 이용하여 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 제6 단계는 상기 제5 단계보다 먼저 실시하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 기판 상에 상기 제1 및 제2 하부전극과 상기 제1 및 제2 상부전극과 상기 제1 및 제2 나노 와이어를 포함하는 구조물을 적어도 한 개 더 형성하는 것을 특징으로 하는 메모리 소자의 제조 방법
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제 20 항에 있어서, 상기 제1 나노 와이어는 탄소나노튜브인 것을 특징으로 하는 메모리 소자의 제조 방법
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