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게이트 지연시간 및 출력시간의 모델링 방법

  • 기술번호 : KST2015116124
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 바디 바이어스 전압이 인가된 경우의 게이트 지연시간 또는 출력시간을 예측하는 모델링 방법에 관한 것이다. 본 발명에 따른 게이트 지연시간 또는 출력시간 모델링 방법은 복수의 게이트들 중 제 1 게이트를 선택하는 단계; 선택된 제 1 게이트의 구조를 판별하는 단계; 판별 결과에 따라 선택된 제 1 게이트의 지연시간 비율 또는 출력시간 비율을 생성하는 단계; 및 생성된 지연시간 비율 또는 출력시간 비율과 복수의 게이트들 중 제 2 게이트의 지연시간 또는 출력시간을 기반으로 바디 바이어스 전압이 인가된 경우의 제 2 게이트의 지연시간 또는 출력시간을 계산하는 단계를 포함한다.
Int. CL H01L 21/00 (2006.01) H01L 21/66 (2006.01) G06F 17/50 (2006.01)
CPC H01L 21/67276(2013.01) H01L 21/67276(2013.01) H01L 21/67276(2013.01)
출원번호/일자 1020120115554 (2012.10.17)
출원인 삼성전자주식회사, 한국과학기술원
등록번호/일자
공개번호/일자 10-2014-0050151 (2014.04.29) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 7

출원인

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번호 이름 국적 주소
1 삼성전자주식회사 대한민국 경기도 수원시 영통구
2 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 서문준 대한민국 서울 영등포구
2 백돈규 대한민국 대전 유성구
3 신영수 대한민국 대전 유성구
4 신인섭 대한민국 대전 유성구
5 김형옥 대한민국 서울 송파구
6 오충기 대한민국 경기 용인시 기흥구
7 전재한 대한민국 서울 관악구
8 도경태 대한민국 경남 창원시 마산회원구
9 최정연 대한민국 경기 화성시 영통로**번길 **,

대리인

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번호 이름 국적 주소
1 특허법인 고려 대한민국 서울특별시 강남구 테헤란로 *길 ** *층(역삼동)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2012.10.17 수리 (Accepted) 1-1-2012-0845180-47
2 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.02.01 수리 (Accepted) 4-1-2013-5019983-17
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157993-01
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157968-69
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5158129-58
6 [대리인선임]대리인(대표자)에 관한 신고서
[Appointment of Agent] Report on Agent (Representative)
2015.05.07 수리 (Accepted) 1-1-2015-0440830-98
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.04.24 수리 (Accepted) 4-1-2019-5081392-49
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.15 수리 (Accepted) 4-1-2020-5108396-12
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.12 수리 (Accepted) 4-1-2020-5131486-63
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
복수의 게이트들의 지연시간 모델링 방법에 있어서,상기 복수의 게이트들 중 제 1 게이트를 선택하는 단계;상기 선택된 제 1 게이트의 구조를 판별하는 단계;상기 판별 결과에 따라 상기 선택된 제 1 게이트의 지연시간 비율을 생성하는 단계; 및상기 생성된 지연시간 비율 및 상기 복수의 게이트들 중 제 2 게이트의 지연시간을 기반으로 바디 바이어스 전압이 인가된 경우의 상기 제 2 게이트의 지연시간을 계산하는 단계를 포함하고,상기 제 1 및 제 2 게이트들은 서로 동일한 스택의 수 및 스테이지의 수를 갖고,상기 스택의 수는 상기 제 1 및 제 2 게이트들의 전원전압 및 출력단 사이의 트랜지스터의 개수이고,상기 스테이지의 수는 상기 제 1 및 제 2 게이트들의 입력단 및 출력단 사이의 트랜지스터의 개수인 게이트 지연시간 모델링 방법
2 2
제 1 항에 있어서,상기 지연시간은 입력신호가 변하는 시점부터 출력신호가 전원 전압의 1/2배가 되는 시점인 게이트 지연시간 모델링 방법
3 3
제 2 항에 있어서,상기 제 1 및 제 2 게이트들 각각에 포함된 트랜지스터들은 서로 다른 너비를 갖는 게이트 지연시간 모델링 방법
4 4
제 1 항에 있어서,상기 선택된 게이트의 구조를 판별하는 단계는,상기 선택된 게이트가 다단 구조인지 판별하는 단계; 및상기 선택된 게이트가 스택 구조인지 판별하는 단계를 포함하는 게이트 지연시간 모델링 방법
5 5
제 4 항에 있어서,상기 판별 결과에 따라 지연시간 비율을 생성하는 단계는,상기 판별된 다단 구조 및 상기 판별된 스택 구조에 따라 각각 서로 다른 지연시간 비율을 생성하는 단계를 포함하는 게이트 지연시간 모델링 방법
6 6
제 1 항에 있어서,상기 복수의 게이트들 각각의 지연시간 및 상기 생성된 지연시간 비율에 기반하여, 상기 바디 바이어스 전압이 인가된 경우의 상기 복수의 게이트들 각각의 지연시간을 계산하는 단계를 더 포함하는 게이트 지연시간 모델링 방법
7 7
복수의 게이트들의 출력시간 모델링 방법에 있어서,상기 복수의 게이트들 중 제 1 게이트를 선택하는 단계;상기 선택된 제 1 게이트의 구조를 판별하는 단계;상기 판별 결과에 따라 출력시간 비율을 생성하는 단계; 및상기 생성된 출력시간 비율 및 복수의 게이트들 중 제 2 게이트의 출력시간을 기반으로, 바디 바이어스 전압이 인가된 경우의 상기 제 2 게이트의 출력시간을 계산하는 단계를 포함하고,상기 제 1 및 제 2 게이트들 각각은 서로 동일한 스택의 수 및 스테이지의 수를 갖고,상기 스택의 수는 상기 제 1 및 제 2 게이트들의 전원전압 및 출력단 사이의 트랜지스터의 개수이고,상기 스테이지의 수는 상기 제 1 및 제 2 게이트들의 입력단 및 출력단 사이의 트랜지스터의 개수인 게이트 출력시간 모델링 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.