요약 | 본 발명의 특징적인 구성은 시스템의 알고리즘을 분석한 후 라이브러리를 설정하는 제 1 단계; 상기 제 1 단계에서 설정된 라이브러리의 내부 동작을 SystemC 언어를 이용해 설정하는 제 2 단계; 상기 제 2 단계에서 설정된 SystemC 코드를 이용하여 시스템 수준 SystemC 코드를 생성하여 라이브러리를 설정하는 제 3 단계; 상기 제 3 단계에서 생성된 SystemC 코드의 성능을 다-수준 통합 시뮬레이터를 이용하여 평가하는 제 4 단계; 상기 제 4 단계에서 소프트웨어 성능 평가 완료된 라이브러리의 구현 방법을 결정하는 제 5 단계; 상기 제 5단계에서 결정된 방법에 의해서 소프트웨어 코드 및 하드웨어 모델을 구현하는 제 6 단계; 상기 제 6 단계에서 설정한 하드웨어 모델 및 소프트웨어 코드를 연결하는 각 채널들에 대하여 적절한 CAT을 선택하는 제 7 단계; 상기 제 7단계에서 선택된 CAT를 하드웨어 또는 소프트웨어 모델들을 라이브러리로부터 가져와 시스템의 RT 수준 코드를 생성하는 제 8 단계; 상기 제 8 단계에서 설정된 시스템의 RT 수준 코드를 이용하여 다-수준 통합 시뮬레이터로 평가하는 제 9 단계; 및 상기 제 9 단계에서 평가된 시스템이 설계 제약을 만족하도록 변경하는 제 10 단계를 포함하여서 된 것이다. |
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Int. CL | G06F 9/455 (2006.01) G06F 9/06 (2006.01) |
CPC | G06F 8/24(2013.01) G06F 8/24(2013.01) |
출원번호/일자 | 1020070061775 (2007.06.22) |
출원인 | 재단법인서울대학교산학협력재단 |
등록번호/일자 | 10-0928181-0000 (2009.11.17) |
공개번호/일자 | 10-2008-0112833 (2008.12.26) 문서열기 |
공고번호/일자 | (20091125) 문서열기 |
국제출원번호/일자 | |
국제공개번호/일자 | |
우선권정보 | |
법적상태 | 등록 |
심사진행상태 | 수리 |
심판사항 | |
구분 | |
원출원번호/일자 | |
관련 출원번호 | |
심사청구여부/일자 | Y (2008.01.25) |
심사청구항수 | 10 |
번호 | 이름 | 국적 | 주소 |
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1 | 재단법인서울대학교산학협력재단 | 대한민국 | 서울특별시 관악구 |
번호 | 이름 | 국적 | 주소 |
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1 | 채수익 | 대한민국 | 서울 송파구 |
2 | 박상규 | 대한민국 | 경기도 화성시 |
번호 | 이름 | 국적 | 주소 |
---|---|---|---|
1 | 특허법인 신세기 | 대한민국 | 서울특별시 강남구 선릉로 ***길 ** |
번호 | 이름 | 국적 | 주소 |
---|---|---|---|
1 | 재단법인서울대학교산학협력재단 | 대한민국 | 서울특별시 관악구 |
번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
---|---|---|---|---|
1 | 특허출원서 Patent Application |
2007.06.22 | 수리 (Accepted) | 1-1-2007-0455604-50 |
2 | [심사청구]심사청구(우선심사신청)서 [Request for Examination] Request for Examination (Request for Preferential Examination) |
2008.01.25 | 수리 (Accepted) | 1-1-2008-0062305-31 |
3 | [출원인변경]권리관계변경신고서 [Change of Applicant] Report on Change of Proprietary Status |
2008.03.04 | 수리 (Accepted) | 1-1-2008-0158939-30 |
4 | 선행기술조사의뢰서 Request for Prior Art Search |
2008.07.08 | 수리 (Accepted) | 9-1-9999-9999999-89 |
5 | 선행기술조사보고서 Report of Prior Art Search |
2008.08.12 | 수리 (Accepted) | 9-1-2008-0051763-24 |
6 | 의견제출통지서 Notification of reason for refusal |
2009.05.21 | 발송처리완료 (Completion of Transmission) | 9-5-2009-0213539-97 |
7 | [거절이유 등 통지에 따른 의견]의견(답변, 소명)서 [Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation) |
2009.07.20 | 수리 (Accepted) | 1-1-2009-0440473-94 |
8 | [명세서등 보정]보정서 [Amendment to Description, etc.] Amendment |
2009.07.20 | 보정승인간주 (Regarded as an acceptance of amendment) | 1-1-2009-0440472-48 |
9 | 등록결정서 Decision to grant |
2009.11.03 | 발송처리완료 (Completion of Transmission) | 9-5-2009-0454995-23 |
10 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2014.08.22 | 수리 (Accepted) | 4-1-2014-5100909-62 |
11 | 출원인정보변경(경정)신고서 Notification of change of applicant's information |
2015.03.20 | 수리 (Accepted) | 4-1-2015-5036045-28 |
번호 | 청구항 |
---|---|
1 |
1 설계하고자 하는 시스템의 알고리즘을 분석한 후 응용 기능 블록들과 이들을 연결하는 채널로 나누어진 라이브러리를 설정하는 제 1 단계; 상기 제 1 단계에서 설정된 각 기능 블록 중에서 응용 기능 블록들의 내부 동작을 SystemC 언어를 이용해 설정하는 제 2 단계; 상기 제 2 단계에서 설정된 응용 기능 블록의 SystemC 코드와 채널의 SystemC 코드를 자동으로 통합하여 시스템 수준 SystemC 코드를 생성하여 라이브러리를 설정하는 제 3 단계; 상기 제 3 단계에서 생성된 SystemC 코드를 내장형 프로세서에서 수행할 때의 성능을 다-수준 통합 시뮬레이터를 이용하여 평가하는 제 4 단계; 상기 제 4 단계에서 소프트웨어 성능 평가 완료 후 각 응용 기능 블록을 하드웨어로 구현할 것인지 소프트웨어로 구현할 것인지를 결정하는 제 5 단계; 상기 제 5단계에서 소프트웨어 구현으로 결정된 응용 기능 블록들의 내장형 소프트웨어 코드를 작성하고, 하드웨어 구현으로 결정된 응용 기능 블록들의 하드웨어 모델을 HDL을 이용하여 구현하는 제 6 단계; 상기 제 6 단계에서 설정한 하드웨어 또는 소프트웨어 응용 기능 블록들을 연결하는 각 채널들에 대하여 CAT을 선택하는 제 7 단계; 상기 제 7단계에서 선택된 CAT의 하드웨어 또는 소프트웨어 모델들을 라이브러리로부터 가져와 하드웨어 응용 기능 블록의 HDL 코드 또는 소프트웨어 응용 기능 블록의 내장형 소프트웨어 코드와 통합하여 시스템의 RT 수준 코드를 생성하는 제 8 단계; 상기 제 8 단계에서 설정된 시스템의 RT 수준 코드를 이용하여 구현된 시스템의 질에 관계되는 설계 지표들을 다-수준 통합 시뮬레이터를 이용하여 평가하는 제 9 단계; 및 상기 제 9 단계에서 평가된 시스템이 설계 제약을 만족하도록 변경하는 제 10 단계를 포함함을 특징으로 하는 디지털 시스템 설계 방법 |
2 |
2 제 1 항에 있어서, 제 1 단계 및 제 3 단계의 라이브러리는 표준 인터페이스들을 가지는 통신 및 메모리 관련 기능 패턴인 채널들과, 각 채널을 하드웨어, 소프트웨어, 또는 하드웨어와 소프트웨어로 구현하기 위하여 다양한 성능 및 면적 특성을 제공하는 마이크로 아키텍처 템플릿인 채널 아키텍처 템플릿(CAT)을 포함함을 특징으로 하는 디지털 시스템 설계 방법 |
3 |
3 제 1 항에 있어서, 제 4 단계 및 제 9 단계의 다-수준 통합 시뮬레이터는 응용 기능 블록과 채널 및 CAT들을 시뮬레이션 할 때 SystemC 모델, 명령어 수준 시뮬레이터에서 수행되는 소프트웨어 모델, 로직 시뮬레이터에서 수행되는 하드웨어 모델, 그리고 생성된 트레이스를 이용하여 기능을 수행하는 트레이스 모델들을 혼용하여 시스템의 동작함을 특징으로 하는 디지털 시스템 설계 방법 |
4 |
4 제 1 항에 있어서, 제 6 단계에서 응용 기능 블록의 소프트웨어를 구현할 때, 별도의 내장형 소프트웨어 코딩 없이 SystemC 코드를 소프트웨어 코드로 수행할 수 있는 내장형 운영체제를 이용함을 특징으로 하는 디지털 시스템 설계 방법 |
5 |
5 제 1 항에 있어서, 제 1 단계 및 제 3 단계의 라이브러리는 각 표준 인터페이스가 세 가지 추상 수준, 즉 설계 초기의 기능 명세에 사용되는 SystemC 기반의 상위 수준 인터페이스, 다수의 입출력 신호들과 이들의 싸이클 수준 프로토콜을 정의하는 RT 수준 인터페이스, SystemC 인터페이스와 기본 골격은 동일하나 내장형 소프트웨어의 최적화 메서드를 추가로 정의한 소프트웨어 수준 인터페이스를 가지고 있고, 이러한 표준 인터페이스를 포함함을 특징으로 하는 디지털 시스템 설계 방법 |
6 |
6 제 1 항에 있어서, 제 1 단계 및 제 3 단계의 라이브러리는 각 채널마다 레지스터, 레지스터 파일, 온 칩 SRAM, 그리고 SDRAM 등 다양한 물리적 메모리 소자를 이용하여 다양한 성능 및 면적 특성을 가지는 아키텍처 템플릿들을 포함하고, 다른 응용과의 공유를 위하여 온 칩 SRAM과 SDRAM이 표준 버스에 연결된 구조에 기반한 아키텍처 템플릿들을 포함하며, 하드웨어 응용 기능 블록과 소프트웨어 응용 기능 블록을 연결하는 채널의 구현을 위하여 디바이스 드라이버로 구현될 버스 마스터 어댑터와 버스 슬레이브 어댑터, 그리고 버스 채널과 인터럽트 신호로 구성된 아키텍처 템플릿을 포함하고, 각 아키텍처 템플릿마다 데이터 타입, 메모리의 크기, 세부 적인 구조 및 동작을 조정할 수 있는 파라메터를 포함함을 특징으로 하는 디지털 시스템 설계 방법 |
7 |
7 제 1 항에 있어서, 제 4 단계 및 제 9 단계의 다-수준 통합 시뮬레이터는 Interface Protocol Randomization을 통하여 하드웨어 기능 블록의 기능을 용이하게 검증함을 특징으로 하는 디지털 시스템 설계 방법 |
8 |
8 제 1 항에 있어서, 제 4 단계 및 제 9 단계의 다-수준 통합 시뮬레이터는 트레이스 기반 검증을 통하여 변경된 기능 블록의 correctness를 체크할 수 있고, 발생한 버그의 시점과 위치를 용이하게 발견함을 특징으로 하는 디지털 시스템 설계 방법 |
9 |
9 제 1 항에 있어서, 제 4 단계 및 제 9 단계의 다-수준 통합 시뮬레이터는 로직 시뮬레이터에서 수행되어 속도가 느린 하드웨어 모델 또는 프로세서의 명령어 수준 시뮬레이터에서 수행되어 속도가 느린 내장형 소프트웨어 모델 대신에 저장되었던 트레이스를 이용해 입출력 동작을 모사해주는 트레이스 모델을 대신 사용하여 시뮬레이션 속도를 개선함을 특징으로 하는 디지털 시스템 설계 방법 |
10 |
10 제 1 항에 있어서, 제 1 단계 및 제 3 단계의 라이브러리는 하드웨어 기능 블록과 소프트웨어 기능 블록을 연결하는 채널의 아키텍처 템플릿들로 버스 슬레이브 어댑터와 버스 마스터 어댑터 간 동기화에 버스-대기 방식, polling 방식, 인터럽트 방식을 지원하는 것들을 포함하여, 이 중에서 응용 기능 블록들의 특성과 시스템의 설계 제약을 고려하여 선택함을 특징으로 하는 디지털 시스템 설계 방법 |
지정국 정보가 없습니다 |
---|
패밀리정보가 없습니다 |
---|
국가 R&D 정보가 없습니다. |
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특허 등록번호 | 10-0928181-0000 |
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표시번호 | 사항 |
---|---|
1 |
출원 연월일 : 20070622 출원 번호 : 1020070061775 공고 연월일 : 20091125 공고 번호 : 특허결정(심결)연월일 : 20091103 청구범위의 항수 : 10 유별 : G06F 9/455 발명의 명칭 : 디지털 시스템 설계 방법 존속기간(예정)만료일 : |
순위번호 | 사항 |
---|---|
1 |
(권리자) 재단법인서울대학교산학협력재단 서울특별시 관악구... |
제 1 - 3 년분 | 금 액 | 217,500 원 | 2009년 11월 17일 | 납입 |
제 4 년분 | 금 액 | 260,000 원 | 2012년 11월 16일 | 납입 |
제 5 년분 | 금 액 | 260,000 원 | 2013년 11월 06일 | 납입 |
제 6 년분 | 금 액 | 260,000 원 | 2014년 11월 10일 | 납입 |
제 7 년분 | 금 액 | 480,000 원 | 2015년 10월 28일 | 납입 |
제 8 년분 | 금 액 | 366,240 원 | 2017년 01월 23일 | 납입 |
제 9 년분 | 금 액 | 336,000 원 | 2017년 10월 23일 | 납입 |
제 10 년분 | 금 액 | 395,000 원 | 2018년 11월 01일 | 납입 |
제 11 년분 | 금 액 | 395,000 원 | 2019년 11월 01일 | 납입 |
제 12 년분 | 금 액 | 406,850 원 | 2020년 11월 18일 | 납입 |
번호 | 서류명 | 접수/발송일자 | 처리상태 | 접수/발송번호 |
---|---|---|---|---|
1 | 특허출원서 | 2007.06.22 | 수리 (Accepted) | 1-1-2007-0455604-50 |
2 | [심사청구]심사청구(우선심사신청)서 | 2008.01.25 | 수리 (Accepted) | 1-1-2008-0062305-31 |
3 | [출원인변경]권리관계변경신고서 | 2008.03.04 | 수리 (Accepted) | 1-1-2008-0158939-30 |
4 | 선행기술조사의뢰서 | 2008.07.08 | 수리 (Accepted) | 9-1-9999-9999999-89 |
5 | 선행기술조사보고서 | 2008.08.12 | 수리 (Accepted) | 9-1-2008-0051763-24 |
6 | 의견제출통지서 | 2009.05.21 | 발송처리완료 (Completion of Transmission) | 9-5-2009-0213539-97 |
7 | [거절이유 등 통지에 따른 의견]의견(답변, 소명)서 | 2009.07.20 | 수리 (Accepted) | 1-1-2009-0440473-94 |
8 | [명세서등 보정]보정서 | 2009.07.20 | 보정승인간주 (Regarded as an acceptance of amendment) | 1-1-2009-0440472-48 |
9 | 등록결정서 | 2009.11.03 | 발송처리완료 (Completion of Transmission) | 9-5-2009-0454995-23 |
10 | 출원인정보변경(경정)신고서 | 2014.08.22 | 수리 (Accepted) | 4-1-2014-5100909-62 |
11 | 출원인정보변경(경정)신고서 | 2015.03.20 | 수리 (Accepted) | 4-1-2015-5036045-28 |
기술정보가 없습니다 |
---|
과제고유번호 | 1345096965 |
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세부과제번호 | 과C6A1604 |
연구과제명 | 정보기술사업단 |
성과구분 | 등록 |
부처명 | 교육과학기술부 |
연구관리전문기관명 | 한국연구재단 |
연구주관기관명 | 서울대학교 |
성과제출연도 | 2009 |
연구기간 | 200603~201302 |
기여율 | 1 |
연구개발단계명 | 응용연구 |
6T분류명 | IT(정보기술) |
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