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소자접합성능향상방법

  • 기술번호 : KST2021007981
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 소자 표면의 접합특성을 향상시켜 신뢰성이 우수한 박형의 반도체 패키지 제조가 가능한 소자접합성능향상방법이 제안된다. 본 소자접합성능향상방법은 소자의 접합할 표면에 접합층을 형성하는 단계; 및 접합층의 표면에 접합력향상 표면처리를 수행하는 단계;를 포함한다.
Int. CL H01L 23/00 (2006.01.01) H01L 23/13 (2006.01.01) H01L 23/50 (2006.01.01) H01L 21/02 (2006.01.01)
CPC H01L 24/89(2013.01) H01L 23/13(2013.01) H01L 23/50(2013.01) H01L 21/02639(2013.01)
출원번호/일자 1020190160367 (2019.12.05)
출원인 한국전자기술연구원
등록번호/일자
공개번호/일자 10-2021-0070531 (2021.06.15) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2020.02.21)
심사청구항수 12

출원인

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번호 이름 국적 주소
1 한국전자기술연구원 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 오철민 경기도 용인시 수지구
2 홍원식 경기도 용인시 수지구

대리인

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번호 이름 국적 주소
1 남충우 대한민국 서울 강남구 언주로 ***, *층(역삼동, 광진빌딩)(알렉스국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
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번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2019.12.05 수리 (Accepted) 1-1-2019-1256773-38
2 [출원서 등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2020.01.03 수리 (Accepted) 1-1-2020-0006134-22
3 [심사청구]심사청구(우선심사신청)서
[Request for Examination] Request for Examination (Request for Preferential Examination)
2020.02.21 수리 (Accepted) 1-1-2020-0185656-41
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.08.24 수리 (Accepted) 4-1-2020-5189497-57
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
소자의 접합할 표면에 접합층을 형성하는 단계; 및 접합층의 표면에 접합력향상 표면처리를 수행하는 단계;를 포함하는 소자접합성능향상방법
2 2
청구항 1에 있어서, 접합층은 1㎛ 내지 1,000㎛인 것을 특징으로 하는 소자접합성능향상방법
3 3
청구항 1에 있어서, 표면처리는 접합층의 일부를 제거하는 것을 특징으로 하는 소자접합성능향상방법
4 4
청구항 3에 있어서, 표면처리는 접합층의 표면에 FIB(Focused Ion Beam) 공정을 이용하여 수행되는 것을 특징으로 하는 소자접합성능향상방법
5 5
청구항 4에 있어서, FIB 공정은 Ga 이온빔을 사용하는 것을 특징으로 하는 소자접합성능향상방법
6 6
청구항 3에 있어서, 접합층은 표면처리 후에, 1㎛ 내지 10㎛ 깊이의 캐비티를 갖는 것을 특징으로 하는 소자접합성능향상방법
7 7
청구항 1에 있어서, 표면처리는 접합층 표면에 요철층을 추가하는 것을 특징으로 하는 소자접합성능향상방법
8 8
청구항 7에 있어서, 표면처리는,접합층 상부에 마스크를 위치시키는 단계; 및요철물질을 스퍼터링하여 마스크 형상에 따라 접합층 표면에 요철층이 형성되는 단계;를 포함하는 것을 특징으로 하는 소자접합성능향상방법
9 9
청구항 1의 소자접합성능향상방법에 따라 접합성능이 향상된 소자
10 10
소자의 접합할 표면에 접합층을 형성하는 단계; 접합층의 표면에 접합력향상 표면처리를 수행하는 단계; 및소자를 기판에 접합시키는 단계;를 포함하는 소자실장방법
11 11
청구항 10에 따른 소자실장방법에 따라 반도체 소자가 실장된 기판을 포함하는 반도체 패키지
12 12
청구항 11에 있어서, 기판은 접합력 향상을 위한 표면처리된 것을 특징으로 하는 반도체 패키지
지정국 정보가 없습니다
패밀리정보가 없습니다
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순번 연구부처 주관기관 연구사업 연구과제
1 산업통상자원부 트리노테크놀로지 우수기술연구센터(ATC)(R&D) 48V 기반 EV/HEV 대응 100V 급 Trench MOSFET 기술개발