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상보적 저항 스위칭 메모리 소자 및 그 제조방법

  • 기술번호 : KST2015142597
  • 담당센터 : 서울서부기술혁신센터
  • 전화번호 : 02-6124-6930
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 상보적 저항 스위칭 메모리 소자를 제공한다. 상보적 저항 스위칭 메모리 소자는 기판, 상기 기판 상에 위치하는 제1 전극, 상기 제1 전극 상에 위치하는 제1 산화물 반도체층, 상기 제1 산화물 반도체층 상에 위치하는 도전층, 상기 도전층 상에 위치하는 제2 산화물 반도체층 및 상기 제2 산화물 반도체층 상에 위치하는 제2 전극을 포함하고, 상기 제1 산화물 반도체층, 도전층 및 제2 산화물 반도체층로 구성된 군에서 선택된 적어도 하나의 층의 상부 또는 하부에 위치하는 추가절연체층을 더 포함하고, 상기 추가절연체층의 저항값은 상기 추가절연체층을 포함하지 않은 경우의 온 저항값의 0.5 배 내지 2 배인 것을 특징으로 한다. 따라서, 추가절연체층이 산소 확산(oxygen diffusion)의 연속적인 이동을 제한함과 동시에 추가적인 저항체 역할을 함으로써, 셋(set) 동작 후에 충분히 온(on) 상태를 유지시킨 후에 리셋(reset) 현상이 나타나게 하여 리드 마진을 증대시킬 수 있다.
Int. CL H01L 27/115 (2006.01) H01L 21/8247 (2006.01) H01L 29/02 (2006.01)
CPC H01L 27/11507(2013.01)
출원번호/일자 1020140124584 (2014.09.18)
출원인 한양대학교 산학협력단
등록번호/일자 10-1545452-0000 (2015.08.11)
공개번호/일자
공고번호/일자 (20150819) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2014.09.18)
심사청구항수 11

출원인

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구

발명자

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번호 이름 국적 주소
1 홍진표 대한민국 서울특별시 성동구
2 배윤철 대한민국 경상남도 거제시
3 이아람 대한민국 경상남도 김해

대리인

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번호 이름 국적 주소
1 특허법인이상 대한민국 서울특별시 서초구 바우뫼로 ***(양재동, 우도빌딩 *층)

최종권리자

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번호 이름 국적 주소
1 한양대학교 산학협력단 대한민국 서울특별시 성동구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2014.09.18 수리 (Accepted) 1-1-2014-0887298-78
2 선행기술조사의뢰서
Request for Prior Art Search
2015.02.11 수리 (Accepted) 9-1-9999-9999999-89
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.02.16 수리 (Accepted) 4-1-2015-5022074-70
4 선행기술조사보고서
Report of Prior Art Search
2015.04.10 수리 (Accepted) 9-1-2015-0024036-69
5 의견제출통지서
Notification of reason for refusal
2015.05.29 발송처리완료 (Completion of Transmission) 9-5-2015-0362220-96
6 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2015.07.16 수리 (Accepted) 1-1-2015-0687299-12
7 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2015.07.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2015-0687300-82
8 등록결정서
Decision to grant
2015.07.31 발송처리완료 (Completion of Transmission) 9-5-2015-0513899-63
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.05 수리 (Accepted) 4-1-2019-5155816-75
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.06 수리 (Accepted) 4-1-2019-5156285-09
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
기판;상기 기판 상에 위치하는 제1 전극;상기 제1 전극 상에 위치하는 제1 산화물 반도체층;상기 제1 산화물 반도체층 상에 위치하는 도전층;상기 도전층 상에 위치하는 제2 산화물 반도체층; 및상기 제2 산화물 반도체층 상에 위치하는 제2 전극을 포함하고,상기 제1 산화물 반도체층, 도전층 및 제2 산화물 반도체층로 구성된 군에서 선택된 적어도 하나의 층의 상부 또는 하부에 위치하는 추가절연체층을 더 포함하고,상기 추가절연체층의 저항값은 상기 추가절연체층을 포함하지 않은 경우의 온 저항값의 0
2 2
기판;상기 기판 상에 위치하는 제1 전극;상기 제1 전극 상에 위치하는 제1 산화물 반도체층;상기 제1 산화물 반도체층 상에 위치하는 도전층;상기 도전층 상에 위치하는 제2 산화물 반도체층; 및상기 제2 산화물 반도체층 상에 위치하는 제2 전극을 포함하고,상기 도전층은 복수개의 금속층들을 포함하고, 상기 금속층들 사이에 적어도 한층 이상 위치하는 추가절연체층을 더 포함하고,상기 추가절연체층의 저항값은 상기 추가절연체층을 포함하지 않은 경우의 온 저항값의 0
3 3
제2항에 있어서,상기 도전층은,제1 금속층;상기 제1 금속층 상에 위치하는 추가절연체층; 및상기 추가절연체층 상에 위치하는 제2 금속층을 포함하는 상보적 저항 스위칭 메모리 소자
4 4
제2항에 있어서,상기 금속층은 Ta, W, Ti, Cu, Ag, TaN, TiN, WN 또는 Pt를 포함하는 상보적 저항 스위칭 메모리 소자
5 5
제1항 또는 제2항에 있어서,상기 추가절연체층은 산화물 또는 질화물을 포함하는 상보적 저항 스위칭 메모리 소자
6 6
제1항 또는 제2항에 있어서,상기 추가절연체층은 Ta2O5-x, TiOx, CoOx, MgOx, CuAlOx, MnOx, SnOx, FeOx, WOx, PbOx, Pr1-xCaxMnO3, La1-xCaxMnO3, La1-xSrxMnO3, PbZr1-xTixO3, HfO2-x, CeOx, ZnOx, AlOx, LaOx, NbOx, InxZn1-xO2), LixNb1-xO3, SrxTi1-xO3, BaxSr1-xTiO3, Ta, W, Ti, Cu, Ag, TaN, TiN, WN, TaN, TaON, TiON 또는 TiN을 포함하는 상보적 저항 스위칭 메모리 소자
7 7
기판 상에 제1 전극을 형성하는 단계;상기 제1 전극 상에 위치하는 제1 산화물 반도체층을 형성하는 단계;상기 제1 산화물 반도체층 상에 도전층을 형성하는 단계;상기 도전층 상에 제2 산화물 반도체층을 형성하는 단계; 및상기 제2 산화물 반도체층 상에 제2 전극을 형성하는 단계를 포함하고,상기 각각 단계들 사이 중 적어도 하나의 사이에, 제1 전극, 제1 산화물 반도체층, 도전층 및 제2 산화물 반도체층 중 적어도 어느 한 층 상에 추가절연체층을 형성하는 단계를 더 포함하고,상기 추가절연체층의 저항값은 상기 추가절연체층을 포함하지 않은 경우의 온 저항값의 0
8 8
기판 상에 제1 전극을 형성하는 단계;상기 제1 전극 상에 위치하는 제1 산화물 반도체층을 형성하는 단계;상기 제1 산화물 반도체층 상에 복수개의 금속층들 및 상기 금속층들 사이에 적어도 한층 이상 위치하는 추가절연체층을 포함하는 도전층을 형성하는 단계;상기 도전층 상에 제2 산화물 반도체층을 형성하는 단계; 및상기 제2 산화물 반도체층 상에 제2 전극을 형성하는 단계를 포함하고,상기 추가절연체층의 저항값은 상기 추가절연체층을 포함하지 않은 경우의 온 저항값의 0
9 9
제8항에 있어서,상기 도전층을 형성하는 단계는,상기 제1 산화물 반도체층 상에 제1 금속층을 형성하는 단계;상기 제1 금속층 상에 추가절연체층을 형성하는 단계; 및상기 추가절연체층 상에 제2 금속층을 형성하는 단계를 포함하는 상보적 저항 스위칭 메모리 소자 제조방법
10 10
제7항 또는 제8항에 있어서,상기 추가절연체층은 산화물 또는 질화물을 포함하는 상보적 저항 스위칭 메모리 소자 제조방법
11 11
제7항 또는 제8항에 있어서,상기 추가절연체층은 Ta2O5-x, TiOx, CoOx, MgOx, CuAlOx, MnOx, SnOx, FeOx, WOx, PbOx, Pr1-xCaxMnO3, La1-xCaxMnO3, La1-xSrxMnO3, PbZr1-xTixO3, HfO2-x, CeOx, ZnOx, AlOx, LaOx, NbOx, InxZn1-xO2), LixNb1-xO3, SrxTi1-xO3, BaxSr1-xTiO3, Ta, W, Ti, Cu, Ag, TaN, TiN, WN, TaN, TaON, TiON 또는 TiN을 포함하는 상보적 저항 스위칭 메모리 소자 제조방법
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