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세라믹 메탈 반도체 패키지 및 그 제조방법

  • 기술번호 : KST2024000144
  • 담당센터 : 경기기술혁신센터
  • 전화번호 : 031-8006-1570
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 개시의 일구현예에 따르면 베이스, 상기 베이스 상에 형성되고 내부에 수용부가 형성되는 바디, 상기 수용부 내의 베이스 상에 배치되고, 반도체 칩과 상기 반도체 칩에 연결되어 전기신호를 전달하는 재배선층을 포함하는 재배선 유닛, 상기 바디에 결합되고 상기 재배선 유닛과 연결되어 외부로 전기신호를 전달하는 리드, 및 상기 바디와 결합되어 상기 수용부를 덮는 캡을 포함하는 세라믹 메탈 반도체 패키지 및 그 제조방법을 제공하여, 고주파수 대역에서도 전기적 특성을 향상할 수 있다.
Int. CL H01L 25/16 (2023.01.01) H01L 23/051 (2006.01.01) H01L 23/00 (2006.01.01) H01L 23/488 (2006.01.01) H01L 23/367 (2006.01.01) H01L 25/00 (2014.01.01) H01L 21/48 (2006.01.01)
CPC H01L 25/16(2013.01) H01L 23/051(2013.01) H01L 24/07(2013.01) H01L 23/488(2013.01) H01L 23/367(2013.01) H01L 24/15(2013.01) H01L 25/50(2013.01) H01L 21/4803(2013.01) H01L 21/4821(2013.01) H01L 2224/0233(2013.01) H01L 2224/02371(2013.01) H01L 2224/02379(2013.01) H01L 2224/19(2013.01)
출원번호/일자 1020220066878 (2022.05.31)
출원인 한국전자기술연구원
등록번호/일자
공개번호/일자 10-2023-0167248 (2023.12.08) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2022.05.31)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 한국전자기술연구원 대한민국 경기도 성남시 분당구

발명자

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번호 이름 국적 주소
1 김동수 경기도 성남시 분당구
2 육종민 경기도 성남시 분당구
3 김준철 경기도 성남시 분당구
4 윤홍선 경기도 성남시 중원구

대리인

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번호 이름 국적 주소
1 청운특허법인 대한민국 서울특별시 서초구 반포대로 ***, *층 (서초동, 장생빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2022.05.31 수리 (Accepted) 1-1-2022-0575753-33
2 특허고객번호 정보변경(경정)신고서·정정신고서
2023.03.14 수리 (Accepted) 4-1-2023-5062703-94
3 특허고객번호 정보변경(경정)신고서·정정신고서
2023.03.20 수리 (Accepted) 4-1-2023-5067768-12
4 선행기술조사의뢰서
Request for Prior Art Search
2023.09.15 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search
2023.11.17 발송처리완료 (Completion of Transmission) 9-6-2023-0220036-49
6 의견제출통지서
Notification of reason for refusal
2023.11.28 발송처리완료 (Completion of Transmission) 9-5-2023-1073045-01
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번호 청구항
1 1
베이스;상기 베이스 상에 형성되고 내부에 수용부가 형성되는 바디; 상기 수용부 내의 베이스 상에 배치되고, 반도체 칩과 상기 반도체 칩에 연결되어 전기신호를 전달하는 재배선층을 포함하는 재배선 유닛; 상기 바디에 결합되고 상기 재배선 유닛과 연결되어 외부로 전기신호를 전달하는 리드; 및 상기 바디와 결합되어 상기 수용부를 덮는 캡을 포함하는, 세라믹 메탈 반도체 패키지
2 2
청구항 1에 있어서, 상기 재배선 유닛은 제1 캐비티가 형성된 시트; 상기 제1 캐비티에 수용되는 반도체 칩; 및 상기 시트의 상면에 형성되고 상기 반도체 칩에 연결되며 전기신호를 전달하는 재배선층을 포함하는, 세라믹 메탈 반도체 패키지
3 3
청구항 2에 있어서, 상기 시트는 제2 캐비티가 더 형성되고, 상기 재배선 유닛은 상기 제2 캐비티에 수용되는 수동소자를 더 포함하며, 상기 재배선층은 상기 반도체 칩 및 수동소자에 연결되어 전기신호를 전달하는, 세라믹 메탈 반도체 패키지
4 4
청구항 3에 있어서, 상기 재배선 유닛은 상기 시트의 하면, 반도체 칩의 하면, 수동소자의 하면에 형성되어 상기 반도체 칩과 수동소자의 열을 상기 베이스로 전달하는 하부금속층을 더 포함하는, 세라믹 메탈 반도체 패키지
5 5
청구항 1에 있어서, 상기 리드는 일단이 상기 재배선 유닛의 상부까지 연장되고 상기 재배선 유닛에 범프를 통해 직접 연결되는, 세라믹 메탈 반도체 패키지
6 6
베이스 상에 수용부가 형성된 바디를 결합하는 제1 단계;상기 수용부 내의 베이스 상에 반도체 칩과 상기 반도체 칩에 연결되어 전기신호를 전달하는 재배선층을 포함하는 재배선 유닛을 배치하는 제2 단계;상기 바디에 리드를 결합하고 상기 리드의 일단과 재배선 유닛을 연결하는 제3 단계; 및 상기 수용부를 커버하는 캡을 상기 바디에 결합하는 제4 단계를 포함하는, 세라믹 메탈 반도체 패키지 제조방법
7 7
청구항 6에 있어서, 상기 제2 단계 이전에, 재배선 유닛을 형성하는 단계를 더 포함하며, 상기 재배선 유닛을 형성하는 단계는 시트를 준비하는 단계;상기 시트에 반도체 칩이 배치될 제1 캐비티를 형성하는 단계;상기 제1 캐비티에 상기 반도체 칩을 배치하는 단계;상기 반도체칩과 시트를 커버하고, 상기 반도체 칩과 시트 사이에 충진되는 절연층을 형성하는 단계;상기 절연층의 일부를 제거하여 칩패드를 노출시키는 제1 오픈부를 형성하는 단계; 및 상기 절연층 상에 상기 칩패드와 연결되는 전극패턴을 형성하는 단계를 포함하는, 세라믹 메탈 반도체 패키지 제조방법
8 8
청구항 6에 있어서, 상기 제2 단계 이전에, 재배선 유닛을 형성하는 단계를 더 포함하며, 상기 재배선 유닛을 형성하는 단계는 시트를 준비하는 단계;상기 시트에 반도체 칩이 배치될 제1 캐비티 및 수동소자가 배치될 제2 캐비티를 형성하는 단계;상기 제1 캐비티에 상기 반도체 칩을 배치하고 상기 제2 캐비티에 상기 수동소자를 배치하는 단계;상기 반도체칩, 수동소자 및 시트를 커버하고, 상기 반도체 칩, 수동소자 및 시트 사이에 충진되는 절연층을 형성하는 단계;절연층의 일부를 제거하여 칩패드를 노출시키는 제1 오픈부 및 수동소자의 패드를 노출시키는 제2 오픈부를 형성하는 단계; 및 상기 절연층 상에 상기 칩패드와 수동소자의 패드를 연결하는 전극패턴을 형성하는 단계를 포함하는, 세라믹 메탈 반도체 패키지 제조방법
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청구항 6에 있어서, 상기 제3 단계는 상기 재배선 유닛 상에 범프를 배치하고 상기 리드의 일단을 상기 범프 상에 배치하고 리플로우 공정을 수행하여, 상기 재배선 유닛과 리드의 일단을 접속하는, 세라믹 메탈 반도체 패키지 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.