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반도체 소자 제조방법(MANUFACTURING METHOD FOR SEMICONDUCTOR DEVICE)

  • 기술번호 : KST2016015745
  • 담당센터 : 대구기술혁신센터
  • 전화번호 : 053-550-1450
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 반도체 소자 제조방법이 개시된다. 본 제조방법은, 기판상에 제1 반도체층을 형성하는 단계, 기 설정된 패턴을 갖는 마스크층을 제1 반도체층 상에 형성하여, 기설정된 소스 구조, 드레인 구조 및 채널 구조가 되도록 제1 반도체층을 건식 식각하는 단계, 채널 구조에 해당하는 제1 반도체층의 폭이 채널 구조에 해당하는 제1 반도체층 상에 형성된 마스크 층의 폭보다 작은 폭을 갖도록 제1 반도체층의 측면을 식각 용액으로 습식 식각하는 단계, 마스크층을 제거하는 단계, 채널 구조에 해당하는 제1 반도체층을 둘러싸는 형태로 게이트 절연막을 형성하는 단계 및 게이트 절연막 상에 게이트 전극을 형성하는 단계를 포함한다.
Int. CL H01L 29/78 (2006.01) H01L 21/3213 (2006.01) H01L 29/66 (2006.01)
CPC H01L 29/785(2013.01) H01L 29/785(2013.01) H01L 29/785(2013.01)
출원번호/일자 1020150024438 (2015.02.17)
출원인 경북대학교 산학협력단
등록번호/일자
공개번호/일자 10-2016-0101577 (2016.08.25) 문서열기
공고번호/일자 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2015.02.17)
심사청구항수 7

출원인

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번호 이름 국적 주소
1 경북대학교 산학협력단 대한민국 대구광역시 북구

발명자

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번호 이름 국적 주소
1 이정희 대한민국 대구광역시 수성구
2 손동혁 대한민국 경상북도 김천시 문지왈길 **
3 강희성 대한민국 대구광역시 북구
4 조영우 대한민국 대구광역시 서구
5 원철호 대한민국 대구광역시 달서구

대리인

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번호 이름 국적 주소
1 이현수 대한민국 서울특별시 마포구 백범로 ***(신공덕동) 메트로디오빌빌딩 ****호(이현수상표특허법률사무소)
2 정홍식 대한민국 서울시 서초구 강남대로 *** 신덕빌딩 *층(나우특허법률사무소)
3 김태헌 대한민국 서울시 서초구 강남대로 *** 신덕빌딩 *층(나우특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 경북대학교 산학협력단 대구광역시 북구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2015.02.17 수리 (Accepted) 1-1-2015-0170067-56
2 선행기술조사의뢰서
Request for Prior Art Search
2016.01.12 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2016.03.10 수리 (Accepted) 9-1-2016-0012934-53
4 의견제출통지서
Notification of reason for refusal
2016.04.21 발송처리완료 (Completion of Transmission) 9-5-2016-0290079-66
5 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2016.06.16 수리 (Accepted) 1-1-2016-0581452-95
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2016.06.16 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2016-0581470-17
7 등록결정서
Decision to grant
2016.10.14 발송처리완료 (Completion of Transmission) 9-5-2016-0738678-80
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.03.26 수리 (Accepted) 4-1-2018-5051994-32
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.23 수리 (Accepted) 4-1-2020-5136893-04
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
반도체 소자 제조방법에 있어서,기판상에 GaN층을 형성하는 단계;기 설정된 패턴을 갖는 마스크층을 상기 GaN층 상에 형성하여, 기설정된 소스 구조, 드레인 구조 및 채널 구조가 되도록 상기 GaN층을 건식 식각하는 단계;상기 채널 구조에 해당하는 GaN층의 폭이 상기 채널 구조에 해당하는 GaN층 상에 형성된 마스크 층의 폭보다 작은 폭을 갖도록 상기 GaN층의 측면을 TMAH(tetra-methyl ammonium hydroxide) 용액으로 습식 식각하는 단계;상기 마스크층을 제거하는 단계;상기 채널 구조에 해당하는 GaN층을 둘러싸는 형태로 게이트 절연막을 형성하는 단계; 및상기 게이트 절연막 상에 게이트 전극을 형성하는 단계;를 포함하며,상기 건식 식각하는 단계는,상기 채널 구조에 해당하는 GaN층의 측면이 질소면(nitrogen face)이 되도록 식각하는 반도체 소자 제조방법
2 2
제1항에 있어서,상기 채널 구조에 해당하는 GaN층을 둘러싸는 형태로 제2 반도체층을 형성하는 단계;를 더 포함하며,상기 게이트 절연막은,상기 채널 구조에 해당하는 GaN층을 둘러싸는 상기 제2 반도체층을 둘러싸도록 형성되는 것을 특징으로 하는 반도체 소자 제조방법
3 3
제1항에 있어서,상기 습식 식각하는 단계는,상기 채널 구조에 해당하는 GaN층의 폭이 50nm 내지 400nm가 되도록 식각하는 것을 특징으로 하는 반도체 소자 제조방법
4 4
삭제
5 5
제2항에 있어서,상기 제2 반도체층은 AlGaN 또는 AlN로 구성되는 것을 특징으로 하는 반도체 소자 제조방법
6 6
제1항에 있어서,상기 채널 구조에 해당하는 GaN층의 일부가 관통되도록 상기 GaN층의 기 설정된 하부 영역을 식각하는 단계;를 더 포함하며,상기 게이트 절연막을 형성하는 단계는,상기 관통된 영역을 통과하며 상기 GaN층을 둘러싸는 형태로 게이트 절연막을 형성하는 것을 특징으로 하는 반도체 소자 제조방법
7 7
제6항에 있어서,상기 관통된 영역을 통과하며 상기 GaN층을 둘러싸는 형태로 제2 반도체층을 형성하는 단계;를 더 포함하며,상기 게이트 절연막은,상기 GaN층을 둘러싸는 상기 제2 반도체층을 둘러싸도록 형성되는 것을 특징으로 하는 반도체 소자 제조방법
8 8
제1항에 있어서,상기 소스 구조와 상기 드레인 구조에 해당하는 GaN층 상에 소스 전극 및 드레인 전극을 각각 형성하는 단계;를 더 포함하는 것을 특징으로 하는 반도체 소자 제조방법
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.