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배선 구조물 형성 방법, 이를 사용한 반도체 장치 제조 방법, 및 이를 통해 제조된 반도체 장치

  • 기술번호 : KST2024000048
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 배선 구조물 형성 방법에서, 기판 상에, 그래핀을 포함하는 전극막 및 육방정계 붕소질화물(h-BN)을 포함하는 절연막을 교대로 반복적으로 적층할 수 있다. 불소를 포함하는 식각 가스를 사용하는 제1 건식 식각 공정을 수행하여 상기 절연막들 중에서 최상층에 형성된 제1 절연막을 식각함으로써, 상기 전극막들 중에서 최상층에 형성된 제1 전극막의 상면을 노출시키는 개구를 형성할 수 있다. 산소 플라스마 및/또는 수소 플라스마를 사용하는 반응성 이온 식각(RIE) 공정을 수행하여 상기 노출된 제1 전극막 부분을 제거함으로써, 상기 절연막들 중에서 상기 제1 전극막 하부에 형성된 제2 절연막의 상면을 노출시키도록 상기 개구를 확장할 수 있다. 불소를 포함하는 식각 가스를 사용하는 제2 건식 식각 공정을 수행하여 상기 노출된 제2 절연막을 식각함으로써, 상기 전극막들 중에서 상기 제2 절연막 하부에 형성된 제2 전극막의 상면을 노출시키도록 상기 개구를 확장할 수 있다. 상기 확장된 개구 내에 콘택 플러그를 형성할 수 있다.
Int. CL H01L 27/092 (2006.01.01) H01L 29/66 (2006.01.01) H01L 29/423 (2006.01.01) H01L 21/8238 (2006.01.01) H01L 23/535 (2006.01.01)
CPC H01L 27/092(2013.01) H01L 29/66969(2013.01) H01L 29/42384(2013.01) H01L 21/823871(2013.01) H01L 23/535(2013.01)
출원번호/일자 1020220092552 (2022.07.26)
출원인 삼성전자주식회사, 서울대학교산학협력단
등록번호/일자
공개번호/일자 10-2023-0166806 (2023.12.07) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020220066516   |   2022.05.31
법적상태 공개
심사진행상태 수리
심판사항
구분 국내출원/신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 N
심사청구항수 10

출원인

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번호 이름 국적 주소
1 삼성전자주식회사 대한민국 경기도 수원시 영통구
2 서울대학교산학협력단 대한민국 서울특별시 관악구

발명자

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번호 이름 국적 주소
1 김민식 경기도 수원시 영통구
2 이관형 서울특별시 관악구
3 김석훈 경기도 수원시 영통구
4 신용준 서울특별시 관악구

대리인

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번호 이름 국적 주소
1 박영우 대한민국 서울특별시 강남구 논현로 ***, *층 **세기특허법률사무소 (역삼동, 세일빌딩)

최종권리자

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번호 이름 국적 주소
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2022.07.26 수리 (Accepted) 1-1-2022-0781859-06
2 특허고객번호 정보변경(경정)신고서·정정신고서
2022.08.11 수리 (Accepted) 4-1-2022-5189083-38
3 특허고객번호 정보변경(경정)신고서·정정신고서
2022.10.07 수리 (Accepted) 4-1-2022-5235636-01
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번호 청구항
1 1
기판 상에, 그래핀을 포함하는 전극막 및 육방정계 붕소질화물(h-BN)을 포함하는 절연막을 교대로 반복적으로 적층하고;불소를 포함하는 식각 가스를 사용하는 제1 건식 식각 공정을 수행하여 상기 절연막들 중에서 최상층에 형성된 제1 절연막을 식각함으로써, 상기 전극막들 중에서 최상층에 형성된 제1 전극막의 상면을 노출시키는 개구를 형성하고;산소 플라스마 및/또는 수소 플라스마를 사용하는 반응성 이온 식각(RIE) 공정을 수행하여 상기 노출된 제1 전극막 부분을 제거함으로써, 상기 절연막들 중에서 상기 제1 전극막 하부에 형성된 제2 절연막의 상면을 노출시키도록 상기 개구를 확장하고;불소를 포함하는 식각 가스를 사용하는 제2 건식 식각 공정을 수행하여 상기 노출된 제2 절연막을 식각함으로써, 상기 전극막들 중에서 상기 제2 절연막 하부에 형성된 제2 전극막의 상면을 노출시키도록 상기 개구를 확장하고; 그리고상기 확장된 개구 내에 콘택 플러그를 형성하는 것을 포함하는 배선 구조물 형성 방법
2 2
제 1 항에 있어서, 상기 불소를 포함하는 식각 가스는 이불화 제논(XeF2), 사불화 탄소(CF4) 혹은 육불화 황(SF6)을 포함하는 배선 구조물 형성 방법
3 3
제 1 항에 있어서, 상기 제1 건식 식각 공정을 수행함에 따라서, 상기 식각 가스에 포함된 불소 성분이 상기 제1 전극막과 결합하여 불화 그래핀을 형성하는 배선 구조물 형성 방법
4 4
제 1 항에 있어서, 상기 제1 전극막은 상기 제1 건식 식각 공정에서 식각 저지막 역할을 수행하는 배선 구조물 형성 방법
5 5
제 1 항에 있어서, 상기 제1 건식 식각 공정을 수행할 때, 상기 제2 절연막은 제거되지 않는 배선 구조물 형성 방법
6 6
기판 상에 제1 채널을 형성하고;상기 제1 채널의 양 측부들을 각각 커버하며 그래핀을 포함하는 제1 소스/드레인 전극들을 상기 기판 상에 형성하고;상기 제1 채널 및 상기 제1 소스/드레인 전극들을 커버하는 제1 절연막을 상기 기판 상에 형성하고;상기 제1 절연막 상에 그래핀을 포함하는 게이트 전극을 형성하고;상기 게이트 전극을 커버하는 제2 절연막을 상기 제1 절연막 상에 형성하고;상기 제2 절연막 상에 제2 채널을 형성하고;상기 제2 채널의 양 측부들을 각각 커버하며 그래핀을 포함하는 제2 소스/드레인 전극들을 상기 제2 절연막 상에 형성하고;상기 제2 채널 및 상기 제2 소스/드레인 전극들을 커버하는 제3 절연막을 상기 제2 절연막 상에 형성하고;상기 제3 절연막을 관통하여 상기 제2 채널의 제1 측에 형성된 상기 제2 소스/드레인 전극의 상면에 접촉하는 제1 콘택 플러그를 형성하고;상기 제1 내지 제3 절연막들을 관통하여 상기 제1 채널의 제1 측에 형성된 상기 제1 소스/드레인 전극의 상면에 접촉하는 제2 콘택 플러그를 형성하고;상기 제1 내지 제3 절연막들, 및 상기 제2 채널의 제2 측에 형성된 상기 제2 소스/드레인 전극을 관통하여 상기 제1 채널의 제2 측에 형성된 상기 제1 소스/드레인 전극의 상면에 접촉하는 제3 콘택 플러그를 형성하고; 그리고상기 제2 및 제3 절연막들을 관통하여 상기 게이트 전극의 상면에 접촉하는 제4 콘택 플러그를 형성하는 것을 포함하는 반도체 장치 제조 방법
7 7
제 6 항에 있어서, 상기 제2 콘택 플러그를 형성하는 것은,불소를 포함하는 식각 가스를 사용하는 건식 식각 공정을 수행하여 상기 제1 내지 제3 절연막들을 식각함으로써, 상기 제1 채널의 상기 제1 측에 형성된 상기 제1 소스/드레인 전극의 상면을 노출시키는 개구를 형성하고; 그리고상기 개구를 채우는 상기 제2 콘택 플러그를 형성하는 것을 포함하는 반도체 장치 제조 방법
8 8
제 6 항에 있어서, 상기 제3 콘택 플러그를 형성하는 것은,불소를 포함하는 식각 가스를 사용하는 제1 건식 식각 공정을 수행하여 상기 제3 절연막을 식각함으로써, 상기 제2 채널의 상기 제2 측에 형성된 상기 제2 소스/드레인 전극의 상면을 노출시키는 개구를 형성하고; 산소 플라스마 및/또는 수소 플라스마를 사용하는 반응성 이온 식각(RIE) 공정을 수행하여 상기 노출된 제2 소스/드레인 전극 부분을 제거함으로써, 상기 제2 절연막의 상면을 노출시키도록 상기 개구를 확장하고;불소를 포함하는 식각 가스를 사용하는 제2 건식 식각 공정을 수행하여 상기 제1 및 제2 절연막들을 식각함으로써, 상기 제1 채널의 상기 제2 측에 형성된 상기 제1 소스/드레인 전극의 상면을 노출시키도록 상기 개구를 확장하고; 그리고상기 확장된 개구를 채우는 상기 제3 콘택 플러그를 형성하는 것을 포함하는 반도체 장치 제조 방법
9 9
제 8 항에 있어서, 상기 제1 및 제2 건식 식각 공정들을 수행함에 따라서, 상기 식각 가스에 포함된 불소 성분이 상기 제2 소스/드레인 전극 및 상기 제1 소스/드레인 전극과 각각 결합하여 불화 그래핀을 형성하는 반도체 장치 제조 방법
10 10
기판 상에 형성된 제1 절연막;상기 제1 절연막 상에 형성된 제1 채널;상기 제1 채널의 양 측부들 및 이에 인접한 상기 제1 절연막 부분들의 상면에 각각 접촉하며 그래핀을 포함하는 제1 소스/드레인 전극들;상기 제1 채널 및 상기 제1 소스/드레인 전극들을 커버하며 상기 제1 절연막 상에 형성된 제2 절연막;상기 제2 절연막 상에 형성되며 그래핀을 포함하는 게이트 전극;상기 게이트 전극을 커버하며 상기 제2 절연막 상에 형성된 제3 절연막;상기 제3 절연막 상에 형성된 제2 채널;상기 제2 채널의 양 측부들 및 이에 인접한 상기 제3 절연막 부분들의 상면에 각각 접촉하며 그래핀을 포함하는 제2 소스/드레인 전극들;상기 제2 채널 및 상기 제2 소스/드레인 전극들을 커버하며 상기 제3 절연막 상에 형성된 제4 절연막;상기 제4 절연막을 관통하여, 상기 제2 채널의 제1 측에 형성된 상기 제2 소스/드레인 전극의 상면에 접촉하는 제1 콘택 플러그;상기 제2 내지 제4 절연막들을 관통하여, 상기 제1 채널의 제1 측에 형성된 상기 제1 소스/드레인 전극의 상면에 접촉하는 제2 콘택 플러그;상기 제2 내지 제4 절연막들, 및 상기 제2 채널의 제2 측에 형성된 상기 제2 소스/드레인 전극을 관통하여, 상기 제1 채널의 제2 측에 형성된 상기 제1 소스/드레인 전극의 상면에 접촉하는 제3 콘택 플러그; 및 상기 제3 및 제4 절연막들을 관통하여, 상기 게이트 전극의 상면에 접촉하는 제4 콘택 플러그를 포함하는 반도체 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.