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2단 고속 래치비교기

  • 기술번호 : KST2015158351
  • 담당센터 : 인천기술혁신센터
  • 전화번호 : 032-420-3580
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 래치비교기가 비교기로서 동작을 하지 않는 반주기 클록 동안에도 '하이' 출력이 항상 일정하게 나오도록 함으로써, 고속 동작시 클록 스큐 현상이나 회로내의 지연시간 등으로 인해 타이밍이 맞지 않은 현상을 제거하여 고속 동작시에도 정확하고 신뢰성있는 비교기를 제공할 수 있는 2단 고속 래치비교기에 관한 것으로, 아날로그-디지털 변환기의 비교기에 있어서, 전원전압과 제 1 및 제 2 노드 사이에 전류통로가 각각 연결되며, 타측 드레인단에 게이트단이 연결되어 응답하는 제 1 래치회로부와, 상기 제 1 노드와 접지전압 및 제 2 노드와 접지전압 사이에 전류통로가 각각 연결되며, 타측 드레인단에 게이트단이 연결되어 응답하는 제 2 래치회로부와, 상기 제 1 노드와 접지전압 사이에 전류통로가 연결되되 제 2 래치회로부와 병렬로 설치되어 입력신호와 클록신호를 각각 제공받아 응답하는 제 1 입력회로부와, 상기 제 2 노드와 접지전압 사이에 전류통로가 연결되되 제 2 래치회로부와 병렬로 설치되어 입력신호와 클록신호를 각각 제공받아 응답하는 제 2 입력회로부와, 상기 전원전압과 제 1 출력단 및 제 2 출력단 사이에 전류통로가 각각 연결되되 타측 드레인단에 게이트단이 연결되며 제 1 래치회로부와 병렬로 연결된 제 3 래치회로부와, 상기 제 1 출력단과 접지전압 사이에 전류통로가 연결되되, 상기 제 1 노드에 게이트단이 연결되어 응답하여 임계전압(Vth)을 공통모드 전압에 가깝게 유지하는 제 1 공통전압유지부, 및 상기 제 2 출력단과 접지전압 사이에 전류통로가 연결되되, 상기 제 2 노드에 게이트단이 연결되어 응답하여 임계전압을 공통모드 전압에 가깝게 유지하는 제 2 공통전압유지부,를 포함하여 이루어져 있다.
Int. CL H03M 1/34 (2006.01) H03M 1/12 (2006.01)
CPC H03M 1/34(2013.01) H03M 1/34(2013.01) H03M 1/34(2013.01) H03M 1/34(2013.01)
출원번호/일자 1020050043141 (2005.05.23)
출원인 인하대학교 산학협력단
등록번호/일자 10-0636989-0000 (2006.10.14)
공개번호/일자
공고번호/일자 (20061020) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.05.23)
심사청구항수 8

출원인

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번호 이름 국적 주소
1 인하대학교 산학협력단 대한민국 인천광역시 미추홀구

발명자

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번호 이름 국적 주소
1 윤광섭 대한민국 인천 남구
2 김현철 대한민국 인천 남구

대리인

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번호 이름 국적 주소
1 유완식 대한민국 서울특별시 강남구 테헤란로 ***, **층 *T 국제특허법률사무소 (역삼동, 여삼빌딩)(*T국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 인하대학교 산학협력단 대한민국 인천광역시 남구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2005.05.23 수리 (Accepted) 1-1-2005-0269593-03
2 선행기술조사의뢰서
Request for Prior Art Search
2006.07.10 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2006.08.11 수리 (Accepted) 9-1-2006-0051137-94
4 등록결정서
Decision to grant
2006.09.27 발송처리완료 (Completion of Transmission) 9-5-2006-0562252-71
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.03.07 수리 (Accepted) 4-1-2008-0003929-31
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.06.12 수리 (Accepted) 4-1-2008-5093865-89
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2009.11.17 수리 (Accepted) 4-1-2009-5220324-82
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.07.22 수리 (Accepted) 4-1-2015-5098802-16
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2016.09.05 수리 (Accepted) 4-1-2016-5127132-49
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.03.02 수리 (Accepted) 4-1-2018-5036549-31
11 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.12.27 수리 (Accepted) 4-1-2018-5266647-91
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
아날로그-디지털 변환기의 비교기에 있어서:전원전압과 제 1 노드 및 제 2 노드 사이에 전류통로가 각각 연결되며, 타측 드레인단에 게이트단이 연결(cross coupling)되어 응답하는 제 1 래치회로부;상기 제 1 노드와 접지전압 및 제 2 노드와 접지전압 사이에 전류통로가 각각 연결되며, 타측 드레인단에 게이트단이 연결되어 응답하는 제 2 래치회로부;상기 제 1 노드와 접지전압 사이에 전류통로가 연결되되 제 2 래치회로부와 병렬로 설치되어 입력신호와 클록신호를 각각 제공받아 응답하는 제 1 입력회로부;상기 제 2 노드와 접지전압 사이에 전류통로가 연결되되 제 2 래치회로부와 병렬로 설치되어 입력신호와 클록신호를 각각 제공받아 응답하는 제 2 입력회로부;상기 전원전압과 제 1 출력단 및 제 2 출력단 사이에 전류통로가 각각 연결되되 타측 드레인단에 게이트단이 연결되며 제 1 래치회로부와 병렬로 연결된 제 3 래치회로부;상기 제 1 출력단과 접지전압 사이에 전류통로가 연결되되, 상기 제 1 노드에 게이트단이 연결되어 응답하여 임계전압을 공통모드 전압에 가깝게 유지하는 제 1 공통전압유지부; 및상기 제 2 출력단과 접지전압 사이에 전류통로가 연결되되, 상기 제 2 노드에 게이트단이 연결되어 응답하여 임계전압을 공통모드 전압에 가깝게 유지하는 제 2 공통전압유지부;를 포함하는 것을 특징으로 하는 2단 고속 래치비교기
2 2
청구항 1에 있어서, 상기 제 1 래치회로부는,상기 전원전압과 제 1 노드 사이에 전류통로가 연결되고 상기 제 2 노드와 게이트단이 연결된 제 1 PMOS트랜지스터; 및 상기 전원전압과 제 2 노드 사이에 전류통로가 연결되고 상기 제 1 노드와 게이트단이 연결된 제 2 PMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
3 3
청구항 1에 있어서, 상기 제 2 래치회로부는,상기 제 1 노드와 접지전압 사이에 전류통로가 연결되고 상기 제 2 노드와 게이트단이 연결된 제 1 NMOS트랜지스터; 및 상기 제 2 노드와 접지전압 사이에 전류통로가 연결되고 상기 제 1 노드와 게이트단이 연결된 제 2 NMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
4 4
청구항 1에 있어서, 상기 제 1 입력회로부는,상기 제 1 노드에 전류통로가 연결되되 제 1 NMOS트랜지스터와 병렬로 연결되어 클록신호를 제공받는 제 3 NMOS트랜지스터; 및 상기 제 3 NMOS트랜지스터의 소오스단과 접지전압 사이에 전류통로가 연결되되 입력신호를 제공받는 제 4 NMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
5 5
청구항 1에 있어서, 상기 제 2 입력회로부는,상기 제 2 노드에 전류통로가 연결되되 제 2 NMOS트랜지스터와 병렬로 연결되어 클록신호를 제공받는 제 5 NMOS트랜지스터; 및 상기 제 5 NMOS트랜지스터의 소오스단과 접지전압 사이에 전류통로가 연결되되 입력신호를 제공받는 제 6 NMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
6 6
청구항 1에 있어서, 상기 제 3 래치회로부는,상기 전원전압과 제 1 출력단 사이에 전류통로가 연결되고 상기 제 2 출력단과 게이트단이 연결된 제 3 PMOS트랜지스터; 및 상기 전원전압과 제 2 출력단 사이에 전류통로가 연결되고 상기 제 1 출력단과 게이트단이 연결된 제 4 PMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
7 7
청구항 1에 있어서, 상기 제 1 공통전압유지부는,상기 제 1 출력단에 전류통로가 연결되되 제 1 노드의 신호에 응답하는 제 7 NMOS트랜지스터; 및 상기 제 7 NMOS트랜지스터의 소오스단과 접지전압 사이에 전류통로가 연결되되 제 1 노드의 출력신호에 응답하는 제 8 NMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
8 8
청구항 1에 있어서, 상기 제 2 공통전압유지부는,상기 제 2 출력단에 전류통로가 연결되되 제 2 노드의 신호에 응답하는 제 9 NMOS트랜지스터; 및 상기 제 9 NMOS트랜지스터의 소오스단과 접지전압 사이에 전류통로가 연결되되 제 2 노드의 신호에 응답하는 제 10 NMOS트랜지스터;로 이루어진 것을 특징으로 하는 2단 고속 래치비교기
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.