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암호시스템에 사용하기 위한 클럭 조절 함수를 이용한키스트림 생성 방법

  • 기술번호 : KST2015211150
  • 담당센터 : 부산기술혁신센터
  • 전화번호 : 051-606-6561
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 선형 피드백 시프트레지스터(LFSR)의 클럭 조절을 사용하여 랜덤 키스트림을 생성하는 장치 및 방법이 개시되어 있다.상기 장치의 클럭 조절부는 n개의 LFSR의 비트들로 구성되며, 클럭 조절 함수에 의해 n개의 LFSR 비트들이 연산되며, 연산된 결과 값에 의해 암호 시스템의 LFSR의 클럭을 조절하게 된다. 상기의 LFSR의 피드백된 값은 2개의 메모리 함수 값과 XOR 연산의 통해 암호시스템의 키스트림의 비트들로서 출력한다.랜덤 키스트림, 스트림 암호, 선형 피드백 시프트레지스터(LFSR), 클럭조절
Int. CL G06F 7/70 (2006.01) G06F 7/58 (2006.01)
CPC G06F 7/584(2013.01) G06F 7/584(2013.01) G06F 7/584(2013.01)
출원번호/일자 1020060041730 (2006.05.10)
출원인 동서대학교산학협력단
등록번호/일자
공개번호/일자 10-2007-0109154 (2007.11.15) 문서열기
공고번호/일자
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 거절
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2006.05.10)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 동서대학교 산학협력단 대한민국 부산광역시 사상구

발명자

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번호 이름 국적 주소
1 조상일 대한민국 경남 김해시
2 김봉근 대한민국 부산 금정구
3 이훈재 대한민국 부산 사상구

대리인

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최종권리자

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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2006.05.10 수리 (Accepted) 1-1-2006-0325512-53
2 선행기술조사의뢰서
Request for Prior Art Search
2006.12.12 수리 (Accepted) 9-1-9999-9999999-89
3 선행기술조사보고서
Report of Prior Art Search
2007.01.12 수리 (Accepted) 9-1-2007-0002597-79
4 의견제출통지서
Notification of reason for refusal
2007.09.10 발송처리완료 (Completion of Transmission) 9-5-2007-0489172-15
5 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2007.11.06 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2007-0794732-03
6 거절결정서
Decision to Refuse a Patent
2008.03.10 발송처리완료 (Completion of Transmission) 9-5-2008-0132932-60
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2010.11.23 수리 (Accepted) 4-1-2010-5219186-66
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.04.04 수리 (Accepted) 4-1-2011-5065136-16
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2018.08.21 수리 (Accepted) 4-1-2018-5163918-21
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번호 청구항
1 1
암호시스템에 사용하기 위한 2개 이상의 LFSR을 사용하는 방식에 있어서, 클럭 콘트롤 하기 위한 클럭의 연산을 위한 부분(280)이 있으며, 계산을 하기 위한 비교 부분을 포함하며, 피드백된 비트(231과 241)의 메모리 비트(252와 262)를 포함하며 각각의 연산을 통해 최종 출력 비트를 생성을 특징으로 상기 장치
2 2
제 1항에 있어서, 상기 클럭 콘트롤의 클럭을 연산하기 위한 다항식을 구성됨을 특징으로 하는 상기 장치
3 3
제 1항에 있어서, 상기 클럭 콘트롤 비교를 위해 다항식 출력 결과를 비교하는 부분을 구성됨을 특징
4 4
제 1항에 있어서, 상기 서브 저장부들은 동일한 수의 저장 스테이지들로 구성됨을 특징으로 하는 상기 장치
지정국 정보가 없습니다
패밀리정보가 없습니다
국가 R&D 정보가 없습니다.