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반도체 칩 패키지, 이를 포함하는 반도체 모듈, 전자 시스템 및 반도체 칩 패키지의 제조 방법

  • 기술번호 : KST2014047101
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 반도체 칩 패키지는 제1 반도체 칩 및 복수의 제2 반도체 칩들을 포함한다. 제1 반도체 칩은 메모리 셀들 및 로직 셀들을 구비하는 코어 영역과, 코어 영역에 인접하고 복수의 제1 입출력 패드들을 구비하는 인터페이스 영역을 포함한다. 복수의 제2 반도체 칩들은 서로 대향하는 제 1 면 및 제 2 면과, 제 1 면 및 제 2 면을 연결하는 복수의 측면들을 구비하고, 복수의 제1 입출력 패드들과 전기적으로 연결되는 복수의 제2 입출력 패드들을 구비한다. 복수의 제2 반도체 칩들 각각은, 일측면이 상기 인터페이스 영역과 접합되고 복수의 제2 입출력 패드들이 상응하는 복수의 제1 입출력 패드들과 직접 접촉되도록 인터페이스 영역 상에 배치된다.
Int. CL H05K 7/14 (2006.01) H01L 23/48 (2006.01) H01L 23/12 (2006.01)
CPC
출원번호/일자 1020100129677 (2010.12.17)
출원인 한국과학기술원
등록번호/일자 10-1104380-0000 (2012.01.03)
공개번호/일자
공고번호/일자 (20120116) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2010.12.17)
심사청구항수 14

출원인

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 김정호 대한민국 대전광역시 유성구
2 김기영 대한민국 대전광역시 유성구
3 박준서 대한민국 대전광역시 유성구

대리인

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번호 이름 국적 주소
1 박영우 대한민국 서울특별시 강남구 논현로 ***, *층 **세기특허법률사무소 (역삼동, 세일빌딩)

최종권리자

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번호 이름 국적 주소
1 한국과학기술원 대한민국 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2010.12.17 수리 (Accepted) 1-1-2010-0833216-08
2 등록결정서
Decision to grant
2011.12.29 발송처리완료 (Completion of Transmission) 9-5-2011-0780415-36
3 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.02.01 수리 (Accepted) 4-1-2013-5019983-17
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157993-01
5 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5157968-69
6 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.12.24 수리 (Accepted) 4-1-2014-5158129-58
7 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.04.24 수리 (Accepted) 4-1-2019-5081392-49
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.05.15 수리 (Accepted) 4-1-2020-5108396-12
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2020.06.12 수리 (Accepted) 4-1-2020-5131486-63
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
메모리 셀들 및 로직 셀들을 구비하는 코어 영역과, 상기 코어 영역에 인접하고 복수의 제1 입출력 패드들을 구비하는 인터페이스 영역을 포함하는 제1 반도체 칩; 및서로 대향하는 제 1 면 및 제 2 면과, 상기 제 1 면 및 상기 제 2 면을 연결하는 복수의 측면들을 각각 구비하고, 상기 복수의 제1 입출력 패드들과 전기적으로 연결되는 복수의 제2 입출력 패드들을 각각 구비하는 복수의 제2 반도체 칩들을 포함하고,상기 복수의 제2 반도체 칩들 각각은, 상기 복수의 측면들 중 일측면이 상기 인터페이스 영역과 접합되고 상기 복수의 제2 입출력 패드들이 상응하는 상기 복수의 제1 입출력 패드들과 직접 접촉되도록 상기 인터페이스 영역 상에 배치되는 반도체 칩 패키지
2 2
제 1 항에 있어서, 상기 제1 반도체 칩은 상기 인터페이스 영역에 형성되고 상기 복수의 제2 반도체 칩들을 고정시키는 고정 수단을 더 포함하는 것을 특징으로 하는 반도체 칩 패키지
3 3
제 2 항에 있어서, 상기 고정 수단은 상기 복수의 제2 반도체 칩들이 각각 삽입되는 복수의 소켓들이고, 상기 복수의 제1 입출력 패드들은 상기 복수의 소켓들 내에 형성되는 것을 특징으로 하는 반도체 칩 패키지
4 4
제 2 항에 있어서, 상기 고정 수단은 상기 복수의 제2 반도체 칩들이 각각 삽입되는 복수의 홈부들이고, 상기 복수의 제1 입출력 패드들은 상기 복수의 홈부들 내에 형성되는 것을 특징으로 하는 반도체 칩 패키지
5 5
제 2 항에 있어서, 상기 고정 수단은 상기 복수의 제2 반도체 칩들을 상기 인터페이스 영역에 접착시키는 접착 물질인 것을 특징으로 하는 반도체 칩 패키지
6 6
제 1 항에 있어서, 상기 코어 영역 상에 형성되어 상기 코어 영역에서 발생되는 열을 방출시키는 히트 싱크(heat sink)를 더 포함하는 것을 특징으로 하는 반도체 칩 패키지
7 7
제 1 항에 있어서, 상기 제1 반도체 칩은 프로세서이고, 상기 복수의 제2 반도체 칩들은 메모리 칩들인 것을 특징으로 하는 반도체 칩 패키지
8 8
제 7 항에 있어서, 상기 제1 반도체 칩은 GPU(Graphic Processing Unit)이고, 상기 복수의 제2 반도체 칩들은 DRAM(Dynamic Random Access Memory)인 것을 특징으로 하는 반도체 칩 패키지
9 9
베이스 기판; 및상기 베이스 기판 상에 장착되는 반도체 칩 패키지를 포함하고,상기 반도체 칩 패키지는,메모리 셀들 및 로직 셀들을 구비하는 코어 영역과, 상기 코어 영역에 인접하고 복수의 제1 입출력 패드들을 구비하는 인터페이스 영역을 포함하는 제1 반도체 칩; 및서로 대향하는 제 1 면 및 제 2 면과, 상기 제 1 면 및 상기 제 2 면을 연결하는 복수의 측면들을 각각 구비하고, 상기 복수의 제1 입출력 패드들과 전기적으로 연결되는 복수의 제2 입출력 패드들을 각각 구비하는 복수의 제2 반도체 칩들을 포함하고,상기 복수의 제2 반도체 칩들 각각은, 상기 복수의 측면들 중 일측면이 상기 인터페이스 영역과 접합되고 상기 복수의 제2 입출력 패드들이 상응하는 상기 복수의 제1 입출력 패드들과 직접 접촉되도록 상기 인터페이스 영역 상에 배치되는 반도체 모듈
10 10
제 9 항에 있어서, 상기 제1 반도체 칩은 상기 인터페이스 영역에 형성되고 상기 복수의 제2 반도체 칩들을 고정시키는 고정 수단을 더 포함하는 것을 특징으로 하는 반도체 모듈
11 11
제 9 항에 있어서, 상기 반도체 칩 패키지는 상기 코어 영역 상에 형성되어 상기 코어 영역에서 발생되는 열을 방출시키는 히트 싱크(heat sink)를 더 포함하는 것을 특징으로 하는 반도체 모듈
12 12
제 9 항에 있어서, 상기 반도체 칩 패키지는 상기 제1 반도체 칩 및 상기 복수의 제2 반도체 칩들 상에 형성되는 하우징(housing)을 더 포함하는 것을 특징으로 하는 반도체 모듈
13 13
베이스 기판 및 상기 베이스 기판 상에 장착되는 반도체 칩 패키지를 포함하는 반도체 모듈; 및상기 반도체 모듈과 외부 장치가 통신하도록 상기 반도체 모듈과 상기 외부 장치를 연결시키는 시스템 버스를 포함하고,상기 반도체 칩 패키지는,메모리 셀들 및 로직 셀들을 구비하는 코어 영역과, 상기 코어 영역에 인접하고 복수의 제1 입출력 패드들을 구비하는 인터페이스 영역을 포함하는 제1 반도체 칩; 및서로 대향하는 제 1 면 및 제 2 면과, 상기 제 1 면 및 상기 제 2 면을 연결하는 복수의 측면들을 각각 구비하고, 상기 복수의 제1 입출력 패드들과 전기적으로 연결되는 복수의 제2 입출력 패드들을 각각 구비하는 복수의 제2 반도체 칩들을 포함하고,상기 복수의 제2 반도체 칩들 각각은, 상기 복수의 측면들 중 일측면이 상기 인터페이스 영역과 접합되고 상기 복수의 제2 입출력 패드들이 상응하는 상기 복수의 제1 입출력 패드들과 직접 접촉되도록 상기 인터페이스 영역 상에 배치되는 전자 시스템
14 14
메모리 셀들 및 로직 셀들을 구비하는 코어 영역과, 상기 코어 영역에 인접하고 복수의 제1 입출력 패드들을 구비하는 인터페이스 영역을 포함하는 제1 반도체 칩을 제조하는 단계;서로 대향하는 제 1 면 및 제 2 면과, 상기 제 1 면 및 상기 제 2 면을 연결하는 복수의 측면들을 각각 구비하고, 복수의 제2 입출력 패드들을 각각 구비하는 복수의 제2 반도체 칩들을 제조하는 단계; 및상기 복수의 측면들 중 일측면이 상기 인터페이스 영역과 접합되고 상기 복수의 제2 입출력 패드들이 상응하는 상기 복수의 제1 입출력 패드들과 직접 접촉되어 전기적으로 연결되도록 상기 복수의 제2 반도체 칩들 각각을 상기 인터페이스 영역 상에 배치시키는 단계를 포함하는 반도체 칩 패키지의 제조 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 한국과학기술원 산업원천기술개발사업 웨이퍼레벨 3차원 IC 설계 및 집적기술