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클럭 위상 정렬 장치 및 그 방법

  • 기술번호 : KST2015098403
  • 담당센터 : 대전기술혁신센터
  • 전화번호 : 042-610-2279
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 클럭 위상 정렬 장치 및 그 방법이 개시된다. 본 발명은 버스트 데이터와 시스템 클럭의 동기를 위해 시스템 클럭의 위상을 정렬하는 장치에 있어서, 기준 클럭을 각각 지연하여 N개의 다중 위상 클럭으로 생성하는 클럭 생성부; 다중 위상 클럭을 이용하여 버스트 데이터를 샘플링하고 타이밍 정렬하는 샘플링부; 데이터 변화가 일어나는 다중 위상을 판별하도록 제어 신호에 따라 타이밍 정렬된 데이터의 각 비트를 이웃 비트와 연산하는 위상 비교부; 위상 비교부에서 출력되는 데이터를 누적하고 누적 결과를 선택신호로 매핑하는 신호 결정부; 선택신호에 따라 N개의 다중 위상 클럭 중 하나를 선택하는 멀티플렉서; 및 버스트 데이터의 시작을 알리는 신호 및 누적 결과를 이용하여 제어 신호를 출력하는 위상 비교부에 출력하는 제어부를 포함함을 특징으로 한다.
Int. CL H04L 7/00 (2013.01) H04B 10/00 (2013.01)
CPC H04L 7/0016(2013.01) H04L 7/0016(2013.01) H04L 7/0016(2013.01)
출원번호/일자 1020070091150 (2007.09.07)
출원인 한국전자통신연구원, 한국정보통신대학교 산학협력단
등록번호/일자 10-0895301-0000 (2009.04.21)
공개번호/일자 10-2008-0053171 (2008.06.12) 문서열기
공고번호/일자 (20090507) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보 대한민국  |   1020060125134   |   2006.12.08
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.09.07)
심사청구항수 9

출원인

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 한국정보통신대학교 산학협력단 대한민국 대전광역시 유성구

발명자

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번호 이름 국적 주소
1 강호용 대한민국 대전 서구
2 최현균 대한민국 대전 유성구
3 이루다 대한민국 광주 남구
4 권율 대한민국 부산 금정구
5 이만섭 대한민국 대전 유성구
6 채상훈 대한민국 충남 천안시

대리인

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번호 이름 국적 주소
1 리앤목특허법인 대한민국 서울 강남구 언주로 **길 **, *층, **층, **층, **층(도곡동, 대림아크로텔)

최종권리자

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번호 이름 국적 주소
1 한국전자통신연구원 대한민국 대전광역시 유성구
2 한국과학기술원 대전광역시 유성구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application		 2007.09.07 수리 (Accepted) 1-1-2007-0652655-99
2 [전자문서첨부서류]전자문서첨부서류등 물건제출서
[Attachment to Electronic Document] Submission of Object such as Attachment to Electronic Document		 2007.09.10 수리 (Accepted) 1-1-2007-5078697-25
3 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2007.12.24 수리 (Accepted) 4-1-2007-5193163-24
4 선행기술조사의뢰서
Request for Prior Art Search		 2008.05.07 수리 (Accepted) 9-1-9999-9999999-89
5 선행기술조사보고서
Report of Prior Art Search		 2008.06.13 수리 (Accepted) 9-1-2008-0037718-51
6 등록결정서
Decision to grant		 2009.03.04 발송처리완료 (Completion of Transmission) 9-5-2009-0098910-13
7 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2009.08.04 수리 (Accepted) 4-1-2009-5150899-36
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2015.02.02 수리 (Accepted) 4-1-2015-0006137-44
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
버스트 데이터와 시스템 클럭의 동기를 위해 상기 시스템 클럭의 위상을 정렬하는 장치에 있어서, 기준 클럭을 각각 지연하여 N개의 다중 위상 클럭으로 생성하는 클럭 생성부; 상기 다중 위상 클럭을 이용하여 상기 버스트 데이터를 샘플링하고 타이밍 정렬하는 샘플링부; 데이터 변화가 일어나는 다중 위상을 판별하도록 제어 신호에 따라 상기 타이밍 정렬된 데이터의 각 비트를 이웃 비트와 연산하는 위상 비교부; 상기 위상 비교부에서 출력되는 데이터를 누적하고 누적 결과를 선택신호로 매핑하는 신호 결정부; 상기 선택신호에 따라 상기 N개의 다중 위상 클럭 중 하나를 선택하는 멀티플렉서; 및 상기 버스트 데이터의 시작을 알리는 신호 및 상기 누적 결과를 이용하여 상기 제어 신호를 출력하는 제어부를 포함함을 특징으로 하는 클럭 위상 정렬 장치
2 2
제1항에 있어서, 상기 샘플링부는 상기 버스트 데이터를 N개의 클럭 위상으로 샘플링하는 제1레지스터; 병렬로 연결되어 상기 샘플링된 데이터를 시간 정렬하는 복수의 레지스터들; 및 상기 복수의 레지스터들중 마지막에 위치한 레지스터의 최상위 비트를 입력으로 하는 D-플립플롭을 포함함을 특징으로 하는 클럭 위상 정렬 장치
3 3
제2항에 있어서, 상기 위상 비교부는 상기 레지스터들중 마지막 단의 출력 및 상기 D-플립플롭의 출력을 입력으로 하여 XOR 연산하는 XOR 연산부; 및 상기 제어신호와 상기 XOR연산 결과를 각각 AND 연산하는 AND 연산부를 포함함을 특징으로 하는 클럭 위상 정렬 장치
4 4
제1항 또는 제3항에 있어서, 상기 신호 결정부는 상기 위상 비교부의 출력을 누적하는 누적부; 및 상기 누적된 결과를 M개(단, 2M=N)의 상기 선택신호로 매핑하는 인코더를 포함함을 특징으로 하는 클럭 위상 정렬 장치
5 5
제4항에 있어서, 상기 누적부는 직렬로 연결되는 M개의 D-플립플롭들을 포함하여, 상기 위상 비교부로부터 출력되는 값들을 각각 M번 누적하여 출력하는 것을 특징으로 하는 클럭 위상 정렬 장치
6 6
제5항에 있어서, 상기 누적부는 상기 누적되어 출력된 값들이 모두 입력단자에 연결되고 출력단자는 상기 D-플립플롭들에 각각 연결되어, 상기 누적되어 출력된 값들을 OR연산하여 상기 D-플립플롭들을 리셋하는 OR연산기를 더 포함함을 특징으로 하는 클럭 위상 정렬 장치
7 7
제1항에 있어서, 상기 제어부는 상기 버스트 데이터의 시작을 알리는 신호를 클럭으로 입력받고, 상기 누적된 결과를 OR연산한 결과를 인에이블 신호로 입력받으며, 제1레벨 데이터를 입력 데이터로 하여 상기 제어신호를 출력하는 제1D-플립플롭을 포함함을 특징으로 하는 클럭 위상 정렬 장치
8 8
제7항에 있어서, 상기 제어부는 상기 버스트 데이터의 시작을 알리는 신호를 인에이블 신호로 입력받고, 상기 누적된 결과를 OR연산한 결과를 클럭 신호로 입력받으며, 상기 제1레벨 데이터를 입력 데이터로 하여 상기 멀티플렉서의 인에이블 신호로 출력하는 제2D-플립플롭을 더 포함함을 특징으로 하는 클럭 위상 정렬 장치
9 9
버스트 데이터와 시스템 클럭의 동기를 위해 상기 시스템 클럭의 위상을 정렬하는 방법에 있어서, 기준 클럭을 각각 지연하여 N개의 다중 위상 클럭을 생성하는 단계; 상기 버스트데이터를 상기 다중 위상 클럭을 이용하여 샘플링하고 타이밍 정렬하는 단계; 데이터 변화가 일어나는 다중 위상을 판별하도록 상기 타이밍 정렬된 데이터의 각 비트를 이웃 비트와 연산하는 단계; 연산 결과를 이용하여 선택신호를 생성하는 단계; 및 상기 선택신호에 따라 상기 N개의 다중 위상 클럭 중 하나를 선택하는 단계를 포함함을 특징으로 하는 클럭 위상 정렬 방법
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1 정보통신부 한국전자통신연구원 IT신성장동력핵심기술개발사업 초고속 광가입자망 기술개발