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디스크립터 배열을 이용한 플래시 메모리 제어 시스템 및방법

  • 기술번호 : KST2015160506
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요약 본 발명은 플래시 메모리 기반의 저장장치 시스템의 성능을 극대화 하기 위하여, 디스크립터 배열을 이용한 플래시 메모리 제어 시스템 및 방법에 관한 것이다. 본 발명에서 제안하는 플래시 메모리 제어 시스템은 기존 플래시 메모리 기반의 저장 장치 시스템에서의 성능상의 병목을 일으키는 주요 원인이 되어왔던 프로세서의 오버헤드를 최소화 하기 위해 디스크립터 배열(descriptor array)기반의 직접 메모리 접근(DMA, direct memory access) 처리 방식을 채택한다. 이러한 방식을 통해 여러 개의 작은 단위의 작업들을 하나의 큰 단위의 작업으로 묶어서 한꺼번에 하드웨어가 처리하도록 함으로써 프로세서의 오버헤드를 최소화할 수 있다. 또한, 이러한 DMA기능을 지원하는 제어장치를 여러 개 두고 각각의 제어장치가 서로 다른 플래시 칩에 동시에 작업을 수행할 수 있도록 함으로써 여러 개의 칩으로 구성된 플래시 저장장치 시스템에서의 병렬 성을 최대화 하도록 한다. 마지막으로 이러한 서로 다른 제어장치들 사이의 우선순위를 두고 저장장치 시스템의 사용자가 체감하는 반응속도를 결정할 수 있는 중요한 작업을 실행하려는 제어장치가 그렇지 않은 제어장치를 선점할 수 있도록 함으로써 사용자의 요청에 대한 전체 플래시 메모리 제어시스템의 지연시간을 최소화 한다.플래시 메모리, DMA, 디스크립터 배열(descriptor array), 제어, 인터페이스
Int. CL G11C 16/00 (2006.01)
CPC
출원번호/일자 1020070011751 (2007.02.05)
출원인 지인정보기술 주식회사, 재단법인서울대학교산학협력재단
등록번호/일자 10-0869675-0000 (2008.11.14)
공개번호/일자 10-2008-0073128 (2008.08.08) 문서열기
공고번호/일자 (20081121) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2007.02.05)
심사청구항수 23

출원인

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번호 이름 국적 주소
1 지인정보기술 주식회사 대한민국 서울특별시 관악구
2 재단법인서울대학교산학협력재단 대한민국 서울특별시 관악구

발명자

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번호 이름 국적 주소
1 민상렬 대한민국 서울시 서대문구
2 성윤제 대한민국 서울시 강남구
3 김성관 대한민국 서울시 관악구
4 한주선 대한민국 서울시 관악구

대리인

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번호 이름 국적 주소
1 천성진 대한민국 서울특별시 강남구 언주로 ***, *층(역삼동,화물재단빌딩)(특허법인 무한)

최종권리자

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1 재단법인서울대학교산학협력재단 대한민국 서울특별시 관악구
2 지인정보기술 주식회사 대한민국 서울특별시 관악구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2007.02.05 수리 (Accepted) 1-1-2007-0107529-16
2 보정요구서
Request for Amendment
2007.02.20 발송처리완료 (Completion of Transmission) 1-5-2007-0022298-20
3 서지사항보정서
Amendment to Bibliographic items
2007.03.16 수리 (Accepted) 1-1-2007-0214959-12
4 출원인정보변경(경정)신고서
Notification of change of applicant's information
2008.01.29 수리 (Accepted) 4-1-2008-5015497-73
5 의견제출통지서
Notification of reason for refusal
2008.02.27 발송처리완료 (Completion of Transmission) 9-5-2008-0104869-80
6 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2008.03.06 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2008-0166177-99
7 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2008.03.06 수리 (Accepted) 1-1-2008-0166175-08
8 등록결정서
Decision to grant
2008.08.14 발송처리완료 (Completion of Transmission) 9-5-2008-0425143-47
9 출원인정보변경(경정)신고서
Notification of change of applicant's information
2014.08.22 수리 (Accepted) 4-1-2014-5100909-62
10 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.03.20 수리 (Accepted) 4-1-2015-5036045-28
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
프로세서로부터 하나 이상의 작업에 대응되는 하나 이상의 디스크립터(descriptor)를 포함하는 디스크립터 배열(descriptor array)을 수신하는 디스크립터 배열 수신부; 및상기 디스크립터 배열에 포함된 디스크립터를 확인하고 상기 확인한 디스크립터에 포함된 플래시 메모리 제어 명령을 수행하는 플래시 메모리 제어부를 포함하고,상기 플래시 메모리 제어부는 상기 프로세서의 동작에 독립적으로 상기 플래시 메모리 제어 명령을 수행하는 것을 특징으로 하는 플래시 메모리 제어 시스템
2 2
제1항에 있어서,상기 플래시 메모리 제어 명령은 지우기 명령, 프로그램 명령 또는 읽기 명령을 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
3 3
제1항에 있어서,상기 디스크립터는 상기 디스크립터가 포함하는 플래시 메모리 제어 명령의 대상이 되는 플래시 메모리의 페이지 주소를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
4 4
제1항에 있어서,상기 디스크립터는 상기 디스크립터가 포함하는 플래시 메모리 제어 명령의 대상이 되는 플래시 메모리의 블록 주소를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
5 5
제1항에 있어서,상기 디스크립터는 플래시 메모리에 기록하기 위한 데이터가 저장된 메모리 정보를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
6 6
제1항에 있어서,상기 디스크립터는 플래시 메모리로부터 읽은 데이터를 저장할 메모리 정보를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
7 7
제5항 또는 제6항에 있어서,상기 메모리 정보는 복수의 메모리 주소를 링크드 리스트(linked list) 형태로 연결한 데이터 구조를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
8 8
제1항에 있어서,상기 플래시 메모리 제어 명령은,포어그라운드 플래시 메모리 제어 명령 및 백그라운드 플래시 메모리 제어 명령을 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
9 9
제8항에 있어서,상기 포어그라운드 플래시 메모리 제어 명령은 백그라운드 플래시 메모리 제어 명령보다 빠른 시간에 응답해야 하는 플래시 메모리 제어 명령인 것을 특징으로 하는 플래시 메모리 제어 시스템
10 10
제8항에 있어서,상기 플래시 메모리 제어부는,상기 디스크립터 배열에 포함된 디스크립터 중 포어그라운드 플래시 메모리 제어 명령을 포함하는 디스크립터를 우선적으로 처리하는 것을 특징으로 하는 플래시 메모리 제어 시스템
11 11
제8항에 있어서,상기 플래시 메모리 제어부는,포어그라운드 플래시 메모리 제어 명령을 처리하는 포어그라운드 플래시 메모리 제어부; 및백그라운드 플래시 메모리 제어 명령을 처리하는 백그라운드 플래시 메모리 제어부를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
12 12
제11항에 있어서,상기 백그라운드 플래시 메모리 제어부는,하나 이상의 서브 플래시 메모리 제어부를 포함하고,상기 하나 이상의 서브 플래시 메모리 제어부는 각각 독립적으로 동작하는 것을 특징으로 하는 플래시 메모리 제어 시스템
13 13
제12항에 있어서,상기 백그라운드 플래시 메모리 제어부는,상기 하나 이상의 서브 플래시 메모리 제어부의 동작을 제어하는 시퀀서(sequencer)를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
14 14
프로세서로부터 포어그라운드 플래시 메모리 제어 명령 및 백그라운드 플래시 메모리 제어 명령을 포함하는 플래시 메모리 제어 명령을 수신하는 플래시 메모리 제어 명령 수신부;상기 포어그라운드 플래시 메모리 제어 명령을 처리하는 포어그라운드 플래시 메모리 제어부; 및상기 백그라운드 플래시 메모리 제어 명령을 처리하는 백그라운드 플래시 메모리 제어부를 포함하고, 상기 포어그라운드 플래시 메모리 제어부 및 상기 백그라운드 플래시 메모리 제어부는 병렬적으로 상기 플래시 메모리 제어 명령을 처리하는 것을 특징으로 하는 플래시 메모리 제어 시스템
15 15
제14항에 있어서,상기 포어그라운드 플래시 메모리 제어 명령은 백그라운드 플래시 메모리 제어 명령보다 빠른 시간에 응답해야 하는 플래시 메모리 제어 명령인 것을 특징으로 하는 플래시 메모리 제어 시스템
16 16
제14항에 있어서,상기 백그라운드 플래시 메모리 제어부는,하나 이상의 서브 플래시 메모리 제어부를 포함하고,상기 하나 이상의 서브 플래시 메모리 제어부는 각각 독립적으로 동작하는 것을 특징으로 하는 플래시 메모리 제어 시스템
17 17
제16항에 있어서,상기 백그라운드 플래시 메모리 제어부는,상기 하나 이상의 서브 플래시 메모리 제어부의 동작을 제어하는 시퀀서(sequencer)를 포함하는 것을 특징으로 하는 플래시 메모리 제어 시스템
18 18
프로세서로부터 하나 이상의 작업에 대응되는 하나 이상의 디스크립터(descriptor)를 포함하는 디스크립터 배열(descriptor array)을 수신하는 단계; 및상기 디스크립터 배열에 포함된 디스크립터를 확인하고 상기 확인한 디스크립터에 포함된 플래시 메모리 제어 명령을 수행하는 단계를 포함하고,상기 플래시 메모리 제어 명령을 수행하는 단계는 상기 프로세서의 동작에 독립적으로 상기 플래시 메모리 제어 명령을 수행하는 것을 특징으로 하는 플래시 메모리 제어 방법
19 19
제18항에 있어서,상기 플래시 메모리 제어 명령은 지우기 명령, 프로그램 명령 또는 읽기 명령을 포함하는 것을 특징으로 하는 플래시 메모리 제어 방법
20 20
제18항에 있어서,상기 플래시 메모리 제어 명령은,포어그라운드 플래시 메모리 제어 명령 및 백그라운드 플래시 메모리 제어 명령을 포함하는 것을 특징으로 하는 플래시 메모리 제어 방법
21 21
제20항에 있어서,상기 포어그라운드 플래시 메모리 제어 명령은 백그라운드 플래시 메모리 제어 명령보다 빠른 시간에 응답해야 하는 플래시 메모리 제어 명령인 것을 특징으로 하는 플래시 메모리 제어 방법
22 22
제20항에 있어서,상기 플래시 메모리 제어 명령을 수행하는 단계는,상기 디스크립터 배열에 포함된 디스크립터 중 포어그라운드 플래시 메모리 제어 명령을 포함하는 디스크립터를 우선적으로 처리하는 것을 특징으로 하는 플래시 메모리 제어 방법
23 23
제18항 내지 제22항 중 어느 한 항의 방법을 실행시키기 위한 프로그램을 기록한 컴퓨터 판독 가능한 기록매체
지정국 정보가 없습니다
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순번 패밀리번호 국가코드 국가명 종류
1 US08296505 US 미국 FAMILY
2 US20100100666 US 미국 FAMILY
3 WO2008096968 WO 세계지적재산권기구(WIPO) FAMILY

DOCDB 패밀리 정보

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1 US2010100666 US 미국 DOCDBFAMILY
2 US8296505 US 미국 DOCDBFAMILY
3 WO2008096968 WO 세계지적재산권기구(WIPO) DOCDBFAMILY
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