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메모리 구조에 따른 메모리 관리 장치

  • 기술번호 : KST2015134951
  • 담당센터 : 서울동부기술혁신센터
  • 전화번호 : 02-2155-3662
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 메모리 관리 장치는 비휘발성(Nonvolatile)이고 복수의 페이지들로 구성된 실행가능한 코드를 저장하는 제1 메모리, 휘발성(volatile)이고 제1 및 제2 메모리 공간들을 포함하며, 상기 제1 및 제2 메모리 공간들은 메모리 관리 정책에 따라 구분되며 상기 복수의 페이지들의 배타적인 부분 집합을 각각 저장하는 제2 메모리 및 상기 제1 및 제2 메모리 공간들을 동적으로 제어하는 메모리 제어부를 포함한다. 따라서 메모리 관리 장치는 비휘발성 램에 저장된 실행 가능한 코드를 효율적으로 실행할 수 있다.
Int. CL G06F 3/06 (2006.01.01) G06F 12/123 (2016.01.01) G06F 12/02 (2018.01.01) G06F 12/1009 (2016.01.01) G06F 9/30 (2018.01.01)
CPC G06F 3/0685(2013.01) G06F 3/0685(2013.01) G06F 3/0685(2013.01) G06F 3/0685(2013.01) G06F 3/0685(2013.01)
출원번호/일자 1020080110508 (2008.11.07)
출원인 서울대학교산학협력단
등록번호/일자 10-0987332-0000 (2010.10.06)
공개번호/일자 10-2010-0051369 (2010.05.17) 문서열기
공고번호/일자 (20101018) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 등록
심사진행상태 수리
심판사항
구분 신규
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2008.11.07)
심사청구항수 16

출원인

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번호 이름 국적 주소
1 서울대학교산학협력단 대한민국 서울특별시 관악구

발명자

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번호 이름 국적 주소
1 이창건 대한민국 서울특별시 서초구
2 김종찬 대한민국 경기도 안양시 동안구
3 이두희 대한민국 경기도 수원시 영통구

대리인

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번호 이름 국적 주소
1 정부연 대한민국 서울특별시 서초구 반포대로**길 ** ***동 ***,***호(서초동, 한빛위너스)(현신특허사무소)

최종권리자

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번호 이름 국적 주소
1 서울대학교산학협력단 대한민국 서울특별시 관악구
번호, 서류명, 접수/발송일자, 처리상태, 접수/발송일자의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 행정처리 표입니다.
번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 [특허출원]특허출원서
[Patent Application] Patent Application
2008.11.07 수리 (Accepted) 1-1-2008-0773097-16
2 보정요구서
Request for Amendment
2008.11.11 발송처리완료 (Completion of Transmission) 1-5-2008-0126014-22
3 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2008.11.27 수리 (Accepted) 1-1-2008-0818084-12
4 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2009.01.13 수리 (Accepted) 1-1-2009-0020569-38
5 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2009.03.13 수리 (Accepted) 1-1-2009-0152631-89
6 선행기술조사의뢰서
Request for Prior Art Search
2009.05.08 수리 (Accepted) 9-1-9999-9999999-89
7 선행기술조사보고서
Report of Prior Art Search
2009.06.18 수리 (Accepted) 9-1-2009-0038147-04
8 [대리인사임]대리인(대표자)에 관한 신고서
[Resignation of Agent] Report on Agent (Representative)
2009.07.28 수리 (Accepted) 1-1-2009-0461126-03
9 의견제출통지서
Notification of reason for refusal
2010.01.29 발송처리완료 (Completion of Transmission) 9-5-2010-0041400-39
10 [거절이유 등 통지에 따른 의견]의견(답변, 소명)서
[Opinion according to the Notification of Reasons for Refusal] Written Opinion(Written Reply, Written Substantiation)
2010.03.26 수리 (Accepted) 1-1-2010-0192535-44
11 [명세서등 보정]보정서
[Amendment to Description, etc.] Amendment
2010.03.26 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2010-0192533-53
12 등록결정서
Decision to grant
2010.07.29 발송처리완료 (Completion of Transmission) 9-5-2010-0328017-53
13 [출원서등 보정]보정서
[Amendment to Patent Application, etc.] Amendment
2010.10.06 수리 (Accepted) 1-1-2010-0643995-89
14 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.09.27 수리 (Accepted) 4-1-2011-5195109-43
15 출원인정보변경(경정)신고서
Notification of change of applicant's information
2013.01.14 수리 (Accepted) 4-1-2013-5007213-54
16 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.03.17 수리 (Accepted) 4-1-2015-5033829-92
17 출원인정보변경(경정)신고서
Notification of change of applicant's information
2015.05.13 수리 (Accepted) 4-1-2015-5062924-01
18 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.05.13 수리 (Accepted) 4-1-2019-5093546-10
19 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.05.23 수리 (Accepted) 4-1-2019-5101798-31
20 출원인정보변경(경정)신고서
Notification of change of applicant's information
2019.08.02 수리 (Accepted) 4-1-2019-5154561-59
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
비휘발성(Nonvolatile)이고 복수의 페이지들로 구성된 실행가능한 코드를 저장하는 제1 메모리; 휘발성(volatile)이고 제1 및 제2 메모리 공간들을 포함하며, 상기 제1 및 제2 메모리 공간들은 메모리 관리 정책에 따라 구분되고 상기 복수의 페이지들의 배타적인 부분 집합을 각각 저장하는 제2 메모리; 실행 인스턴스(실행 인스턴스는 실행 가능한 코드에 포함됨) 별로 상기 제1 및 제2 메모리 공간들의 크기를 결정하여 상기 제1 및 제2 메모리 공간들을 동적으로 제어하는 메모리 제어부; 및 상기 실행가능한 코드를 실행하는 프로세서를 포함하고, 상기 제2메모리는 페이지 매핑 정보를 포함하며, 상기 페이지 매핑 정보는 상기 실행가능한 코드가 미리 실행되거나 상기 실행 가능한 코드가 컴파일될 때 결정되고, 상기 페이지 매핑 정보는 상기 제1 메모리 공간의 크기에 관한 정보, 상기 제1 메모리 공간에 배치될 적어도 하나의 페이지에 관한 정보 및 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하거나 또는 상기 제1 메모리 공간에 페이지의 삽입, 삭제 및 대체에 관한 정보와 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하는 메모리 관리 장치
2 2
제1항에 있어서, 상기 메모리 제어부는 메모리 고정(Memory Pinning) 정책에 따라 상기 제1 메모리 공간을 관리하는 것을 특징으로 하는 메모리 관리 장치
3 3
제2항에 있어서, 상기 메모리 제어부는 LRU(Least Recently Used) 정책, LFU(Least Frequently Used) 정책 또는 FIFO(First-In First-Out) 정책에 따라 상기 제2 메모리 공간을 관리하는 것을 특징으로 하는 메모리 관리 장치
4 4
제1항에 있어서, 상기 메모리 제어부는 상기 실행가능한 코드의 시간적 계획을 기초로 적어도 하나의 실행 인스턴스를 결정하고, 허용가능한 페이지 폴트 수를 기초로 상기 실행 인스턴스 별로 상기 제1 및 제2 메모리 공간들의 크기를 결정하는 것을 특징으로 하는 메모리 관리 장치
5 5
삭제
6 6
제1 메모리; 상기 제1 메모리보다 빠르게 동작하며, 메모리 관리 정책에 따라 구분되는 제1 및 제2 메모리 공간들을 포함하는 제2 메모리; 실행 인스턴스(실행 인스턴스는 실행 가능한 코드에 포함됨) 별로 상기 제1 및 제2 메모리 공간들의 크기를 결정하여 상기 제1 및 제2 메모리 공간들을 동적으로 제어하는 메모리 제어부; 및 상기 실행가능한 코드를 실행하는 프로세서를 포함하고, 상기 제2메모리는 페이지 매핑 정보를 포함하며, 상기 페이지 매핑 정보는 상기 실행가능한 코드가 미리 실행되거나 상기 실행 가능한 코드가 컴파일될 때 결정되고, 상기 페이지 매핑 정보는 상기 제1 메모리 공간의 크기에 관한 정보, 상기 제1 메모리 공간에 배치될 적어도 하나의 페이지에 관한 정보 및 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하거나 또는 상기 제1 메모리 공간에 페이지의 삽입, 삭제 및 대체에 관한 정보와 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하는 메모리 관리 장치
7 7
제6항에 있어서, 상기 메모리 제어부는 소정의 조건하에서 상기 제1 및 제2 메모리 공간들의 전체 크기가 가장 작도록 상기 제1 및 제2 메모리 공간들의 상대적 크기를 결정하는 것을 특징으로 하는 메모리 관리 장치
8 8
제7항에 있어서, 상기 소정의 조건은 허용가능한 페이지 폴트 수(tolerable page fault count)를 기초로 결정되는 것을 특징으로 하는 메모리 관리 장치
9 9
제6항에 있어서, 상기 제2 메모리는 실행 가능한 코드를 저장하기 위한 제1 영역; 및 상기 실행 가능한 코드의 페이지 매핑 정보를 저장하기 위한 제2 영역을 포함하는 것을 특징으로 하는 메모리 관리 장치
10 10
제9항에 있어서, 상기 메모리 제어부는 상기 페이지 매핑 정보를 기초로 상기 제1 및 제2 메모리 공간들의 전체 크기와 상대적 크기를 결정하는 것을 특징으로 하는 메모리 관리 장치
11 11
삭제
12 12
삭제
13 13
삭제
14 14
제1 메모리; 상기 제1 메모리보다 빠르게 동작하며, 메모리 관리 정책에 따라 구분되는 제1 및 제2 메모리 공간들을 포함하는 제2 메모리; 상기 제2 메모리 공간의 접근 시간 비용과 상기 제2 메모리 공간의 공간 비용을 고려하여 실행 인스턴스(실행 인스턴스는 실행 가능한 코드에 포함됨) 별로 상기 제1 및 제2 메모리 공간들을 제어하는 메모리 제어부; 및 상기 실행가능한 코드를 실행하는 프로세서를 포함하고, 상기 제2메모리는 페이지 매핑 정보를 포함하며, 상기 페이지 매핑 정보는 상기 실행가능한 코드가 미리 실행되거나 상기 실행 가능한 코드가 컴파일될 때 결정되고, 상기 페이지 매핑 정보는 상기 제1 메모리 공간의 크기에 관한 정보, 상기 제1 메모리 공간에 배치될 적어도 하나의 페이지에 관한 정보 및 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하거나 또는 상기 제1 메모리 공간에 페이지의 삽입, 삭제 및 대체에 관한 정보와 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하는 메모리 관리 장치
15 15
제14항에 있어서, 상기 메모리 제어부는 상기 접근 시간 비용을 고려하여 상기 제1 및 제2 메모리 공간들의 전체 크기가 가장 작도록 상기 제1 및 제2 메모리 공간들의 상대적 크기를 결정하는 것을 특징으로 하는 메모리 관리 장치
16 16
제15항에 있어서, 상기 제1 메모리는 플래시 메모리에 상응하는 것을 특징으로 하는 메모리 관리 장치
17 17
복수의 페이지들로 구성된 실행가능한 코드를 실행하는 프로세서; 상기 실행가능한 코드를 저장하는 제1 메모리; 상기 제1 메모리보다 빠르게 동작하고, 메모리 관리 정책에 따라 구분되며 상기 복수의 페이지들의 배타적인 부분 집합을 각각 저장하는 제1 및 제2 메모리 공간들을 포함하는 제2 메모리; 및 실행 인스턴스(실행 인스턴스는 실행 가능한 코드에 포함됨) 별로 상기 제1 및 제2 메모리 공간들의 크기를 결정하여 상기 제1 및 제2 메모리 공간들을 동적으로 제어하는 메모리 제어부를 포함하고, 상기 제2메모리는 페이지 매핑 정보를 포함하며, 상기 페이지 매핑 정보는 상기 실행가능한 코드가 미리 실행되거나 상기 실행 가능한 코드가 컴파일될 때 결정되고, 상기 페이지 매핑 정보는 상기 제1 메모리 공간의 크기에 관한 정보, 상기 제1 메모리 공간에 배치될 적어도 하나의 페이지에 관한 정보 및 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하거나 또는 상기 제1 메모리 공간에 페이지의 삽입, 삭제 및 대체에 관한 정보와 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하는 컴퓨팅 시스템
18 18
실행가능한 코드(복수의 페이지들을 포함함)를 실행하는 프로세서, 제1 및 제2 메모리들(상기 제1 메모리는 상기 실행가능한 코드를 저장하고, 상기 제2 메모리는 메모리 관리 정책에 따라 구분되는 제1 및 제2 메모리 공간들을 포함함)과 메모리 제어부(실행 인스턴스(실행 인스턴스는 실행 가능한 코드에 포함됨) 별로 상기 제1 및 제2 메모리 공간들의 크기를 결정하여 상기 제1 및 제2 메모리 공간들을 동적으로 제어함)를 포함하고, 상기 제2메모리는 페이지 매핑 정보를 포함하며, 상기 페이지 매핑 정보는 상기 실행가능한 코드가 미리 실행되거나 상기 실행 가능한 코드가 컴파일될 때 결정되고, 상기 페이지 매핑 정보는 상기 제1 메모리 공간의 크기에 관한 정보, 상기 제1 메모리 공간에 배치될 적어도 하나의 페이지에 관한 정보 및 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하거나 또는 상기 제1 메모리 공간에 페이지의 삽입, 삭제 및 대체에 관한 정보와 상기 제2 메모리 공간의 크기를 결정하기 위한 정보를 포함하는 컴퓨팅 시스템에서, 상기 컴퓨팅 시스템에 의한 상기 제1 및 제2 메모리들을 효율적으로 관리하는 방법은 상기 프로세서는 필요한 페이지를 상기 메모리 제어부에게 요청하는 단계; 상기 메모리 제어부는 상기 제1 메모리에서 상기 필요한 페이지를 검색하는 단계; 및 만일 상기 필요한 페이지가 상기 제1 메모리에서 검색되는 경우에는 (a1) 상기 메모리 제어부는 상기 제1 메모리로부터 상기 필요한 페이지를 읽는 단계; 및 (a2) 상기 메모리 제어부는 상기 프로세서에 상기 읽은 페이지를 전송하는 단계를 포함하는 상기 컴퓨팅 시스템에 의한 상기 제1 및 제2 메모리들을 효율적으로 관리하는 방법
19 19
제18항에 있어서, 만일 상기 필요한 페이지가 상기 제1 메모리에서 검색되지 않은 경우에는 (b1) 상기 메모리 제어부는 상기 제2 메모리로부터 상기 필요한 페이지를 읽는 단계; 및 (b2) 상기 메모리 제어부는 상기 프로세서에 상기 읽은 페이지를 전송하는 단계를 더 포함하는 것을 특징으로 하는 상기 컴퓨팅 시스템에 의한 상기 제1 및 제2 메모리들을 효율적으로 관리하는 방법
20 20
제19항에 있어서, (b3) 상기 메모리 제어부는 (b2) 단계 전 또는 후에 상기 읽은 페이지를 상기 메모리 관리 정책에 따라 상기 제1 메모리에 저장하는 단계를 더 포함하는 것을 특징으로 하는 상기 컴퓨팅 시스템에 의한 상기 제1 및 제2 메모리들을 효율적으로 관리하는 방법
지정국 정보가 없습니다
패밀리정보가 없습니다
순번, 연구부처, 주관기관, 연구사업, 연구과제의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 국가R&D 연구정보 정보 표입니다.
순번 연구부처 주관기관 연구사업 연구과제
1 지식경제부 전남대학교 산학협력단 대학 IT연구센터 육성·지원 사업 차세대 휴대폰용 지능형 사용자 인터페이스 플랫폼 기술개발