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혼합형 가산기

  • 기술번호 : KST2014009764
  • 담당센터 : 광주기술혁신센터
  • 전화번호 : 062-360-4654
요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 본 발명은 설계 비용의 최적화가 가능한 가산기에 관한 것으로, 전체 비트폭이 I개(단, I는 1보다 큰 양수)의 비트 그룹으로 분할되어 I개의 하부가산기에 각각 할당되고, 상기 I개의 하부가산기는 각각 서로 다른 캐리전달 방식을 가지는 가산기로서 캐리신호를 통하여 선형으로 연결된 구조를 특징으로 하는 혼합형 가산기를 제공한다. 가산기, 혼합형
Int. CL G06F 7/50 (2006.01)
CPC
출원번호/일자 1020040085014 (2004.10.22)
출원인 광주과학기술원
등록번호/일자 10-0714316-0000 (2007.04.26)
공개번호/일자 10-2006-0035494 (2006.04.26) 문서열기
공고번호/일자 (20070502) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항 심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2004.10.22)
심사청구항수 6

출원인

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번호 이름 국적 주소
1 광주과학기술원 대한민국 광주광역시 북구

발명자

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번호 이름 국적 주소
1 이정아 대한민국 광주광역시 북구
2 김기선 대한민국 광주광역시 북구
3 이정근 대한민국 강원도 춘천시
4 김석진 대한민국 서울특별시 마포구

대리인

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번호 이름 국적 주소
1 황이남 대한민국 서울시 송파구 법원로 ***, ****호 (문정동, 대명벨리온지식산업센터)(아시아나국제특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 광주과학기술원 대한민국 광주광역시 북구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application
2004.10.22 수리 (Accepted) 1-1-2004-0484290-72
2 의견제출통지서
Notification of reason for refusal
2006.05.18 발송처리완료 (Completion of Transmission) 9-5-2006-0282836-34
3 명세서등보정서
Amendment to Description, etc.
2006.07.18 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0510137-29
4 의견서
Written Opinion
2006.07.18 수리 (Accepted) 1-1-2006-0510138-75
5 거절결정서
Decision to Refuse a Patent
2006.12.28 발송처리완료 (Completion of Transmission) 9-5-2006-0781379-96
6 명세서 등 보정서(심사전치)
Amendment to Description, etc(Reexamination)
2007.02.27 보정승인 (Acceptance of amendment) 7-1-2007-0007924-10
7 등록결정서
Decision to grant
2007.03.30 발송처리완료 (Completion of Transmission) 9-5-2007-0178272-66
8 출원인정보변경(경정)신고서
Notification of change of applicant's information
2011.09.15 수리 (Accepted) 4-1-2011-5187089-85
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번호 청구항
1 1
가수 및 피가수의 전체 비트폭이 n 일때 상기 전체 비트폭을 I개(단, I는 1보다 큰 양수)의 비트그룹으로 분할하고, 상기 각 비트그룹은 I개의 하부가산기에 순차적으로 할당되며, 상기 I개의 하부가산기는 각각 서로 다른 캐리전달 방식을 가지고, 상기 각각의 하부가산기는 이전 가산기에서 전달되는 캐리신호를 선형으로 입력받는 캐리입력부(Cin)와, 할당된 비트값과 캐리 입력신호를 가산 연산한 후 서로 다른 캐리 전달 방식으로 상기 발생하는 캐리신호를 다음 가산기로 선형으로 출력하는 캐리출력부(Cout), 및 상기 각 가산기에서 가산된 합계출력(SUM)을 출력하는 합계출력부를 포함하는 구조를 특징으로 하는 혼합형 가산기
2 2
제 1항에 있어서, 각 가산기는 디지털 표현방식은 이진수인 경우의 0,1을 포함하여 특정 자연수 R진수인 경우의 0 내지 (R-1)로 이루어진 그룹에서 어느 하나의 방식으로 표현되는 것을 특징으로 하는 혼합형 가산기
3 3
제 1항에 있어서, 각 가산기는 파동형 캐리 전달 가산기(Ripple Carry Adder, RCA), 캐리-도약 가산기(Carry Skip Adder, CSKA)), 캐리-선택 가산기(Carry Select Adder), 캐리-미리보기 가산기(Carry Lookahead Adder, CLA), 캐리-미리보기 트리 가산기(Carry Look-ahead Tree Adder, CLTA), 조건 합 가산기(Conditional Sum Adder, CSA), 브렌트-쿵 가산기 및 프리픽스 가산기(Prefix Adder, PA)로 구성된 그룹에서 선택되는 것을 특징으로 하는 혼합형 가산기
4 4
제1항에 있어서, 혼합형 가산기는 I개의 각 비트 폭의 합이 전체 비트 폭이 되도록 각각의 비트폭 파라미터가 조절되어진 가산기 IP를 포함하는 혼합형 가산기
5 5
제 1항에 있어서, 회로사용량(A)이 최소화되도록 하기 조건을 만족하는 혼합형 가산기lb_T≤T≤ub_T, n= 상기에서 lb_T는 최소지연처리시간이고, ub_T는 최대지연처리시간이며, T는 혼합형 가산기의 가산처리지연시간이다
6 6
제 1항에 있어서, 가산처리지연시간(T)이 최소화되도록 하기 조건을 만족하는 혼합형 가산기lb_A≤A≤ub_A, n= 상기에서 lb_A는 최소 회로사용량이고, ub_A는 최대 회로사용량이며, A는 혼합형 가산기의 회로사용량이다
7 6
제 1항에 있어서, 가산처리지연시간(T)이 최소화되도록 하기 조건을 만족하는 혼합형 가산기lb_A≤A≤ub_A, n= 상기에서 lb_A는 최소 회로사용량이고, ub_A는 최대 회로사용량이며, A는 혼합형 가산기의 회로사용량이다
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1 EP01650647 EP 유럽특허청(EPO) FAMILY
2 EP01650647 EP 유럽특허청(EPO) FAMILY
3 US07562107 US 미국 FAMILY
4 US20060089961 US 미국 FAMILY

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1 EP1650647 EP 유럽특허청(EPO) DOCDBFAMILY
2 EP1650647 EP 유럽특허청(EPO) DOCDBFAMILY
3 US2006089961 US 미국 DOCDBFAMILY
4 US7562107 US 미국 DOCDBFAMILY
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