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동화상 인코더를 위한 정수 변환 장치

  • 기술번호 : KST2015174640
  • 담당센터 : 광주기술혁신센터
  • 전화번호 : 062-360-4654
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요약, Int. CL, CPC, 출원번호/일자, 출원인, 등록번호/일자, 공개번호/일자, 공고번호/일자, 국제출원번호/일자, 국제공개번호/일자, 우선권정보, 법적상태, 심사진행상태, 심판사항, 구분, 원출원번호/일자, 관련 출원번호, 기술이전 희망, 심사청구여부/일자, 심사청구항수의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 서지정보 표입니다.
요약 H.264와 같은 동화상 압축 기술에서 예측 에러에 대한 정수 변환을 수행하는 정수 변환 장치를 제시한다.본 발명의 정수 변환 장치는 입력 데이터에 대하여 가산 또는 감산 연산을 각각 수행하여 지정된 비트 수만큼 증가한 비트 수를 갖는 데이터를 출력하는 복수의 가산기 및 감산기를 포함하는 제 1 가감산단, 제 1 가감산단 출력 데이터의 쉬프트 연산 수행 결과에 대하여 가산 또는 감산 연산을 각각 수행하여 지정된 비트 수만큼 증가한 비트 수를 갖는 데이터를 출력하는 복수의 가산기 및 감산기를 포함하는 제 2 가감산단, 제 2 가감산단의 출력 데이터에 대하여 가산 또는 감산 연산을 수행하여 지정된 비트 수만큼 증가한 비트 수를 갖는 데이터를 출력하는 복수의 가산기 및 감산기를 포함하는 제 3 가감산단 및 제 3 가감산단 출력 데이터의 쉬프트 연산 수행 결과에 대하여 가산 또는 감산 연산을 각각 수행하여 지정된 비트 수만큼 증가한 비트 수를 갖는 데이터를 출력하는 복수의 가산기 및 감산기를 포함하는 제 4 가감산단으로 이루어져, 동화상 압축 인코더 구현시 하드웨어 복잡도를 낮출 수 있고, 처리 속도를 향상시킬 수 있다.H.264, 인코더, 비트 확장
Int. CL H04N 19/51 (2014.01) H04N 19/43 (2014.01)
CPC
출원번호/일자 1020050030693 (2005.04.13)
출원인 광주과학기술원
등록번호/일자 10-0711088-0000 (2007.04.18)
공개번호/일자 10-2006-0108939 (2006.10.18) 문서열기
공고번호/일자 (20070424) 문서열기
국제출원번호/일자
국제공개번호/일자
우선권정보
법적상태 소멸
심사진행상태 수리
심판사항
구분
원출원번호/일자
관련 출원번호
심사청구여부/일자 Y (2005.04.13)
심사청구항수 3

출원인

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번호 이름 국적 주소
1 광주과학기술원 대한민국 광주광역시 북구

발명자

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번호 이름 국적 주소
1 홍언표 대한민국 전남 광양시
2 하동수 대한민국 광주 북구
3 이정아 대한민국 광주 북구
4 신현섭 대한민국 서울 강동구

대리인

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번호 이름 국적 주소
1 이세진 대한민국 서울특별시 강남구 역삼로 *길 **, 신관 *층~*층, **층(역삼동, 광성빌딩)(특허법인다나)
2 김성남 대한민국 서울특별시 송파구 법원로*길 **(문정동) 에이치비즈니스파크 C동 ***호(에스엔케이특허법률사무소)

최종권리자

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번호 이름 국적 주소
1 광주과학기술원 대한민국 광주광역시 북구
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번호 서류명 접수/발송일자 처리상태 접수/발송번호
1 특허출원서
Patent Application		 2005.04.13 수리 (Accepted) 1-1-2005-0191948-56
2 보정요구서
Request for Amendment		 2005.04.28 발송처리완료 (Completion of Transmission) 1-5-2005-0024721-10
3 서지사항보정서
Amendment to Bibliographic items		 2005.05.06 수리 (Accepted) 1-1-2005-0238246-59
4 명세서등보정서
Amendment to Description, etc.		 2006.03.27 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0211393-10
5 의견제출통지서
Notification of reason for refusal		 2006.08.18 발송처리완료 (Completion of Transmission) 9-5-2006-0473828-04
6 명세서등보정서
Amendment to Description, etc.		 2006.08.29 보정승인간주 (Regarded as an acceptance of amendment) 1-1-2006-0622171-10
7 등록결정서
Decision to grant		 2007.01.18 발송처리완료 (Completion of Transmission) 9-5-2007-0028942-19
8 출원인정보변경(경정)신고서
Notification of change of applicant's information		 2011.09.15 수리 (Accepted) 4-1-2011-5187089-85
번호, 청구항의 정보를 제공하는 이전대상기술 뷰 페이지 상세정보 > 청구항 표입니다.
번호 청구항
1 1
H
2 2
제 1 항에 있어서,상기 가산기는 n 비트의 제 1 및 제 2 데이터를 가산하기 위한 n+1개의 전가산기로 이루어지며,첫번째 전가산기는 0, 제 1 및 제 2 데이터의 첫번째 비트를 각각 입력으로 하여 가산 연산을 수행한 후, 합과 캐리 신호를 출력하고,두번째 전가산기 내지 n번째 전가산기는 전단 전가산기로부터 출력되는 캐리 신호, 제 1 및 제 2 데이터의 두번째 내지 n번째 비트를 각각 입력으로 하여 가산 연산을 수행한 후, 각각의 합과 캐리 신호를 출력하며,n+1번째 전가산기는 n번째 전가산기의 캐리 신호, 제 1 및 제 2 데이터의 n번째 비트를 입력으로 하여 가산 연산을 수행한 후, 각각의 합과 캐리 신호를 출력하는 것을 특징으로 하는 동화상 인코더를 위한 정수 변환 장치
3 3
제 1 항에 있어서,상기 감산기는 n 비트의 제 1 및 제 2 데이터를 감산하기 위한 n+1개의 전가산기로 이루어지며,첫번째 전가산기는 1, 제 1 데이터의 첫번째 비트 및 제 2 데이터 첫번째 비트의 반전값을 각각 입력으로 하여 가산 연산을 수행한 후, 합과 캐리 신호를 출력하고,두번째 전가산기 내지 n번째 전가산기는 전단 전가산기로부터 출력되는 캐리 신호, 제 1 데이터의 두번째 내지 n번째 비트 및 제 2 데이터 반전값의 두번째 내지 n번째 비트를 각각 입력으로 하여 가산 연산을 수행한 후, 각각의 합과 캐리 신호를 출력하며,n+1번째 전가산기는 n번째 전가산기의 캐리 신호, 제 1 데이터의 n번째 비트 및 제 2 데이터 n번째 비트의 반전값을 입력으로 하여 가산 연산을 수행한 후, 각각의 합과 캐리 신호를 출력하는 것을 특징으로 하는 동화상 인코더를 위한 정수 변환 장치
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순번 패밀리번호 국가코드 국가명 종류
1 US2006259536 US 미국 DOCDBFAMILY
국가 R&D 정보가 없습니다.